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- 本书综合了所有最近的主要视频编码标准: AVS China、 H· 264 / MPEG-4 Part 10 ( 今后称之为 H· 264 / AVC)、 VP6 ( 目前 VP10 )、 Dirac、 VC-1 / 2 以及 HEVC / NGVC ( HEVC: 高效视频编码/ 下一代视频编码)0 103浏览会员免费
- 【2021计算机体系结构实验四 解决控制冒险报告】 1. 修改流水线CPU代码,解决无条件跳转指令(JUMP指令)的控制冒险问题。 a) 消除无条件跳转指令的后续指令所产生的影响; 2. 修改流水线CPU代码,解决条件跳转指令(BNE与BEQ指令)的控制冒险问题。 a) 当条件跳转指令的Z信号还未准备好时,需要暂停流水线; b) 消除条件跳转指令的后续指令所产生的影响; 3. 设置指令序列进行仿真,验证所实现流水线CPU能够解决控制冒险问题。 4. 在流水线CPU结构图中做出相应修改: a) 画出为流水线解决数据冒险与控制冒险问题所增加的功能部件及相应控制信号; b) 说明所增加功能部件及相应控制信号是如何被使用。0 552浏览会员免费
- 【2021计算机体系结构实验三 解决数据冒险报告】 (1)使用纯暂停流水线方法解决数据冒险问题: 1. 分析数据冒险出现的情况有哪些; 2. 如何检测数据冒险是否发生; 3. 修改流水线CPU代码,当数据冒险发生时用暂停流水线的方式处理,保证程序运行结果的正确性。 (2)使用内部前推技术+暂停流水线方法解决数据冒险问题: 1. 分析数据冒险出现的情况有哪些; 2. 如何检测数据冒险是否发生; 3. 修改流水线CPU代码,当数据冒险发生时用数据前推的方式处理,保证程序运行结果的正确性。 分析在非Load指令后产生数据冒险时,是否能通过纯内部前推技术得到正确结果。分析当检测到Load指令后数据冒险时,是否能通过内部前推数据+暂停流水线技术得到正确的计算结果。0 536浏览会员免费
- 【2021计算机体系结构实验二 五级流水线 CPU 设计报告】 1. 在单周期CPU代码的基础上添加流水线,补充以下代码以构建具有五级流水线结构的CPU:IF_ID级流水线寄存器(instruction_register) ID_EXE级流水线寄存器(id_exe_register) EXE_MEM级流水线寄存器(exe_mem_register) MEM_WB级流水线寄存器(mem_wb_register) 2. 按规定方式对寄存器与数据存储器进行初始化 3. 对所实现的流水线CPU进行仿真,验证并分析自定义指令序列的运行结果(写指令存储器) 4. 自编代码进行测试5 867浏览会员免费
- 要求设计与实现基本功能部件、CPU各主要功能部件,并对CPU进行封装,将其与内存封装为计算机进行仿真测试。具体要求为: 1. 设计的CPU能够执行5条R型指令、5条I型指令、1条J型指令,每条指令的编码长度均为32位; 2. 指令类型有:加减运算类型add、sub、addiu、subu,比较类型slt、sltu,逻辑运算类型ori,访问存储器类型lw、sw,条件转移类型beq和跳转类型j; 3. 操作数有:寄存器操作数、立即数; 4. 采用给出的指令寄存器进行仿真,结果正确无误。5 1392浏览会员免费
- 1. 编写实验使用的示例程序 2. 理解X86计算机的寻址机制,理解全局描述符表GDT,局部描述符表等数据结构的内容。 3. 查看GDTR,LDTR,DS等寄存器,了解寄存器的数据格式。 4. 根据寄存器和相关的数据结构,计算变量j的线性地址。 5. 使用creg查看寄存器信息 6. 根据线性地址和页内偏移,基于页式地址转换,计算物理地址。0 292浏览会员免费
- 实验结果:全部通过所给的10个测试序列 实验内容:在实验室提供的软硬件环境中,设计并实现一个基本的进程与资源管理器。 该管理器能够完成进程的控制,如进程创建与撤销、进程的状态转换;能够基于 优先级调度算法完成进程的调度,模拟 时钟中断,在同优先级进程中采用时间片 轮转调度算法进行调度;能够完成资源的分配与释放,并完成进程之间的同步。 该管理器同时也能完成从用户终端或 者指定文件读取用户命令,通过 Test shell 模块完成对用户命令的解释,将用户命令转化为对进程与资源控制的具体操作, 并将执行结果输出到终端或指定文件中。0 339浏览会员免费
- 1.根据边沿D触发器74x74的原理图编写设计和仿真模块。 2.根据通用移位寄存器74x194的原理图编写设计和仿真模块。 3.采用1片74x194和其它小规模逻辑门设计3位LFSR计数器,编写设计和仿真模块。 4.根据4位同步计数器74x163的原理图编写设计和仿真模块。 5.输入为100MHz的系统时钟,采用7片74x163和其它小规模逻辑门设计1Hz的数字信号。 6.在FPGA开发板上调试3位LFSR计数器。5 618浏览会员免费
- 1.逻辑输入采用实验箱的K1-K11,逻辑输出接L1-L10。测试实验箱上的HD74LS04P(非门)、SN74LS32N(或门)、SN74LS00N(与非门)、SN74HC86N(异或门)、SN74HC153(数据选择器、多路复用器)的逻辑功能。 2.采用小规模逻辑器件设计一位数据比较器:设一位数据比较器的输入为A、B,比较A>B,A=B,A<B,输出三个比较结果,输出采用低电平有效。 3.分别用小规模和中规模逻辑器件设计3输入多数表决器:设输入为A、B、C,当三个输入有两个或两个以上同意时,输出结果为同意,输入、输出的同意均为高电平有效。 4. 拓展内容(选做)设计一个4位二进制数检测电路,当对应的十进制数为3、7、大于等于11(十进制)时,输出1,否则输出0。尝试只使用与非门实现该逻辑电路。尝试使用4选1数据选择器和其它逻辑门实现该逻辑电路。0 728浏览会员免费
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