verilog-components

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: verilog-ethernet-master_ethernet-verilog_crewmsp_verilog_Etherne Verilog Ethernet Components ReadmeGitHub repository: alexforencich verilog-ethernet
评级：0 浏览量：266 收藏量：0 资源大小：1.68MB 上传时间：2021-10-03

: verilog-pcie-master.zip Collection of PCI express related components. Includes PCIe to AXI and AXI lite bridges and a flexible, high-performance DMA subsystem. Currently supports operation with several FPGA families from ...
评级：0 浏览量：83 收藏量：0 资源大小：1.66MB 上传时间：2022-10-12

: verilog-axi-master_verilog_AXImaster_verilogaxi_axiverilog_AXI_源 Verilog AXI Components ReadmeGitHub repository: alexforencich verilog-axi
评级：4 浏览量：324 收藏量：1 资源大小：306KB 上传时间：2021-10-04

: verilog-ethernet_IntelligentSystems_10GUDp_FPGAverilog_udp_ip_st Collection of Ethernet-related components for gigabit
评级：5 浏览量：90 收藏量：0 资源大小：1.83MB 上传时间：2021-09-30

: 很全的Verilog Ethernet Components(包括G和10G两种)及testBench 用Verilog实现GB和10GB的IP UDP ARP封包，并给出了testBench。压缩包内共计90个verilog文件，注释较丰富。 TOP文件： IP : ip_complete.v (1G) 或 ip_complete_64.v (10G); UDP：udp_complete.v (1G) 或 udp_...
评级：1 浏览量：767 收藏量：8 资源大小：103KB 上传时间：2017-09-17

: ice-chips-verilog:IceChips是Verilog中所有常见离散逻辑设备的库冰屑verilog Verilog中用于电子设计自动化的74LS，74HC，74HCT系列芯片 Fully validated by test bench · Parametrized code · DELAY parameters for timing simulation IceChips旨在支持和宣言：入门使用...
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: VerilogCogs:用于 DSP 功能和其他常见任务的 Verilog 模块，使 FPGA 开发更轻松、更有趣将所有 Verilog 文件复制到 library/components 文件夹中。包含模块的清单伺服.v - 用于驱动业余伺服的伺服输出模块。振荡器.v - 一个紧凑的正弦振荡器，用于产生固定频率的正弦波。 sdDac.v - 一阶 sigma-delta ...
评级：0 浏览量：102 收藏量：0 资源大小：11KB 上传时间：2021-06-01

: import_components:外部组件模块的参考源文件导入组件外部组件模块的参考源文件这包含在创建“导入 BVI”文件时用作原始参考的供应商文件。版权/所有权归原作者所有。目录 z7all 包含 z7all.zip 中的 txt 文件，引用自 ug865-Zynq-7000-Pkg-Pinout.pdf： ...
评级：0 浏览量：72 收藏量：0 资源大小：1.11MB 上传时间：2021-06-27

: Collection of AXI4 and AXI4 lite bus components. Introduction Collection of AXI4 and AXI4 lite bus components. Most components are fully parametrizable in interface widths. Includes full cocotb testbenches that utilize cocotbext-axi.
评级：0 浏览量：50 收藏量：0 资源大小：430KB 上传时间：2022-10-12

: dblclockfft:流水线式Verilog FFT内核的可配置C ++生成器通用的FFT核心生成器这个通用的流水线FFT项目包含创建IP以生成任意大小的FFT所需的所有软件。 FFT已修改，可以在以下模式之一中运行：每个时钟输入两个样本，经过一段时间的延迟后，每个时钟输出两个样本。...
评级：0 浏览量：104 收藏量：0 资源大小：315KB 上传时间：2021-05-17

: Introduction to Verilog Introduction to Verilog <br>n Learn the basic constructs of Verilog n Learn the modeling structure of Verilog n Learn the ... a Verilog Model n Components of a Verilog Module –...
评级：0 浏览量：91 收藏量：0 资源大小：260KB 上传时间：2007-08-24

: sdspi:SD卡控制器，使用（可选）共享的SPI接口 SD卡控制器，使用共享的SPI接口该Verilog内核将SD卡控制器接口从内部FPGA导出到FPGA内核的其余部分，同时还要注意接口内部的底层细节。与提供完整SD接口的不同，该控制器专注于SD卡的SPI接口。虽然这是一个较慢的...
评级：0 浏览量：139 收藏量：0 资源大小：337KB 上传时间：2021-05-25

: [Verilog] Digital Design (Verilog): An Embedded Systems Approach Using Verilog Digital Design (Verilog): An Embedded Systems Approach Using Verilog Product Description Digital Design: An Embedded Systems Approach Using Verilog provides a foundation in digital design for ...
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: An Embedded Systems Approach Using Verilog Digital Design: An Embedded Systems Approach Using ... this book provides an understanding of the hardware needed in the analysis and design of systems comprising both hardware and software components.
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