5级流水线CPU

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5级流水线CPU

: 5级流水线CPU 5级流水线CPU，处理了data hazard，验收过了啦
评级：0 浏览量：1199 收藏量：4 资源大小：2.52MB 上传时间：2015-12-24

: 静态5级流水 MIPS CPU实现.rar 1 实验材料-静态5级流水 MIPS CPU实现.docx 实验内容文档 2 体系结构实验课_V1.ppt 讲解PPT 3 报告模板.docx 报告封皮 4 Basys3实验指导手册-V1.0.pdf basys3 板卡资料 5 verilog示例代码rtl_code ppt...
评级：5 浏览量：824 收藏量：6 资源大小：48.13MB 上传时间：2021-11-30

: 16位5级流水线CPU设计使用Verilog实现16位5级流水线CPU设计
评级：1 浏览量：877 收藏量：12 资源大小：2.34MB 上传时间：2016-05-17

: 硬件综合设计5级流水线CPU 我们大三小学期的硬件综合设计项目，实现了57条指令，连接了soc，实现了axi接口，并且能够成功上板，压缩包解压后便可以直接将文件引用到vivado中。
评级：0 浏览量：96 收藏量：2 资源大小：31KB 上传时间：2023-01-16

: 基于logisim平台mips实现5级流水线cpu 完整cric文件计算机组成与设计作业资源分享
评级：0 浏览量：294 收藏量：1 资源大小：15.63MB 上传时间：2023-05-29

: MIPS五级流水线_实验代码.zip 1)用硬件描述语言（Verilog）设计MIPS流水线CPU，支持如下指令集： {add,addi,addiu,addu,and,andi,beq,bne,divu,j,jal,jr,lb,lbu ,lhu,lui, lw,multu,mfhi,mflo,or,ori,slt,slti,sltu,sll,sra,srl,sb,sh,sw,sub,...
评级：0 浏览量：1348 收藏量：8 资源大小：34KB 上传时间：2020-06-28

: 五级流水线cpu.zip 五级流水线cpu
评级：0 浏览量：289 收藏量：0 资源大小：11KB 上传时间：2021-07-16

: MIPS五级流水线CPU（全部注释）系统硬件综合设计设计并实现一个多周期和流水CPU。 1.若干段流水、可以处理冲突。 2.三种类型的指令（R类，I类，J类指令）若干条。 3.CPU指令集（MIPS、ARM、RISC-V等均可）不限
评级：5 浏览量：2949 收藏量：33 资源大小：208KB 上传时间：2021-04-28

: Verilog实现MIPS的5级流水线cpu设计（Modelsim仿真）.rar 里面是制作5级流水线CPU的源代码文件，用的是Verilog编程，Modelsim仿真。程序实现了数据冒险和控制冒险的解决。配套博文：https://blog.csdn.net/WXY19990803/article/details/104008650
评级：0 浏览量：3072 收藏量：29 资源大小：13KB 上传时间：2020-07-16

: 基于MIPS32的5级流水线CPU设计与实现.zip 2.采用 5 级流水线技术，具有数据前推机制。 3.具有解决控制冒险，数据冒险等问题的能力，能够插入气泡暂停等。 4.具有缩短分支的延迟等方案。详细分析过程及代码分析参见：...
评级：4 浏览量：3099 收藏量：22 资源大小：11.45MB 上传时间：2020-03-18

: 16位5级流水线CPU 16位5级流水线CPU，可执行简单的指令，测试文件已给出
评级：0 浏览量：440 收藏量：3 资源大小：8KB 上传时间：2015-06-07

: src_基于RISCV的流水线CPU设计_ricsv_五级流水线_源码本设计在RICSV的基础上用Verilog语言实现了流水线CPU设计，项目中包含了五级流水线各自的源文件和testbench文件。
评级：5 浏览量：1800 收藏量：20 资源大小：16KB 上传时间：2021-10-02

: 五级流水线cpu的实现+实验报告.zip 五级流水线cpu的实现+实验报告五级流水线cpu的实现+实验报告.zip 五级流水线cpu的实现+实验报告.zip 【项目介绍】该资源内项目代码都是经过测试运行成功，功能ok的情况下才上传的，请放心下载使用！本项目适合...
评级：5 浏览量：162 收藏量：2 资源大小：23.17MB 上传时间：2023-08-09

: 基于Verilog实现mips五级流水线CPU设计【100013168】 1）五级整数流水线，分别是：取指、译码、执行、访存、回写 2）哈佛结构，分开的指令、数据结构 3）32 个 32 位整数寄存器 4）大端模式 5）向量化异常处理，支持精确的异常处理 6）支持 6 个外部中断 7）具有 ...
评级：5 浏览量：714 收藏量：2 资源大小：990KB 上传时间：2023-08-11

: cpu.zip（5级流水线结构的CPU实现）一个 5 级流水线结构的简单 CPU的实现。TinyMIPS 的流水线共分为五级，对应五个功能模块，分别为 IF（取指令）、ID（译码）、 EX（执行）、MEM（访存）、WB（写回）。而这五个流水级分别对应 CPU 处理指令时的五个...
评级：0 浏览量：1558 收藏量：12 资源大小：14.51MB 上传时间：2020-05-25

: 三级流水线CPU 三级流水线CPU的实现成功在FPGA开发板上通过此CPU实现流水灯的运行。该CPU实现了十多条常用指令，代码中含有指令结构和详细介绍。通过DEBUG分析，最后得到的频率有200多M
评级：5 浏览量：1098 收藏量：4 资源大小：142KB 上传时间：2019-04-09

: 五级流水线CPU完整设计（包括control hazard和data hazard处理）建议师弟师妹们还是要自己写，完整地理解好CPU设计的思路，不要直接在网上找到就抄。http://blog.csdn.net/c602273091/article/details/35883557 大家可以到师兄博客看一下hazard解决的思路分析。
评级：1 浏览量：5140 收藏量：16 资源大小：17KB 上传时间：2015-06-18

: 应用背景 Verilog 实现 MIPS32 V1整数指令集， 5级流水线CPU 没有文档应用背景 Verilog 实现 MIPS32 V1整数指令集， 5级流水线CPU 没有文档，按照流水线划分模块，代码注释多，便于理解。FPGA验证通过，可综合。关键技术五级流水线MIPS处理器verilog源码，实现MIPS32的整数指令，代码...
评级：0 浏览量：64 收藏量：0 资源大小：44KB 上传时间：2023-01-31

: 五级流水线 CPU 设计【100012365】完成五级流水线 CPU 核心模块的设计。完成对五级流水线 CPU 的仿真，仿真测试程序应该具有与实验一提供的标准测试程序代码相同的功能。对两种 CPU实现核心处理功能的过程和设计处理上的区别作对比分析 ...
评级：5 浏览量：226 收藏量：0 资源大小：12.21MB 上传时间：2023-05-22

: 探秘X86架构CPU流水线 当我们讨论某个新款处理器拥有 12 级流水线还是 18 级流水线，甚至是更深的 31 级流水线时，这到些都意味着什么呢？　应用程序通常会将 CPU 看作是黑盒子。程序中的指令按照顺序依次进入 CPU,执行完之后再按顺序...
评级：0 浏览量：442 收藏量：0 资源大小：292KB 上传时间：2021-01-19

: 应用背景 Verilog 实现 MIPS32 V1整数指令集， 5级流水线CPU 没有文档，按照流水线划分模块，代码注释多，... 应用背景 Verilog 实现 MIPS32 V1整数指令集， 5级流水线CPU 没有文档，按照流水线划分模块，代码注释多，便于理解。FPGA验证通过，可综合。关键技术五级流水线MIPS处理器verilog源码，实现MIPS32的整数指令，代码...
评级：5 浏览量：88 收藏量：1 资源大小：44KB 上传时间：2023-03-10

: Verilog流水线CPU配套源码 Verilog流水线CPU配套源码（v文件），详细代码注释以及流程分析信息请移步至本人博客“Verilog流水线CPU设计（超详细）” 已经于2019.12.17更新
评级：5 浏览量：6947 收藏量：36 资源大小：31KB 上传时间：2020-11-23

: 简单基本流水线CPU设计VerilogHDL（含源代码+报告+原理图）简单基本流水线CPU设计VerilogHDL（含源代码+报告+原理图）简单的流水线CPU，报告原始设计图，VerilogHDL语言的代码，已经Quartus工程项目设计文档等等
评级：5 浏览量：2796 收藏量：15 资源大小：27.49MB 上传时间：2021-07-03

: 流水线CPU代码设计北航计算机组成课程设计支持20条指令的流水线CPU的Verilog代码实现，内包含源代码和相应的测试文件
评级：0 浏览量：869 收藏量：6 资源大小：31KB 上传时间：2018-05-08

: MIPS五级流水线CPU+cache设计 verilog编写的MIPS五级流水线，实现四十余条指令，使用512B的一级数据cache（高速缓存）。附带测试程序与说明文档。
评级：5 浏览量：1971 收藏量：27 资源大小：361KB 上传时间：2018-06-29

: 基于五级流水线CPU的分支预测+实验报告+项目说明.zip 基于五级流水线CPU的分支预测+实验报告+项目说明【项目介绍】该资源内项目代码都是经过测试运行成功，功能ok的情况下才上传的，请放心下载使用！本项目适合计算机相关专业(如计科、人工智能、通信工程、自动化、...
评级：5 浏览量：172 收藏量：2 资源大小：23.5MB 上传时间：2023-08-09

: CPU流水线设计报告,流水线处理器的基本原理,Verilog 4本次开发使用的硬件描述语言是 Verilog 语言，使用的指令系统是一个以 MIPS 指令集为子集的指令系统，共 22 条指令，所用的设计仿真软件Modelsim。
评级：5 浏览量：901 收藏量：5 资源大小：2.06MB 上传时间：2021-09-10

: 计算机组成实验Project5流水线CPU源代码通过强测和P5课上测试，支持addu,subu,ori, beq,lw, sw, lui, j, jal, jr, nop指令；支持转发和暂停处理冲突机制；仅可用于参考，不要将其直接上传，否则被查重后果自负。
评级：0 浏览量：413 收藏量：4 资源大小：17KB 上传时间：2019-01-15

: vivado简单流水线cpu设计计算机组成简单流水线cpu的设计 1.解决数据冒险和结构冒险 2.实现周期结束后各阶段的锁存 3.实现内部前推
评级：0 浏览量：1832 收藏量：13 资源大小：2.5MB 上传时间：2018-12-04

: 基于risc-V的五级流水线CPU实验项目+实验报告.zip 基于risc-V的五级流水线CPU实验项目+实验报告.zip基于risc-V的五级流水线CPU实验项目+实验报告.zip基于risc-V的五级流水线CPU实验项目+实验报告.zip基于risc-V的五级流水线CPU实验项目+实验报告.zip基于risc-V的五级...
评级：5 浏览量：160 收藏量：2 资源大小：321KB 上传时间：2023-12-29

: MIPS流水线CPU设计（武汉大学计算机学院专用）本文围绕着指令执行过程中需经历的五个阶段，详细描述了处理器中各阶段的逻辑设计...在完成了CPU的整体逻辑设计后，通过Modelsim仿真软件在所设计的CPU上运行了测试程序，测试输出波形表明了处理器逻辑设计的正确性。
评级：0 浏览量：2108 收藏量：17 资源大小：232KB 上传时间：2018-06-22

: 五级流水线cpu修正版五级流水线cpu修正版
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: 五级流水线CPU VHDL代码实现这是模拟MIPS机的五级流水线而设计的用VHDL代码实现的CPU。该运行环境是QUART||
评级：5 浏览量：622 收藏量：7 资源大小：1.47MB 上传时间：2012-11-21

: 流水线CPU课程设计Demo 学校CPU课程设计代码，需要的可以借鉴一下，如有错误请多包涵
评级：0 浏览量：292 收藏量：2 资源大小：6.81MB 上传时间：2018-03-20

: 流水线CPU设计(50条指令) 北航计算机组成课程设计支持50条指令的流水线CPU的Verilog代码实现，内包含源代码和相应的测试文件
评级：0 浏览量：1679 收藏量：21 资源大小：57KB 上传时间：2018-05-08

: CPU五级流水线 CPU 五级流水线 计算机组成原理课设。CPU 五级流水线 计算机组成原理课设
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: 流水线CPU Verilog设计 流水线CPU 包括转发暂停等功能，支持mips除eret ，mtc0，mfc0外所有指令(包括乘除运算，读写hi lo，取字节等等）乘除分别需要5，10个周期，代码能通过测试。
评级：4 浏览量：1202 收藏量：13 资源大小：2.15MB 上传时间：2015-12-23

: 多周期五段流水线MIPS CPU 实现了五段流水线的MIPS CPU，代码分模块书写，内容详尽，代码易读
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: 一个MIPS流水线CPU的设计-综合文档一个MIPS流水线CPU的设计
评级：0 浏览量：239 收藏量：0 资源大小：10.83MB 上传时间：2021-05-23

: 单周期流水线CPU实现.rar 使用verilog语言，对cpu进行了设计和实现，对三十多条指令都做了设计，并成功实现其功能，做cpu实验的大学同学可以参考，后面还会发一个实验报告。
评级：5 浏览量：638 收藏量：5 资源大小：321KB 上传时间：2020-03-16

: 五级流水线cpu 流水线cpu的实现，代码调试过了，解决冲突方面改进很多
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: exp7_final.rar_流水线cpu CPU流水线设计实现旁路停顿和控制竞争处理源代码
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: 北航计组Verilog流水线CPU 北航16级老学长的P6课设，仅供参考，抄袭责任自负五级流水线CPU 祝愿每位航友圆满计组实验 (摘要大于50字实在不知道要写啥啊啊啊啊啊啊啊啊啊啊啊啊)
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: darkriscv.rar_cpu架构_riscv cpu core_五级cpu_五级流水线_流水线一个基于riscv 指令集架构的软核，它实现了五级流水线结构，非常适合于cpu开发者学习使用。
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: 单周期流水线cpu实验报告.docx 对前面发的实验代码做了一个系统的讲解，包括各个模块的功能，实现的原理和机制，接口的参数设置，运行结果展示都一一列举出来。
评级：0 浏览量：601 收藏量：3 资源大小：654KB 上传时间：2020-03-16

: 西工大计算机组成与结构基础实验满绩单周期、流水线CPU代码、报告实验分块在压缩包内，包含所有.v源文件，有的有QuestaSim或Vivado仿真工程，含有单周期和流水线报告各4份，最终实验成绩满绩。
评级：0 浏览量：1096 收藏量：27 资源大小：20.32MB 上传时间：2022-07-26

: vivado简单流水线cpu设计-网络设备代码类资源计算机组成简单流水线cpu的设计 1.解决数据冒险和结构冒险 2.实现周期结束后各阶段的锁存 3.实现内部前推
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: MIPS 五段流水线CPU.rar MIPS五段流水线CPU vivado实现计算机组成原理实验。
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: CPU五级流水线verilog源代码使用了verilog写的五级流水线。处理过了hazard，还有stall。
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: MIPS多周期流水线CPU设计计算机组成原理课程作业：使用verilog完成 1、完成四十余条MIPS指令； 2、使用五级流水线； 3、单发射，无cache，无分支预测，使用延迟槽； 4、含测试代码和说明文档。
评级：0 浏览量：2915 收藏量：31 资源大小：8.23MB 上传时间：2018-06-29

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