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流水线CPU设计(50条指令) 评分:

北航计算机组成课程设计 支持50条指令的流水线CPU的Verilog代码实现,内包含源代码和相应的测试文件
2018-05-08 上传大小:57KB
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MIPS_54条指令CPU

计算机组成原理课设要求做的54条cpu 用verilog HDL在vivado上编写的MIPS指令集的cpu,可以在N4板上下板运行,具体指令再实验报告和test文件夹中有 cputest文件夹是测试指令,在前仿真cpu时可以读取这些txt文件中的指令到内存中去,将结果输出到指定文件中,再与文件夹中的答案对比验证 用于前仿真的测试代码与最终的下板代码会有一点差异(关于频率和文件读写等),都是注释掉的,简单修改即可 两个实验报告中有比较详细的cpu设计图作为参考

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MIPS五级流水线baseline代码

这是一个关于32位MIPS处理器的五级流水线baseline代码,实现了一条ori指令。并附有模块的互联图。大家可以根据baseline代码往里添加指令。

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基于MIPS指令集的32位CPU设计与Verilog语言实现_流水线CPU

用Verilog语言设计的流水线CPU,资源里包含了源代码及流水线CPU结构图,与大家分享下。

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计算机组成原理实验(Modelsim+单周期+多周期流水线

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基于logisim的五段流水线设计

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CPU五级流水线verilog源代码

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vivado简单流水线cpu设计

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