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src_基于RISCV的流水线CPU设计_ricsv_五级流水线_源码
共21个文件
v:21个
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2021-10-02
03:41:26
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本设计在RICSV的基础上用Verilog语言实现了流水线CPU设计,项目中包含了五级流水线各自的源文件和testbench文件。
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src.zip (21个子文件)
Risc5CPU.v 6KB
ALU.v 2KB
dffr.v 216B
ID.v 3KB
dff.v 170B
Branchtest.v 1KB
adder_4bits.v 1KB
mux.v 627B
register.v 1KB
DataRAM_sim_netlist.v 24KB
adder2_4bits.v 910B
IF_tb.v 1KB
Decode_tb.v 2KB
InstructionROM.v 2KB
ALU_tb.v 1KB
Risc5CPU_tb.v 813B
IF.v 1KB
EX.v 2KB
adder32bits.v 1KB
dffre.v 246B
decoder.v 5KB
共 21 条
- 1
资源评论
- weixin_459638622022-06-01用户下载后在一定时间内未进行评价,系统默认好评。
- qq_457961352022-06-13用户下载后在一定时间内未进行评价,系统默认好评。
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海四
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