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5级流水线CPU 评分:

5级流水线CPU,处理了data hazard,验收过了啦
2015-12-24 上传大小:2.52MB
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MIPS五级流水线CPU(verilog实现)

计算机组成原理课程实验:一个MIPS五级流水线CPU 内含全部源代码和实验文档,verilog实现,开发平台为ISE

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支持RISC-V指令集,32位5级流水线,支持Flush与转发操作的CPU

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MIPS五级流水线baseline代码

这是一个关于32位MIPS处理器的五级流水线baseline代码,实现了一条ori指令。并附有模块的互联图。大家可以根据baseline代码往里添加指令。

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五级流水线CPU完整设计(包括control hazard和data hazard处理)

建议师弟师妹们还是要自己写,完整地理解好CPU设计的思路,不要直接在网上找到就抄。http://blog.csdn.net/c602273091/article/details/35883557 大家可以到师兄博客看一下hazard解决的思路分析。

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五级流水线MIPS指令集cpu设计,verilog语言,通过modelsim与ISE并下载FPGA验证(计算机组成原理)

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五级流水线CPU VHDL代码实现

这是模拟MIPS机的五级流水线而设计的用VHDL代码实现的CPU。该运行环境是QUART||

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CPU五级流水线verilog源代码

使用了verilog写的五级流水线。处理过了hazard,还有stall。

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多周期五段流水线MIPS CPU

实现了五段流水线的MIPS CPU,代码分模块书写,内容详尽,代码易读

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五级流水线MIPS微处理器部分指令实现(Verilog)

Verilog实现MIPS处理器部分指令,不乏存在错误,还请指出。

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基于mips的5级流水cpu verilog

基于mips的基本5级流水线cpu verilog实现 有结构图

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组原课设 5段流水线CPU

华科组原课设,在logisim平台实现单周期CPU,5段流水线,理想流水线,插气泡和数据重定向处理各种冲突,包含老师给的各种测试案例和运行结果,以及各种故障处理。包括任务书和mips指令集

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基于MIPS指令集的32位CPU设计与Verilog语言实现_流水线CPU

用Verilog语言设计的流水线CPU,资源里包含了源代码及流水线CPU结构图,与大家分享下。

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16位5级流水线CPU设计

使用Verilog实现16位5级流水线CPU设计

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带有缓存的流水线CPU设计

使用Verilog实现带有缓存的16位5级流水线CPU设计

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16位5级流水线CPU

16位5级流水线CPU,可执行简单的指令,测试文件已给出

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8位MINI cpu试验报告

根据《自己动手写CPU》编写的5级流水线的MINI 8位CPU

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C#编写的MIPS汇编模拟器

C#编写的基于MIPS指令集的一个汇编模拟器 MIPS是五级流水线的体系结构,该模拟器支持将汇编源码转译成二进制的机器码,可带设置断点。模拟器模拟机器码的执行,可以单步执行,多步执行到断点处,完全可视化的模拟界面,可以动态查看和修改寄存器和存储器的值,支持数据定向和stall。 本模拟器的另一大特点是带cache测试,可以配置cache模块的各种功能和替换算法,动态统计cache的失效率 请最好用VS2008以上版本打开工程

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cpu有关于hazard的处理

写好的5级流水线cpu修改完善hazard部分,包括data forward 和control hazard

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计算机体系结构五级流水线模拟器 MIPS

计算机体系结构 五级流水线 模拟器 C# MIPS 计算机体系结构 五级流水线 模拟器 C# MIPS 计算机体系结构 五级流水线 模拟器 C# MIPS

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硬件描述语言写的采用流水线的CPU

用VHDL和Verilog写的CPU,采用了5级流水线,50MHz工作,在FPGA中运行,采用MIPS指令集

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