DDR3开发

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DDR3开发

: xilixn mig DDR3开发与应用 Xilinx MIG DDR3接口开发 1，xilinx DDR3控制mig IP的应用（一） 2，xilinx DDR3控制mig IP的应用（二） 3，xilinx DDR3控制mig IP的应用（三） 4，xilinx DDR3控制mig IP的应用（四） 5，xilinx DDR3控制mig IP的...
评级：0 浏览量：448 收藏量：4 资源大小：18.17MB 上传时间：2019-03-01

: xilinx sparten6 ddr3 开发手册 xilinx sparten6 ddr3 开发手册.pdf
评级：0 浏览量：153 收藏量：1 资源大小：2.07MB 上传时间：2016-01-09

: verilog实现ddr3功能代码实现ddr3功能，并非控制器功能
评级：0 浏览量：129 收藏量：2 资源大小：458KB 上传时间：2022-02-08

: Xilinx ISE MIG 中文教程 DDR3开发利器图文并茂、简明易懂的MIG仿真、综合、自定义用户接口教程，适合FPGA DDR3初学者
评级：2 浏览量：528 收藏量：5 资源大小：23.47MB 上传时间：2017-12-31

: DDR3 DRAM开发协议中文版.pdf DDR3开发必备，内容由标准的英文版本翻译而来，对开发DDR3 DRAM的开发者由很大的帮助。DDR3属于SDRAM家族的存储器产bai品，提供相较于DDR2 SDRAM更高的运行性能与更低的du电压，是DDR2 SDRAM（四倍数据率同步动态...
评级：1 浏览量：2980 收藏量：15 资源大小：6.08MB 上传时间：2020-06-27

: vivado开发的DDR3读写这个工程只包含了从DDR的自定义地址中读取数据，如果需要查看写数据的工程，可以查看我主页的另一个工程
评级：0 浏览量：9 收藏量：0 资源大小：206.16MB 上传时间：2024-04-25

: DDR3控制信号简介 DDR3各个控制信号功能简介，方便FPGA开发控制程序的编写
评级：0 浏览量：696 收藏量：0 资源大小：13KB 上传时间：2018-07-04

: DDR3设计规范 DDR3的设计规范，，可以供硬件工程师开发的时候以及研发的时候参考用
评级：0 浏览量：453 收藏量：0 资源大小：1.1MB 上传时间：2015-08-16

: xilinx ddr3 这要针对ddr3 xilinx开发绝对全面而且使用起来很方变
评级：0 浏览量：221 收藏量：2 资源大小：455KB 上传时间：2018-04-01

: Quartus EMIF DDR3 IP 仿真工程本资源是 Quartus EMIF DDR3 IP 测试工程，使用 Quartus External Memory Interfaces IP 实现 DDR3 控制器和物理层接口，开发平台版本为 Quartus Prime Pro 21.3，仿真平台版本为 Modelsim-SE64 10.7，工程主要用于...
评级：0 浏览量：244 收藏量：0 资源大小：53.05MB 上传时间：2023-07-07

: ddr3指导文档 ddr3的读写程序，通过仿真测试和硬件平台测试，用的是vivado和modelsim，测试通过！用xilinx的ip核，用户接口模块是自己写的！
评级：0 浏览量：92 收藏量：1 资源大小：18.12MB 上传时间：2016-01-20

: ddr3控制器VHDL实现使用VHDL语言实现DDR3控制，已通过测试
评级：0 浏览量：84 收藏量：0 资源大小：101KB 上传时间：2022-02-08

: DDR3协议标准-JEDEC STANDARD DDR3 SDRAM Specification DDR3协议标准-JEDEC STANDARD DDR3 SDRAM Specification
评级：0 浏览量：312 收藏量：0 资源大小：5.35MB 上传时间：2023-04-17

: Verilog ddr3测试工程代码例子 Verilog ddr3测试工程代码例子，xilinx开发环境，对初学者很有借鉴意义。
评级：0 浏览量：138 收藏量：0 资源大小：47.48MB 上传时间：2022-08-20

: 黑金ax7101和7102 DDR3读写测试仿真例程及代码提供AX7101和7102 官方DDR3读写测试仿真例程实验指导，内含代码，包括IP核配置，管脚约束文件等，讲解详细，已下板测试成功，适合DDR3初学者了解和深入学习。
评级：1 浏览量：983 收藏量：3 资源大小：89.07MB 上传时间：2019-08-31

: FPGA与ddr3通讯内存自检 1. 基于Artix-7芯片xc7a200t-sbv484 2. 使用Vivado提供的MIG7作为DDR3的控制器 3. 使用Vivado提供的DDR3验证模型ddr3_model 4. 一个内存自检模块的建模和验证
评级：0 浏览量：69 收藏量：1 资源大小：29.97MB 上传时间：2023-07-02

: lattice ddr3控制器开发手册 lattice ddr3控制器开发手册
评级：0 浏览量：261 收藏量：0 资源大小：1.04MB 上传时间：2016-01-09

: 镁光DDR3 MT41J128M16数据手册文档详细介绍了这款低功耗DDR3的数据资料，是硬件开发和软件驱动编写的好助手
评级：0 浏览量：1362 收藏量：1 资源大小：2.81MB 上传时间：2018-12-22

: DDR3 user guide xilinx ddr3 的用户手册，开发ddr3必备。
评级：0 浏览量：113 收藏量：0 资源大小：15.24MB 上传时间：2016-04-05

: PanGo-FPGA-AD7606-DDR3-HDMI 本次代码采用盘古开发板AVP50G_Pango，配置AD7606驱动实测195Khz采样率，采集的数据放入DDR3中，DDR3存储的数据通过FIFO读取出来，读取出来后通过HDMI输出到显示器上，因为显示器默认60HZ，所以需要DDR3进行缓存。...
评级：0 浏览量：52 收藏量：0 资源大小：20.93MB 上传时间：2023-12-27

: DDR3 PHY Calc v10.xlsx DDR3初始化计算工具，适合DSP、FPGA平台使用DDR3的开发人员计算相关参数
评级：0 浏览量：238 收藏量：1 资源大小：60KB 上传时间：2021-05-25

: 基于深度学习的Xilinx DDR3存储器接口解决方案，适合FPGA的初学者，也适合需要使用DDR进行FPGA设计的设计... Xilinx将DDR3存储控制器IP核以源码形式展现给用户，用户可以根据具体的应用需求，配置更改DDR3存储控制器IP核，进而帮助用户降低设计的难度，加快开发的进度。本文主要对XilinxDDR3存储器接口解决方案进行详尽的...
评级：0 浏览量：16 收藏量：0 资源大小：2.33MB 上传时间：2024-05-10

: 基于DDR3的大容量FIFO的设计与验证开发基于ddr3的大容量FIFO的设计，能用于数据量缓存应用
评级：1 浏览量：1810 收藏量：4 资源大小：1.88MB 上传时间：2018-04-04

: DDR3 Design Requirements for KeyStone Devices 该文档是TI DSP关于DDR3开发的技术说明书，有助于开发者对其进行开发
评级：0 浏览量：145 收藏量：1 资源大小：582KB 上传时间：2017-04-12

: xilinx ultrascale ddr3控制器开发手册 xilinx ultrascale ddr3控制器开发手册
评级：0 浏览量：259 收藏量：0 资源大小：20.56MB 上传时间：2016-01-09

: 双片ddr3正反贴PCB_layout.BRD 双片DDR3正反贴布局布线，等长已经绕好。节省空间，可以拿去复制直接用。cadence文件。接FPGA。需要再FPGA端调整下管脚。现在是接的K7的BANK33、34布线。
评级：5 浏览量：489 收藏量：0 资源大小：162KB 上传时间：2022-05-27

: 基于Xilinx FPGA的DDR3读写控制模块（包含整个工程）基于Xilinx FPGA的DDR3控制器读写程序，此程序已经用于实际的项目中，读写控制很稳定。上传的是一个实际的DDR3工程，开发环境为Vivado 2017.4
评级：3 浏览量：5663 收藏量：63 资源大小：35.06MB 上传时间：2018-07-05

: 『FPGA通信接口』DDR(3)DDR3颗粒读写测试含两片DDR3、四片DDR3，两片DDR4，DDR3 SODIMMs内存条四个读写测试工程。
评级：0 浏览量：38 收藏量：0 资源大小：338.74MB 上传时间：2024-04-30

: 紫光同创 DDR3 仿真工程紫光同创 DDR3 控制器 IP 仿真工程，从 Modelsim 进入解压后的文件夹，可以直接运行仿真。如果要重新编译工程，需要删除 work 文件夹，然后运行 run.bat 文件。资源已更新，修复仿真过程中可能缺少 pango 库的问题。
评级：4 浏览量：570 收藏量：4 资源大小：13.05MB 上传时间：2022-07-30

: 韩国三星电子开发出512MB DDR3显示内存联合通讯社汉城12月9日电据三星电子9日称，在世界上率先开发出每秒运行速度为1.6Gbps的512MB DDR3显示内存。此前的最大容量和最高速度分别是256Mb及1.4Gbps/秒。　三星电子方面介绍说，DDR3显示内存是驱动电压...
评级：0 浏览量：94 收藏量：0 资源大小：38KB 上传时间：2020-11-28

: Xilinx DDR3 PCB Design Guide 该文档是Xilinx官方发布的DDR3信号完整性和PCB设计指南，对于使用Xilinx FPGA进行DDR3电路设计的PCB开发很有指导性。
评级：0 浏览量：309 收藏量：1 资源大小：1.45MB 上传时间：2017-10-22

: FPGA 3GSDI 采集输出 DDR 3 缓存方案 SDI 接口即数字分量串行接口（Serial Digital Interface），是 1989 年由 SMPTE（电影和电视工程师协会）标准化的一系列数字视频接口。
评级：0 浏览量：98 收藏量：0 资源大小：1.57MB 上传时间：2023-09-20

: 关于ddr3的资料压缩包.rar 发一些 ddr3 的资料，方便自己，方便他人。有兴趣的朋友可以看一下。
评级：0 浏览量：173 收藏量：0 资源大小：5.66MB 上传时间：2020-02-21

: DDR3内存的PCB仿真与设计本文主要使用了Cadence公司的时域分析工具对DDR3设计进行量化分析，介绍了影响信号完整性的主要因素对DDR3进行时序分析，通过分析结果进行改进及优化设计，提升信号质量使其可靠性和安全性大大提高。
评级：0 浏览量：202 收藏量：0 资源大小：342KB 上传时间：2020-08-30

: ddr3 datasheet ddr3 的datasheet，开发用到ddr3时候时候总归要看看
评级：5 浏览量：226 收藏量：0 资源大小：8.14MB 上传时间：2011-09-01

: DDR3 Memory Down 配置用于DDR3L MEMORY DOWN开发参考，主要用于BIOS开发工程师或硬件开发工程师！
评级：1 浏览量：582 收藏量：1 资源大小：19KB 上传时间：2018-07-25

: TMS320C6678 DDR3设计指导文件 TMS320C6678硬件设计DDR3指导文档，包括DDR3设计约束和DDR3参数配置，可供参考。主要用于开发设计，详见附件。
评级：0 浏览量：788 收藏量：1 资源大小：647KB 上传时间：2019-11-20

: 基于FPGA、DDR3和USB2.0的图像采集系统基于FPGA、DDR3和USB2.0的图像采集系统。内含usb回环测试代码、完整FPGA项目文件、三种上位机、PCB设计、ov5640-vga-usb-full-AX545、ddr_test、ov5640-vga-usb-test、sd_test、usb_test等文件
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: FDMA（DDR3 控制器） xilinx FPGA开发中使用VIVADO来对DDR3内存进行控制器的DMA。主要是用于A7,K7,V7系列的FPGA，块控制DDR3时使用
评级：5 浏览量：469 收藏量：2 资源大小：14KB 上传时间：2022-05-05

: XILINX_DDR3_IP核使用教程2.0版.zip 详细介绍了如何使用赛灵思公司的DDR3 ip核进行设计，由浅入深，面面俱到，只要看完这篇文档应该可以上手了，资源很不错，如果有问题可以留言给我，我最近也在研究DDR3的开发设计，下一步准备写一些测试程序上传，...
评级：0 浏览量：497 收藏量：3 资源大小：24.49MB 上传时间：2019-07-19

: sp605 ddr3学习文档这是开发sp605上ddr3资源的一个过程和总结。作者是一个第一次用xilinx系列硬件的小白开发员，经过思考和测试完成了MCB的第一次调试，很详细，也是一步步来的。
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: DDR_Stress_tESTER工具用于测试更换的DDR，是否满足要求。支持cpu为IMX6Q。适合样板调试。使用方便。测试DDR,DDR,DDR
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: DDR3走线规则 DDR走线规则，硬件开发必备，方便硬件开发，及画图人员走线，
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: DDR2和DDR3的PCB信号完整性设计　它主要涉及到对DDR2和DDR3在设计印制线路板(PCB)时，考虑信号完整性和电源完整性的设计事项，这些是具有相当大的挑战性的。文章重点是讨论在尽可能少的PCB层数，特别是4层板的情况下的相关技术，其中一些设计方法...
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: Infineon 推出业界首款DDR3内存模组英飞凌科技公司（Infineon）近日宣布，该公司已向PC业界领先开发商提供了业界首款DDR3 （双数据速率3 ）内存模组。这标志着英飞凌已置身于新一代内存产品的开发前沿，新一代内存产品的速度将是现有最高速内存产品的...
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: DDR3封装成fifo使用MIG ip core进行DDR3的读写操作 FPGA设计源代码及设计文档资料.zip DDR3封装成fifo使用MIG ip core进行DDR3的读写操作 FPGA设计源代码及设计文档资料，外部看是一个fifo接口，内部使用ip core，有设计框图文档和代码能有查看，可在XILINX VIVADO平台上仿真测试。
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: DDR3内存控制器参数设计实例参考本文档基于PowerPC P1020 CPU硬件手册和DDR3芯片H5TQ1G63DFR H9C为例，演示了内存控制器参数的配置过程，对于新开发单板的初学者有用。每个板子的参数与硬件，甚至芯片批次有关系，不可能完全一样，不要照抄这些参数...
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: DRAM技术精解(中文) DDR3_DDR4_DDR5_LPDDR3_LPDDR4_LPDDR5.pdf 本文档为DRAM Technology DDR3_DDR4_DDR5_LPDDR3_LPDDR4_LPDDR5技术精解中文版. 本文档详细介绍了dram的历史发展中出现的不同技术，以及技术对应的解决方案这是最详细的介绍, 把基本DDR 到DDR5，LPDDR 到LPDDR5的...
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