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TCI6630K2L
ZHCSDQ3E –MAY 2013–REVISED JANUARY 2015
TCI6630K2L 多多核核 DSP+ARM KeyStone II 片片上上系系统统 (SoC)
1 器器件件概概述述
1.1 特特性性
1
– 比特率协处理器
• 4 个 TMS320C66x 数字信号处理器 (DSP) 内核子
系统 (C66x CorePac)，每个具有
• WCDMA/HSPA+、TD-SCDMA、LTE、LTE-
A 和 WiMAX 上行链路和下行链路比特处理
– 1.0GHz 或 1.2GHz C66x 定点/浮点 DSP 内核
• 包括编码、速率匹配/解匹配、分段、多路复
• 1.2GHz 时，定点运算速度达 38.4 GMacs/内
用等
核
• 对于 LTE，分别支持高达 1525Mbps 的 DL
• 1.2GHz 时，浮点运算速度达 19.2 GFlops/内
速率和高达 1030Mbsp 的 UL 速率；对于
核
WCDMA/TD-SCDMA，分别支持高达
– 存储器
784Mbps 的 DL 速率和高达 216Mbsp 的 UL
• 每个 CorePac 具有 32K 字节的 L1P
速率
• 每个 CorePac 具有 32K 字节的 L1D
• 多核导航器
• 每个 CorePac 具有 1024K 字节的本地 L2
– 具有队列管理器的 8K 多用途硬件队列
• ARM CorePac
– 基于数据包的直接内存访问 (DMA) 支持零开销传
– 两个 ARM
®
Cortex
®
-A15 MPCore™ 处理器频率
输
高达 1.2GHz
• 网络协处理器
– 两个 ARM 内核共享 1MB L2 缓存
– 数据包加速器可支持
– 完全执行 ARMv7-A 架构指令集
• 传输面 IPsec，GTP-U，SCTP，PDCP
– 每个内核具有 32KB L1 指令和数据缓存
• L2 用户面 PDCP（RoHC、无线加密）
– AMBA 4.0 AXI 一致性扩展 (ACE) 主端口，与多
• 每秒 1.5M 数据包速率下的线速吞吐量达
核共享存储器控制器 (MSMC) 相连，可实现对共
1Gbps
享的 MSMC 静态随机存取存储器 (SRAM) 的低
– 安全加速器引擎可支持
延迟访问
• IPSec、SRTP、3GPP 与 WiMAX 无线接
• 多核共享存储器控制器 (MSMC)
口，以及 SSL/TLS 安全性、
– 4 个 DSP CorePac 和 1 个 ARM CorePac 共享
• ECB、CBC、CTR、F8、A5/3、CCM、
2MB SRAM 存储器
GCM、HMAC、CMAC、GMAC、AES、
– MSM SRAM 与 DDR3_EMIF 的存储器保护单元
DES、3DES、Kasumi、SNOW 3G、SHA-
• 片上独立随机存取存储器 (RAM) (OSR) - 1MB 片上
1、SHA-2（256 位散列）、MD5、ZUC、
SRAM 作为附加共享存储器
ZUC-MAC
• 硬件协处理器
• 高达 6.4Gbps 的 IPSec 和 3Gbps 的空中加
– 2 个 Turbo 解码器
密
• 支持 WCDMA/HSPA/HSPA+/TD-SCDMA、
– 以太网子系统
LTE、LTE-A 和 WiMAX
• 4 个串行千兆位介质无关接口 (SGMII) 端口开
• 数据块大小为 6144 比特且迭代次数为 8 时，
关
支持高达 282Mbps 的 LTE 速率；数据块大
• 8 个 Rake/搜索加速器 (RSA)，支持
小为 5144 比特且迭代次数为 8 时，支持高达
– 对 WCDMA Rel'99、HSDPA 和 HSDPA+ 进行
206Mbps 的 LTE 速率
芯片速率处理
• 低 DSP 开销 — 硬件交错表生成与 CRC 校验
– 雷德密勒 (Reed-Muller) 解码
– 4 个维特比 (Viterbi) 解码器
• 外设
• 支持高达 50Mbps 的速率（长度 9、速率
– 数字前端 (DFE) 子系统
1/3、块大小 2500）
• 支持多达四通道 JESD204A/B（最大线速率
– 1 个 WCDMA 接收加速协处理器
为 7.37Gbps）多个数据转换器接口
• 支持多达 8192 个相关器
• 集成了数字下/上变频 (DDC/DUC)、波峰因数
– WCDMA 发送加速协处理器
降低 (CFR) 以及数字预失真 (DPD) 模块
• 支持多达 2304 个传播器
– 两个快速傅立叶变换协处理器
• 快速傅立叶变换 (FFT) 大小为 1024 时，支持
高达 1200Msps 的速率
1
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English Data Sheet: SPRS893
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