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简介: 结合VIVADO 的FFT IP核的使用,编写Verilog 代码进行配置和相应的testbench文件的编写,并结合MATLAB软件产生测试数据并进行后续的计算结果误差分析。有详细的源代码以及注释。
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『始于原创,忠于原创』
1
1 设计目的和思路
本设计主要是针对 Vivado 2018.3 的 FFT IP 核(Fast Fourier Transform v9.1)
进行相关的设计验证。
主要思路是:
1、完成 FFT IP 核的调用、配置和封装
2、利用 MATLAB 产生测试数据,导入 testbench
3、执行仿真,观察时序
4、将 IP 核计算的结果导出,进一步导入 MATLAB 分析计算误差
2 调用、配置 IP
2.1 找到 FFT IP 核
图 2.1 寻找 IP
『始于原创,忠于原创』
2
2.2 Configuration Tab
图 2.2 Configuration Tab 界面
提醒几点:
1、通道数量最大为 12
2、FFT 变换最大点数 65536
2.3 Implementation Tab
『始于原创,忠于原创』
3
图 2.3 Implementation Tab 界面
几点说明:
1、scaling options :一般选择 scaled ,这样会对输出的 FFT 结果有一个尺
度上的缩减,减少逻辑资源。
2、input data width:指的是输入数据实部或者虚部的位宽,换言之,输入数据
的实虚部数据都是 input data width 指定的位宽。
3、phase factor width:相位因子的宽度,会影响计算结果的精度。
4、复位信号在设计过程中一般都需要勾选。(在使用时,至少保持两个周
期的低电平才能做到有效复位)
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