vhdl程序(内核)

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vhdl程序(内核)

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评级：0 浏览量：85 收藏量：0 资源大小：629KB 上传时间：2011-10-12

: 8051开源内核VHDL Verilog都可使用里边还有相应的程序说明以及内核结构详细说明。 2011.8.25添加：鉴于很多朋友不知道怎么用，这里以quartus ii平台为OM例。将最顶层的文件例化到工程中去，将编译好的51生成文件，如hex等，加载到51核的配置ROM里，...
评级：5 浏览量：425 收藏量：4 资源大小：451KB 上传时间：2010-03-19

: BladeRF ADS-B硬件解码器_VHDL_代码_相关文件_下载 dump1090 可视化 BladeRF ADS-B VHDL 解码器的输出。此存储库包含模拟和构建 ADS-B 内核所需的所有文件。可在此处找到详细说明 ADS-B 内核实现的多部分教程系列。操作原理 ADS-B 解码器直接在 FPGA 中解码信号，...
评级：5 浏览量：151 收藏量：1 资源大小：390KB 上传时间：2022-07-05

: ip-cores:XiXilinx FPGA器件的IP内核 OFDM基带的IP内核Xilinx FPGA器件的IP内核警告！请注意，此存储库当前由工作代码组成，可能对您的应用程序不起作用。特拉维斯CI 参见.travis.yml
评级：0 浏览量：62 收藏量：0 资源大小：65.02MB 上传时间：2021-05-16

: ZPUFlex:ZPU处理器内核的高度可配置和紧凑型变体尽管常规ZPU内核是一个简单的通用处理器，但此项目所基于的zpu_small变体受固定大小的基于BlockRAM的堆栈的限制，该堆栈可以兼用作程序ROM。这使其更加独立，但是限制了可以运行的程序的复杂性。原始的zpu_small...
评级：0 浏览量：46 收藏量：0 资源大小：26KB 上传时间：2021-05-10

: VHDL语言设计可综合的微处理器内核 vhdl 开发环境程序比较详尽内容简单易懂
评级：4 浏览量：71 收藏量：0 资源大小：154KB 上传时间：2011-04-23

: I2C-Controller-IP.rar_VHDL/FPGA/Verilog_VHDL_ 实现通过I2C来控制IP内核的简易程序，适合新手学习使用
评级：0 浏览量：64 收藏量：0 资源大小：1.09MB 上传时间：2021-08-11

: SHA256_hw_accelerator:在Zybo FPGA的Zynq内核上进行sha256硬件加速器设计，仿真，综合和实现 DigitalSystems-SHA256硬件加速器报告司机用户界面测试介绍该项目的目的是创建一个SHA256硬件加速器，该加速器将映射到Zybo原型开发板的Xilinx内核上。还将设计符合AXI Lite包装器，以实现处理器与外围设备之间的...
评级：0 浏览量：216 收藏量：0 资源大小：916KB 上传时间：2021-04-29

: HLS-Axi-Master-on-Microzed-with-Yocto-Linux-device-driver:使用高级综合 (HLS) 技术...Yocto 设备驱动程序适用于 Zynq 的 HLS AXI 主控和 Yocto 内核驱动程序微型板上的完整流程示例，包括中断处理这是一个应用程序模板，可帮助希望通过自定义 AXI Master 将数据从 Axi Stream 源传输到 Zynq DDR 的用户。包括中断生成、...
评级：0 浏览量：270 收藏量：1 资源大小：83.63MB 上传时间：2021-06-03

: FPGA VHDL语言DDS函数信号发生器的设计与实现（2）掌握DDS函数信号发生器的原理，并采用VIIDL语言设计DDS内核单元。（3）掌握单片机与DDS单无连接框图原理，推导出频率控制字、相位控制字的算法。（4）设计键盘输入电路和程序并调试。掌握键盘和显示...
评级：0 浏览量：1337 收藏量：13 资源大小：5.83MB 上传时间：2020-03-14

: mp3_player.rar_NIOS MP3_fpga mp3 nios_mp3 vhdl_mp3_player vhdl_p FPGA采用NIOS II 实现MP3功能包括硬件程序及内核程序
评级：0 浏览量：30 收藏量：0 资源大小：6.09MB 上传时间：2022-07-14

: mips32-CPU:2017 2017年夏季，支持57条NSCSCC（龙芯杯）指令的32位MIPS CPU /test/pref_test -10个基准程序的性能测试 /test/memory_game测试整个SoC系统的程序硬件环境提供的实验盒和Xilinx:copyright:Artex7的FPGA。关于CPU 五级管道单期小端始终处于内核模式支持57条MIPS指令与多...
评级：5 浏览量：669 收藏量：3 资源大小：72.3MB 上传时间：2021-03-27

: matlab集成c代码-agravic:支持VHDL样式的C++编码的仿真平台。...使用C预处理程序生成VHDL代码。简单的 MAC链路层固件，该固件在IRQ处理和WFI内核停顿的情况下大量运行。该固件使用常规的risc-V工具链进行编译，并且：到目前为止非常好。当然，这里没有提供这些BTLE / MAC IP。 FPGA操作仍通过“ Agravic invaders”...
评级：0 浏览量：74 收藏量：0 资源大小：1.35MB 上传时间：2021-05-22

: Sha256_Hw_Accelerator:SHA256硬件加速器，由Digilent合成并映射到Zybo板的Zynq内核上报告SHA256硬件加速器-数字系统司机应用测验介绍该项目的目的是设计一种SHA256硬件加速器，它将由Digilent合成并映射到Zybo板的Zynq内核上。硬件模块将具有一个符合AXI的包装器，该包装器可以使用AXI协议在特定的...
评级：0 浏览量：119 收藏量：0 资源大小：25.06MB 上传时间：2021-05-02

: core_arm.tar.gz_arm processor vhdl_arm9 vh_core_arm_core_arm.tar 用VHDL语言实现的ARM处理器的标准内核的源代码程序，可在重用
评级：0 浏览量：36 收藏量：0 资源大小：640KB 上传时间：2022-09-21

: 轴突：在具有FreeRTOS端口的VHDL中开发的AXIMIPS SoC。能够抢先或合作运行顾名思义，Plasma-SoC的内核依靠ARM AMBA4高级可扩展接口（AXI）通过可配置的AXI4-全交叉开关互连进行通信。 Plasma-SoC的主要硬件组件包括CPU ，计时器，中断控制器， GPIO ， UART ，互连模块以及为在Digilent ...
评级：0 浏览量：57 收藏量：0 资源大小：120.44MB 上传时间：2021-02-04

: MATLAB产生调制信号代码-GNSS-VHDL:VHDL代码生成GPSL1C/A和GalileoE1OS和E5PRN和无数据信号。不包含次要 MATLAB产生调制信号代码VHDL代码生成GPS L1 C / A以及Galileo E1和E5 PRN和信号。该项目是用Xilinx ISE 14.7实施的，但应该很容易将其迁移到Vivado。对于Altera平台，必须修改某些IP内核（主要是RAM存储器）。 ...
评级：0 浏览量：374 收藏量：1 资源大小：783KB 上传时间：2021-05-27

: TomThumbRISC-VCPU内核和演示系统riscv-tomthumb.zip 还包括Terasic DE0-Nano板（包含Altera Cyclone IV FPGA）的项目文件和一些程序（主要是汇编器）来测试设计。主要设计目标是设计的简单性和关于FPGA资源消耗的轻便性。目前，完整的设计在Cyclone IV FPGA上约为1400 ...
评级：0 浏览量：114 收藏量：0 资源大小：86KB 上传时间：2019-07-19

: gbc4mega65:适用于MEGA65的Game Boy和Game Boy颜色核心使用MEGA65的位流实用程序或安装核心文件，以便您可以使用MEGA65的“无滚动”启动菜单加载核心。核心需要FAT32格式的SD卡来加载游戏光盘。如果将ROM放入名为/gbc的文件夹中，则内核将在启动时显示此文件夹。 ...
评级：0 浏览量：67 收藏量：0 资源大小：4.86MB 上传时间：2021-03-14

: CRAPS-Kernel:Nexys2 的简单操作系统、处理器和编译器将 C 子集编译为 CRAPS 程序集的编译器； CRAPS 处理器的监视器/调试器；一个 shell 和几个在操作系统中运行的任务。板载操作系统可以通过串口与计算机进行通信。它还可以使用板上的开关、按钮和七段显示器。它...
评级：0 浏览量：60 收藏量：0 资源大小：10.73MB 上传时间：2021-06-19

: matlab精度检验代码-numerical-fpga-thesis:本科生MartijnBakker-使用CλaSH的FPGA上的数值数学 matlab精度检验代码使用CλaSH的FPGA上的数值数学笔记样本项目应适用于Quartus ...内核-用于将适当Linux内核加载到SoCKit的实用程序文件和脚本文学-收集的文学概述最小化-一个最小的项目，包含带有I
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: 电子设计大赛我们该做什么.doc 熟练基于VHDL、AHDL的CPLD、FPGA、GAL的内核设计 3.熟练基于Multisim的电路仿真分析 4.熟练基于MCS-51或其它系列的单片机程序设计（C/A混合编程） 5.熟练基于ASIC 的中小规模时序及组合数字电路设计 6.熟练基于ASIC ...
评级：5 浏览量：309 收藏量：3 资源大小：84KB 上传时间：2023-02-27

: matlab精度检验代码-zynq_tdc:RedPitayaZynq-7010SoC中的快速高分辨率时间数字转换器 ARM内核的基于Linux的C程序，可通过“ mmap”系统调用与TDC通道进行通信。在TDCsystem项目的地址编辑器中设置地址。 PLclock脚本-包含bash命令，用于将PL时钟频率从125降低到100 MHz。必须在TDC实施之前执行。 ...
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: Matlab代码verilog-fingerprinting:指纹识别 RTOS为所有内核生成代码。 #crc_gen在VHDL中生成任意CRC电路 #automotive_control在Matlab中生成并移植到Nios多核系统的汽车控制系统的设计示例。安东尼·德拉奇（Anthony Delage），亚历山大·鲁南（Alexander ...
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: FPGA课程设计任务书-数字电子钟设计 .doc 其中包括分频程序模块、时分秒计数模块、处理器及外设模块，并且使用QuartusII运用VHDL语言对分频和计数两个模块进行硬件电路设计和电路波形仿真，运用sopc技术嵌入内核并创建了系统所需的外部设备FLASH和SRAM软件...
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: Modelsim FLI接口在协同仿真技术中的应用 1 前言　协同仿真就是利用仿真工具提供的...　Mentor公司的ModelSim是业界最优秀的HDL语言仿真软件，它能提供友好的仿真环境，是业界唯一的单内核支持VHDL和Verilog混合仿真的仿真器。它采用直接优化的编译技术、Tcl/
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: Free tools and cores for FPGAs-开源 FPGA开发和IP内核的工具。该项目提供了用于开发FPGA应用程序的工具，内核和文档。该项目专注于VHDL。
评级：0 浏览量：24 收藏量：0 资源大小：48KB 上传时间：2021-04-28

: 基于FPGA的数字时钟设计其中包括分频程序模块、时分秒计数模块、处理器及外设模块，并且使用QuartusII运用VHDL语言对分频和计数两个模块进行硬件电路设计和电路波形仿真，运用sopc技术嵌入内核并创建了系统所需的外部设备FLASH和SRAM软件...
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