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基于FPGA的高精度数字频率计的设计
基于FPGA的高精度数字频率计的设计
FPGA
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基于FPGA的高精度数字频率计的设计,非常适合毕设,论文。有用。
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基于FPGA的等精度数字频率计 Frequency_indicator_Verilog.rar
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5星 · 资源好评率100%
基于FPGA的等精度数字频率计Verilog资料合集,包含源码工程、仿真工程、视频教程、原理图PCB图,是FPGA经典案例系列博客的其中资源之一,系列博客地址:https://blog.csdn.net/qq_33486907/article/details/119887681 欢迎浏览。
基于FPGA的高精度频率计设计
浏览:133
4星 · 用户满意度95%
基于FPGA的高精度频率计设计的毕业论文,其中包括了完整的格式要求和设计说明书,还有参考文献,请注意修改。
基于FPGA的数字频率计设计
浏览:71
5星 · 资源好评率100%
本文要设计一个8位十进制数字频率计,需要由四种器件来组成,即:测频控制信号发生器(FTCTRL)、有时钟使能的十进制计数器(CNT10)、32位锁存器(REG32B)、除法器模块(division). 因为是8位十进制数字频率计,所以计数器CNT10需用8个,7段显示LED7也需用8个. 频率测量的基本原理是计算每秒钟内待测信号的脉冲个数。 为此,测频控制信号发生器FTCTRL应设置一个控制信号时
基于FPGA 的数字频率计设计
浏览:182
4星 · 用户满意度95%
这是一份基于FPGA的数字频率计的设计,用到了verilog 语言,通过检测波形的高低电平来计算出该波形的频率大小并显示在数码管上。
FPGA_基于FPGA的数字频率计设计,verilog程序,word论文。ISE平台开发。
浏览:107
5星 · 资源好评率100%
FPGA_基于FPGA的数字频率计设计,verilog程序,word论文。ISE平台开发。在硬件上,利用xilinx公司的FPGA器件为主控器;在软件上,采用Verilog HDL硬件描述语言编程,在ISE中开发,极大地减少了硬件资源的占用,最后再Modelsim中进行系统仿真。该数字频率计的0.lHz~100MHz输入被测脉冲信号具有频率测量用途。
8位数字频率计Verilog代码(FPGA综合成功)
浏览:123
4星 · 用户满意度95%
实验成功可以用
频率计verilog程序
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基于FPGA的频率计设计 QuartusII verilog程序
Verilog频率计设计与仿真(1kHz~100M)
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频率计设计与测试(1k~100M)
基于FPGA的8位十进制数字频率计设计.pdf
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基于FPGA的8位十进制数字频率计设计.pdf
基于FPGA数字频率计设计
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5星 · 资源好评率100%
本设计使用VHDL语言写的,并在QuartusII 12.0上进行了仿真实验,并在A-C5FB开发板上进行验证。
基于FPGA的高精度频率计设计实验
浏览:151
基于FPGA的高精度频率计设计实验.
基于FPGA的高精度、宽域频率计
浏览:160
自己敲代码时敲有注释!课设所做,VHDL语言。高低频段采用不同计算方法以保证测量速度,本人粗略测量5-几十兆Hz范围内均可得准确结果。不会VHDL的,转成verilog,不多说
基于FPGA的数字频率计的设计与实现
浏览:83
5星 · 资源好评率100%
基于FPGA的数字频率计的设计与实现 基于FPGA的数字频率计的设计与实现
基于FPGA的数字频率计(ISE工程)
浏览:150
5星 · 资源好评率100%
根据全国大学生电子设计竞赛题目《简易数字频率计》的要求设计,测量范围0-1Mhz ,测量精度满足题目中要求, 所用开发板为 xilinx spartan 3ES。具体设计过程可以参考博客 。http://blog.csdn.net/li200503028
基于FPGA的高速高精度频率测量的研究
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常用的直接测频方法在实用中有较大的局限性,其测量精度随着被测信号频率的下降而降低,并且对被测信号的计数要产生±1个数字误差。采用等精度频率测量方法具有测量精度,测量精度保持恒定,不随所测信号的变化而变化.
基于FPGA自适应数字频率计的设计与实现
浏览:104
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绍一种以FPGA(Field Programmable Gate Array)为核心,基于硬件描述语言VHDL的数字频率计设计与实现。在介绍频率测量的原理和测量方法的基础上,针对所设计的频率计需简单易用的要求,采用FPGA和简单的外围电路使系统具有体积小、可靠性高、灵活性强及价格低廉等特点,同时还具有易于升级的特点。
基于FPGA数字频率计的设计及应用.doc
浏览:92
基于FPGA数字频率计的设计与实现,有完整的仿真结果实验,板子介绍,功能介绍,功能实现等等。使用Verilog语言,对各项技术也有详细的介绍
基于Verilog的频率计的程序
浏览:123
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这是基于Verilog FPGA编写的频率计的程序代码,能直接在ISE软件中打开。
十进制频率计FPGA程序,verilog代码
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4星 · 用户满意度95%
十进制频率计FPGA程序,verilog代码,比赛时使用没有问题,通过测试
verilog实现高精度频率测量
浏览:51
使用Verilog实现了高精度的电平宽度测量,可以进行高低电平的持续测量,测量精度为一个工作时钟周期。
基于FPGA的数字频率计 测频,测占空比,测相位差
浏览:192
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FPGA测频,12864液晶显示。30M方波测频,测占空比,测双方波相位差。verilog
基于verilog语言的数字频率计设计
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基于verilog语言的数字频率计设计.doc
高精度单片机频率计的设计
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可用两种方法测待测信号的频率 方法一:(定时1s测信号脉冲次数) 实验原理分析: 1. 根据该实验原理待测信号的频率不应该大于计数器的最大值65535,也就是说待测信号应小于65535Hz。 2. 实验的误差应当是均与的与待测信号的频率无关。 方法二(测信号正半周期) 实验原理分析: 1. 根据该实验原理该方法只适用于1:1占空比的方波信号,要测非1:1占空比的方波信号 2. 由于有执行f=1/(
高精度频率计设计.doc
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高精度频率计设计.doc
基于FPGA的高精度数字频率计.pdf
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基于FPGA的高精度数字频率计.pdf
基于FPGA的高精度频率计.pdf
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