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verilog-ethernet:用于FPGA实现的Verilog以太网组件
共956个文件
v:402个
py:220个
makefile:128个
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2021-04-29
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Verilog以太网组件自述文件 有关更多信息和更新: : GitHub存储库: : 介绍 以太网相关组件的集合,用于千兆位,10G和25G数据包处理(8位和64位数据路径)。 包括用于处理以太网帧以及IP,UDP和ARP的模块,以及用于构建完整UDP / IP堆栈的组件。 包括用于千兆位和10G / 25G的MAC模块,一个10G / 25G PCS / PMA PHY模块以及一个10G / 25G组合MAC / PCS / PMA模块。 包括各种与PTP相关的组件,用于实施需要精确时间同步的系统。 还包括利用完整cocotb测试平台。 仅对于IP和ARP支持,请使用ip_complete(1G)或ip_complete_64(10G / 25G)。 要获得UDP,IP和ARP支持,请使用udp_complete(1G)或udp_complete_64(10G / 25G
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verilog-ethernet:用于FPGA实现的Verilog以太网组件 (956个子文件)
AUTHORS 40B
AUTHORS 40B
coregen.cgp 520B
coregen.cgp 520B
coregen.cgp 520B
COPYING 1KB
COPYING 1KB
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
eth 12B
.gitignore 33B
.gitignore 33B
tox.ini 440B
Makefile 7KB
Makefile 5KB
Makefile 5KB
Makefile 5KB
Makefile 5KB
Makefile 5KB
Makefile 5KB
Makefile 5KB
Makefile 5KB
Makefile 5KB
Makefile 5KB
Makefile 5KB
Makefile 5KB
Makefile 5KB
Makefile 5KB
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Makefile 4KB
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Makefile 3KB
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资源评论
- 好运爆棚2023-07-25文件中的Verilog代码简洁明了,易于理解和使用,对于初学者而言也很友好。
- IYA17382023-07-25这个文件提供了一个稳定且可靠的Verilog以太网组件,可以方便地用于FPGA实现。
- 人亲卓玛2023-07-25文件作者在提供文档和使用示例方面做得很出色,帮助我快速上手并成功实现了以太网功能。
- 洋葱庄2023-07-25该组件的功能齐全,支持多种常用以太网功能,满足了我在项目中对以太网通信的需求。
- 三更寒天2023-07-25虽然有一些小的改进空间,但整体来说,这个文件是一个很好的资源,值得推荐给其他对FPGA以太网实现感兴趣的人。
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