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同步时序逻辑电路
同步时序逻辑电路
逻辑电路
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同步时序电路设计
5.1
时序逻辑电路概述
•
组合逻辑电路：
在任何时刻产生的稳
定输
出信号都仅与该时刻
电路的输入信号相关。
如译码器，全加器，
数据选择器。
•
时序逻辑电路：
在任何时刻产生的稳
定输
出信号不仅与电路该
时刻的输入信号有关，
而且与电路过去的输
入信号有关。如触发
器，寄存器，计数器
和移位寄存器等
时序电路结构图
输
入
输
出
q
1
q
k
z
1
z
r
Y1
Y2
Ym
x
1
x
2
x
n
内
部
输
入
内
部
输
出
组合逻辑电
路
触发器
特点
：
包含组合逻辑
电路和记忆（存储
）电路；
在电路的结构上
，具有反馈。
)
,
,
,
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,
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输出方
程
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2
1
1
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h
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x
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h
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q
q
q
z
z
z
h
q
状态方
程
表示存储电路中每个触发器的现态
1
1
2
1
1
2
1
,
,
＋
＋
＋
，
n
k
n
n
n
k
n
n
q
q
q
q
q
q
表示每个触发器的次态
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