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基于FPGA的verilog实现的AMI码的编解码
基于FPGA的verilog实现的AMI码的编解码
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基于FPGA的verilog实现的AMI码的编解码
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基于verilog的H264视频编解码开发
浏览：164
5星 · 资源好评率100%
基于verilog的H264视频编解码开发 DF_top (clk,reset_n,gclk_DF,gclk_end_of_MB_DEC,gclk_DF_mbAddrA_RF,gclk_DF_mbAddrB_RAM, end_of_BS_DEC,disable_DF,mb_num_h,mb_num_v, bs_V0,bs_V1,bs_V2,bs_V3,bs_H0,bs_H1,bs_H2,bs_
FPGA设计曼彻斯特编解码Verilog源代码.zip.zip
浏览：136
5星 · 资源好评率100%
FPGA设计曼彻斯特编解码Verilog源代码 module md (rst,clk16x,mdi,rdn,dout,data_ready) ; input rst ; input clk16x ; input mdi ; input rdn ; output [7:0] dout ; output data_ready ; reg clk1x_enable ; reg mdi1 ; reg m
基于verilog的AMI编程协议
浏览：118
基于verilog的AMI协议,含modelsim仿真。 输入八位数据，输出AMI协议数据
ami Verilog编码
浏览：76
这是ami编码，用的事Verilog语言描述，因为结果有0,1，-1三个电平，所以扩展成两位表示。编码后00表示0,01表示1,10表示-1。
基于FPGA的AMI/HDB3编码器
浏览：44
5星 · 资源好评率100%
本设计是在Quartus ii开发环境下采用VHDL语言实现的AMI/HDB3编码器课程设计。 之前做的EDA课设，附带废话连篇报告
基于FPGA的数字基带通信系统AMI码设计
浏览：120
5星 · 资源好评率100%
基于FPGA的数字基带通信系统AMI码设计、电子技术,开发板制作交流
基于FPGA的HDB3码编码
浏览：129
5星 · 资源好评率100%
module test_hdb3(reset_all,data_in,clk_2m,tdp,out,tdn,select_pn); input reset_all; input data_in; input clk_2m; output tdp; output tdn; output out; output select_pn; reg data_in_buff; always@(n
AMI编码演示
浏览：116
4星 · 用户满意度95%
AMI编码中的1码通常称为传号，0码则叫空号，这是沿用了早期电报通信中的叫法。从形态上看，它已是三状态信号，所以AMI码是伪三进制码。 一、编码规则: 消息代码中的0 传输码中的0 消息代码中的1 传输码中的+1、-1交替 例如: 消息代码:1 0 1 0 1 0 0 0 1 0 1 1 1 AMI码: +1 0 -1 0 +1 0 0 0 -1 0 +1 -1 +1 此例程演示AMI码的生成过
以ami码编码来详细介绍Xilinx-ise软件的使用，调试fpga板子
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基于FPGA的AMI编解码设计.pdf
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基于FPGA的AMI编解码设计.pdf
基于FPGA汉明编解码
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该程序完成16位NRZ码的汉明编解码，已调试通过，可直接下载使用，采用VERILOG设计，在QUARTUS II环境下编译，适用ALTERA芯片。
曼切斯特编解码 verilog FPGA 实现
浏览：123
4星 · 用户满意度95%
曼切斯特编解码 关于编码讲解的很清楚 verilog FPGA 实现
基于FPGA的8b10b编解码verilog实现
浏览：142
5星 · 资源好评率100%
本设计是采用EDA技术设计的一种8B /10B 编解码电路,实现了在高速的串行数据传输中的直流平衡。利用verilog HDL 逻辑设计语言，经过modelsim、quartus II的仿真和下载验证，实现其编码和解码的功能。 该编解码电路设计大体上可以由五个模块构成，分别是默认编码模块、差异度计算模块、编码校正模块、并串转换模块、显示模块。 采用Verilog HDL 描述、modelsim 1
编解码FPGA实现，包括matlab程序，verilog
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RS（255,239）编解码 BM迭代算法 verilog 详细解读 该解码算法迭代过程可以改进
基于FPGA的HDB3编解码器的设计与实现.pdf
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基于FPGA的HDB3编解码器设计与实现的知识点涵盖了数字通信、编码规则、FPGA硬件开发等多个方面。首先，数字通信系统在进行长距离传输时，需要对信号进行编码转换成数字基带信号，并通过调制器进行传输。在传输过程中...
基于FPGA的HDB3编码和解码器的设计与实现.pdf
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4. Verilog HDL与Quartus II的使用：在实现基于FPGA的HDB3编解码器时，使用了硬件描述语言Verilog HDL进行编程，并通过EDA（Electronic Design Automation，电子设计自动化）工具Quartus II进行设计的仿真和综合。...
SDH中HDB3编解码电路的FPGA实现.pdf
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总之，本文提供了一个针对SDH系统中HDB3编解码电路进行FPGA实现的详细方案，不仅有助于理解HDB3编解码技术，而且也展示了FPGA在高速数字信号处理领域的应用潜力。通过FPGA实现HDB3编解码电路，可以达到高度集成、低...
matlab-基于FPGA的HDB3编译码verilog实现-源码
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标题中的“matlab-基于FPGA的HDB3编译码verilog实现-源码”表明这是一个关于使用MATLAB进行FPGA（Field-Programmable Gate Array）开发的项目，具体涉及HDB3（High Density Bipolar 3，高密度双极性编码）的编译码，...
FPGA设计曼彻斯特编解码Verilog源代码修改版
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FPGA设计曼彻斯特编解码Verilog源代码 module md (rst,clk16x,mdi,rdn,dout,data_ready) ; // input rst ; input clk16x ; input mdi ; input rdn ; output [7:0] dout ; output data_ready ; reg clk1x_enable ; reg mdi1 ; reg
基于FPGA的MP3解码VERILOG源码
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基于verilog实现BCH码
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基于cyclone系列，通过verilog语言实现BCH编码。BCH码是一种常用的线性分组码，这种编码方式能够检验并纠正1~3葛错误，具有较高的编码效率
基于FPGA的8B/10B编解码设计
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为提高8B/10B编解码的工作速度和简化逻辑方法，提出一种基于FPGA的8B/10B编解码系统设计方案。与现有的8B/10B编解码方案相比，该方案是一种利用FPGA实现8B/10B编解码的模块方法，接收模块在收到外部发送的并行数据时，通过直接查找映射的方法转换成利于传输的串行信号。串行信号经串并行转换模块，将数据经10B/8B解码模块解码还原成原始数据。为了更好实现数据的传输，系统加入了极性偏差R
AMI编解码的仿真程序设计
浏览：129
4星 · 用户满意度95%
自己做的AMI的编解码仿真程序设计 希望对大家有用
B码解码的verilog代
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B码解码的verilog代码，1M时钟
基于FPGA的汉明码的编码与解码的实现，Verilog代码
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5星 · 资源好评率100%
基于FPGA的汉明码的编码与解码的实现，Verilog代码，Modelsim仿真
RS编解码VERILOG实现
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RS 编码器，译码器，主要采用FPGA来实现软件使用verilog语言，从原理到硬件的实现，进行了功能仿真 以及板上调试，验证正确
用verilog实现HDB3编解码的程序
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4星 · 用户满意度95%
初学者比较适合！因为程序很简单还有注释，希望可以帮到大家的忙！多多下载啊
基于verilog的串口实现
浏览：188
基于verilog的串口通信实现，串口通信简介和原理讲解。
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yankui666
2012-07-23
方法知道怎么解决了，就是程序还不清楚
烦烦烦的事实上
2014-04-08
讲的是原理，有更完整的源码就更好
木箫思木
2019-02-21
具有一定的参考价值
lzh_no_1
2018-10-24
原理而已，参考吧
lyh04189999
2012-10-10
讲的是原理，有更完整的源码就更好
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jinghaiyouzhu
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