FPGA的高速计数器

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FPGA的高速计数器

: 基于FPGA的高速计数器设计基于FPGA的高速计数器设计，pdf格式
评级：4 浏览量：270 收藏量：0 资源大小：300KB 上传时间：2009-05-26

: FPGA的高速计数器设计[整理].pdf FPGA的高速计数器设计[整理].pdf
评级：0 浏览量：33 收藏量：0 资源大小：2.18MB 上传时间：2021-10-11

: Fpga 对adc高速采集数据进行峰值检测，并记录所有峰值检测位置信息主要是对并行数据排序处理，本例程是处理 2Gsps adc 输入到FPGA中的8路并行数据，data_1~data_8（点顺序是data_1最先出来，依次排序，data_8是一个时钟并行数据最后点）, 同时寄存比data_1之前一点数据 adc_data_...
评级：0 浏览量：305 收藏量：4 资源大小：3KB 上传时间：2023-03-04

: 硬件和算法，这两个学习FPGA最重要的要领一般速率太高了，需要用FPGA把高速数字信号分开，然后使信号容易处理，传输，存储。数字信号处理。包括图像处理，雷达信号处理，医学信号处理等。优势是实时性好，用面积换速度，比CPU快的多。
评级：0 浏览量：222 收藏量：0 资源大小：749KB 上传时间：2021-07-07

: 高速计数板FPGA解决方案.zip 该方案是针对100L/150L的尘埃粒子计数器的传感器解决方案，主控芯片为一颗Xilinx的Spartan6芯片，在此芯片内部使用Microblaze软核，运行类modbus协议，定制IP核用于多个通道的技术，有效缓解通道堵塞，压缩包包括...
评级：0 浏览量：83 收藏量：0 资源大小：41.48MB 上传时间：2020-05-21

: 电源技术中的基于FPGA的高速可变周期脉冲发生器的设计为了使之具有高速、灵活的优点，本文采用Atelra公司的可编程芯片FPGA设计了一款周期和输出个数可变的脉冲发生器。经过板级调试获得良好的运行效果。　2 总体设计思路　脉冲的周期由高电平持续时间与低电平持续...
评级：0 浏览量：227 收藏量：1 资源大小：83KB 上传时间：2020-12-08

: FPGA的时钟频率同步设计　分布式网络中节点的时钟通常是采用晶振+计数器的方式来实现，由于晶振本身的精度以及稳定性问题，造成了时间运行的误差。时钟同步通常是选定一个节点时钟作为主时钟，其他节点时钟作为从时钟。主节点周期性地通过...
评级：5 浏览量：478 收藏量：0 资源大小：212KB 上传时间：2021-01-19

: FPGA时序设计全面讲解时序信号的处理以及高速电路中时钟设计
评级：5 浏览量：67 收藏量：0 资源大小：4.45MB 上传时间：2012-11-02

: 基于FPGA 的运动控制卡的设计和实现在硬件算法上，采用乒乓操作处理高速的分频倍数数据流，提高了系统的实时性和控制精度；并且提出了一种基于加二计数器的分频算法，实现任意分频倍数的分频。利用嵌入式调试工具SignalTap 对运动控制卡进行硬件调试和...
评级：1 浏览量：532 收藏量：0 资源大小：288KB 上传时间：2021-01-19

: 论文研究-一种实现高速异步FIFO的FPGA方法.pdf 提出了一种在FPGA内实现高速异步FIFO的方法，该方法针对不可能产生满信号的高频系统，通过省略“满”信号产生模块和多余的存储器位深来简化常规的FIFO模块，而只保留“空”信号产生模块。仿真和综合设计结果表明，...
评级：0 浏览量：147 收藏量：0 资源大小：661KB 上传时间：2019-09-11

: FPGA实际开发论文基于Nios_的自定制PWM模块设计与...基于单片机和FPGA的多功能计数器的设计基于FPGA和LabVIEW的任意波形发生器设计基于FPGA的虚拟逻辑分析仪设计 51单片机与FPGA的UART通信模式研究基于FPGA的高速定点FFT算法的实现
评级：4 浏览量：77 收藏量：0 资源大小：9.04MB 上传时间：2011-03-25

: DDC的基于FPGA的可编程逻辑控制器-电路方案执行自动化系统的数字控制:完整的IEC 61131-3布尔运算，包括计数器和计时器功能块。可配置性:在软件级别–完全可编程；在硬件级别–可扩展的基于FPGA的设计，可以重新配置为仅包括应用程序所需的外围设备。高速...
评级：0 浏览量：203 收藏量：0 资源大小：20.84MB 上传时间：2021-04-19

: 如何使用CPLD实现出租车计费器的设计该出租车计费系统包括计数器分频模块、数码管分频模块、计程模块、计时模块、计费模块、控制模块、数码管显示模块和顶层主控模块共八大部分；分起步、里程、等待三个阶段。该出租车计费器能够自行设定计费标准，借助...
评级：0 浏览量：264 收藏量：4 资源大小：955KB 上传时间：2021-07-07

: 入门学习EDA实验指导书实验2 含异步清零和同步时钟使能的加法计数器设计实验3 1位全加器原理图输入设计实验4 2位十进制频率计原理图输入设计实验5 7段数码显示译码器设计实验6 数控分频器的VHDL设计实验7 正弦信号发生器设计实验8 ...
评级：0 浏览量：304 收藏量：0 资源大小：7.01MB 上传时间：2018-08-06

: EDA/PLD中的FPGA的时钟频率同步设计　分布式网络中节点的时钟通常是采用晶振+计数器的方式来实现，由于晶振本身的精度以及稳定性问题，造成了时间运行的误差。时钟同步通常是选定一个节点时钟作为主时钟，其他节点时钟作为从时钟。主节点周期性地通过...
评级：0 浏览量：115 收藏量：0 资源大小：166KB 上传时间：2020-11-08

: 电子设计大赛题目作品（多功能计数器、高功率因数电源、位移测量装置、温度自动控制系统）-电路方案本设计给出了以CycloneII型FPGA EP2C8为核心的多功能计数器的基本原理与实现方案。FPGA片内包括测频模块，测相模块，DDS查表模块及NIOSII处理器； NIOS核调节频率字与相位字控制DDS查表模块并经片外高速DA DAC900...
评级：0 浏览量：974 收藏量：4 资源大小：8.18MB 上传时间：2021-04-21

: EDA/PLD中的基于CPLD/FPGA的出租车计费器随着EDA技术的高速发展，电子系统的设计技术和工具发生了深刻的变化，大规模可编程逻辑器件CPLD／FPGA的出现，给设计人员带来了诸多方便。利用它进行产品开发，不仅成本低、周期短、可靠性高，而且具有完全的知识...
评级：0 浏览量：216 收藏量：0 资源大小：95KB 上传时间：2020-12-13

: EDA/PLD中的基于FPGA 的运动控制卡的设计和实现在硬件算法上，采用乒乓操作处理高速的分频倍数数据流，提高了系统的实时性和控制精度；并且提出了一种基于加二计数器的分频算法，实现任意分频倍数的分频。利用嵌入式调试工具SignalTap 对运动控制卡进行硬件调试和...
评级：0 浏览量：200 收藏量：0 资源大小：220KB 上传时间：2020-11-10

: 电子设计课设报告-基于CYCLONE FPGA设计的出租车计价器+Quartus9.1工程源码.zip 随着EDA技术的高速发展，电子系统的设计技术发生了深刻的变化，大规模可编程逻辑器件CPLD／FPGA的出现，给设计人员带来了诸多方便。利用它进行产品开发，不仅成本低、周期短、可靠性高，而且具有完全的知识产权。...
评级：5 浏览量：1084 收藏量：10 资源大小：726KB 上传时间：2021-12-25

: FPGA在超声气体温度测量中的应用 (2005年) 现场可编程门阵列FPGA（Field Programmble Gate Array）是新一代可编程ASIC...在超声温度测量系统中，应用数字移相技术，结合现场可编程门阵列器件（FPGA）设计了一个高速计数器，实现燃烧气体温度的快速、准确测量。
评级：0 浏览量：27 收藏量：0 资源大小：618KB 上传时间：2021-04-25

: EDA/PLD中的CPLD在多路高速同步数据采集系统中的应用摘要：采用VHDL语言设计，用CPLD控制模/数转换电路，完成多路模拟输入的高速同步数/模转，具有容错和自检能力。...与FPGA相比，CPLD比较适合计算机总线控制、地址译码、复杂状态机、定时/计数器、存储
评级：0 浏览量：116 收藏量：0 资源大小：142KB 上传时间：2020-12-10

: 便携式高精度脉冲信号产生和测量装置测量功能实现，首先将待测信号进行阻抗匹配及衰减器处理，然后，通过FPGA的高速计数器进行等精度测频实现信号频率10 Hz到2 MHz的测量；通过高速数据采样及高速A/D转换实现幅度范围为0.1V到10 V、占空比测量范围为10%...
评级：0 浏览量：150 收藏量：1 资源大小：1.74MB 上传时间：2021-01-12

: aes220-peak-counter:由多个峰值计数器组成的数字接口，用于包含 X 射线传感器阵列的项目 aes220-峰值计数器由多个峰值计数器组成的数字接口，用于包含 X 射线传感器阵列的项目。这是在 aes220b 高速 USB FPGA 迷你模块 ( ) 上实现的基于 FPGA 的项目。目前，此 repo 用于项目文件的个人存储。
评级：0 浏览量：59 收藏量：0 资源大小：7KB 上传时间：2021-07-14

: 程控任意波形功率电源的研究采用了以单片机为核心，应用大规模集成逻辑器件FPGA、高速D/A转换器MAX5885和功率放大电路的方案设计了一款任意波形功率驱动电源。系统由单片机控制各个模块，频率合成电路合成所需的不同频率的时钟作为控制地址...
评级：0 浏览量：68 收藏量：0 资源大小：585KB 上传时间：2021-04-18

: EDA/SOPC 技术实验讲义设计含异步清0 和同步时钟使能的加法计数器 7 1-4. 7 段数码显示译码器设计 8 1-5. 8 位数码扫描显示电路设计 9 1-6. 数控分频器的设计 10 1-7. 32 位并进/并出移位寄存器设计 10 1-8. 在QuartusII 中用原理图...
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: 三维成像激光雷达高带宽数据采集与存储系统针对系统中多片模数转换器（ADCs）采样数据不同步问题，提出了高速信号同步触发电路及现场可编程逻辑门阵列（FPGA）固有路径延迟校准算法。为了精确测量激光雷达内光路触发脉冲与系统时钟之间的延时量，设计了基于...
评级：0 浏览量：176 收藏量：0 资源大小：12.11MB 上传时间：2021-01-26

: EDA/PLD中的状态机“毛刺”的产生及消除方法随着EDA技术的高速发展, 以大规模和超大规模器件FPGA/CPLD为载体、以VHDL(硬件描述语言)为工具的电子系统设计越来越广泛。有限状态机(简称状态机)作为数字系统控制单元的重要设计方案之一，无论与基于VHDL语言的其他...
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: 复旦nois教材01.rar 1.4 支持Nios CPU的FPGA型号.............................................................................................5 第二章 SOPC Builder开发环境.......................................................
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: 100MHz双踪虚拟示波器电路+程序+上位机等-电路方案本文档介绍的是虚拟示波器仪器采用32位处理器@100MHz主频，FPGA，高速A/D，高速运放，高速程控增益放大器设计，实现了专业示波超才具备的触发灵敏度调节，交替触发，电平触发，硬件电平平移等，独创的等效采样技术...
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: 基于51单片机八路抢答器课程设计.doc 但由于本设计对数据处理的速度要求不高，FPGA的高速处理的优势得不到充分体现，并且由于其集成度高，使其成本偏高，同时由于芯片的引脚较多，实物硬件电路板布线复杂，加重了电路设计和实际焊接的工作。...
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: 18位、1.33 MSPS、16通道数据采集系统参考设计-电路方案信号处理电路与简单的4位增/减二进制计数器结合，提供无需FPGA、CPLD或高速处理器即可实现通道间切换的简单、高性价比方案。可编程设置计数器，使其递增或递减计数，实现顺序采样多个通道；也可加载固定的二进制字，...
评级：0 浏览量：199 收藏量：1 资源大小：4.73MB 上传时间：2021-04-22

: 基础电子中的状态机设计 FPGA的一个较大的好处在于并行处理的高效高速，如果滥用状态机的话，有时就失去了FPGA的优势；二是状态机的写法，推荐使用双进程的状态机的结构来构造状态机好处是结构清晰，构造输出容易。因为可以早一拍得到次态...
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