EP2C35F672C6

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EP2C35F672C6

: VGA课程设计.zip VGA控制器的设计与实现，本设计使用FPGA芯片EP2C35F672C6，在Quartus I工作平台下，利用verilog硬件描述语言实现。文件包含完整代码、仿真图、及课程详细报告。
评级：0 浏览量：182 收藏量：1 资源大小：60.29MB 上传时间：2020-04-20

: DE2引脚图 Cyclone II EP2C35F672C6 de2 引脚图适合于Cyclone II EP2C35F672C6
评级：5 浏览量：1309 收藏量：3 资源大小：22KB 上传时间：2011-05-16

: DE2开发板EP2C35F672C6N光盘资料 Altera公司DE2开发板cyclone two 系列EP2C35F672C6N光盘资料
评级：4 浏览量：468 收藏量：1 资源大小：26.89MB 上传时间：2012-04-30

: [FPGA][DE2-EP2C35F672C6](WM8731)音频输入->ADC->FPGA->DAC->音频输出我参照DE2的示例代码，重写的一份更简洁的代码。
评级：0 浏览量：503 收藏量：6 资源大小：911KB 上传时间：2021-03-02

: DigitalClock:数字电路课程设计-多...程序运行依托的数字电路板为Cyclone 2系列，EP2C35F672C6序列的开发板程序运行依托的数字电路板为Cyclone 2系列，EP2C35F672C6序列的开发板。在这个环境下，实现了数字电路课程设计，一个基于FPGA开放板的多功能数字时钟。 1.设计要求此多功能数字时钟使用LCD1602 ，数码管， LED等...
评级：0 浏览量：451 收藏量：2 资源大小：2.1MB 上传时间：2021-03-23

: 基于Cyclone II-EP2C35F672C6的交通灯程序文件解压后可以看到三个文件夹，其中traaffic文件夹是工程文件，程序文件夹是编写过程中失败的和最后修改的，错误文件夹是编写过程中遇到的错误。此程序能实现十字路口四组灯的四种状态转换，并且有四组对应的...
评级：5 浏览量：325 收藏量：5 资源大小：1.25MB 上传时间：2010-01-15

: EP2C8F256C6N-全新原装正品.doc EP2C8F256C6N-全新原装正品.doc
评级：0 浏览量：52 收藏量：0 资源大小：635KB 上传时间：2021-10-12

: Mars_EP1C6F_Interface_demo(Verilog).rar_FPGA I2C VERILOG_Verilo FPGA开发板配套Verilog代码。芯片为Mars EP1C6F。一些接口通信的源码。包括7段数码管、I2C通讯等。
评级：0 浏览量：47 收藏量：0 资源大小：3.24MB 上传时间：2022-07-13

: Traffic_Lights.rar 这是本人在大学期间所做的实验已经成功的
评级：0 浏览量：400 收藏量：1 资源大小：908KB 上传时间：2021-04-28

: DE303软件，硬件开发 DE303软件，用于和硬件通讯的软件，常用于自动化软件开发
评级：0 浏览量：73 收藏量：0 资源大小：1.08MB 上传时间：2018-06-27

: Altera 12款FPGA/CPLD开发板原理图，包括EP2C、EP1C、EPM、MAX系列等：Cyclone II EP2C20 原理图，Cyclone1C20的Nios开发板，EP1C3T144 FPGA开发板手册，EP1C6Q240C6开发板原理图，EP2C5原理图，EP2C8开发板原理图，EPM1270F256C5 MAX II板示意图，EPM7128最小系统，MAX7000等等。
评级：0 浏览量：429 收藏量：0 资源大小：2.35MB 上传时间：2021-07-07

: CYCLONE1 2系列及MAX系统FPGA CPLD开发板PDF原理图合集（10个）.zip Cyclone II EP2C20 FPGA开发板PDF原理图.pdf Cyclone1C20的Nios开发板.DDB EMP7128 CPLD开发板PDF原理图.pdf EP1C6Q240C6 FPGA开发板PDF原理图.pdf EP2C5最小系统 FPGA开发板PDF原理图.pdf EP2C8 CYCLONE2 FPGA...
评级：5 浏览量：162 收藏量：0 资源大小：2.26MB 上传时间：2022-05-30

: 基于DE2的LCD图形显示设计 DE2开发平台选用的FPGA是CycloneII系列FPGA中的EP2C35F672C6,通过对DE2的学习，我们能够迅速理解和掌握实时多媒体工业产品设计的技巧，并进行系统设计的验证。DE2平台的设计和制造完全按照工业产品标准进行，可靠性...
评级：5 浏览量：293 收藏量：2 资源大小：977KB 上传时间：2010-05-13

: 基于verilog语言编程的数字秒表设计.doc * 数字秒表原理图如图一所示，为设计项目选定CyclongII系列中的EP2C35F672C6器件，锁定顶层设计中各端口所对应的引脚号，并编译通过。 * 然后对器件编程，使用USB-Blaste下载电缆把项目以在线配置的方式下载到Altera...
评级：0 浏览量：59 收藏量：1 资源大小：178KB 上传时间：2023-06-22

: DE2 平台的引脚分配表附录表的DE2 平台的引脚分配表。对应的型号cyclone II EP2C35F672C6N
评级：0 浏览量：204 收藏量：0 资源大小：911KB 上传时间：2017-10-21

: 使用Verilog HDL语言实现0.01s高分辨力报警器的设计资料说明定时器设计基本要求：最大为1小时，精度要求为0.01秒，当倒计时间为0的时候能够报警，要求能在数码管上面正确显示。...定时器的核心器件为EP2C35F672C6芯片，显示采用6个7段数码管，采用共阳接法。
评级：0 浏览量：368 收藏量：3 资源大小：1.04MB 上传时间：2021-07-07

: FIR数字滤波的FPGA实现 FIR数字滤波的FPGA实现、电子技术,开发板制作交流
评级：0 浏览量：113 收藏量：0 资源大小：275KB 上传时间：2021-02-03

: 3.数字ASK调制系统1 在本设计任务中，我们将构建一个数字幅度键控(ASK)调制系统，该系统主要由三部分组成：数字基带信号生成、正弦载波信号生成和ASK调制...最终，完成的设计应能在实际的CycloneII系列EP2C35F672C6 FPGA上成功实现并运行。
评级：0 浏览量：63 收藏量：0 资源大小：23KB 上传时间：2022-08-08

: 汉明码编解码系统1 整个系统需要在CycloneII系列EP2C35F672C6 FPGA上进行设计和仿真，确保各模块在统一的时钟信号下同步工作，并在reset信号作用下正确初始化。总结来说，这个设计任务涵盖了数字通信中的一些核心概念，包括序列生成...
评级：5 浏览量：76 收藏量：0 资源大小：61KB 上传时间：2022-08-08

: 基于FPGA的嵌入式数字化语音录制与回放的设计实现 1系统整体方案系统以Altera公司的FPGA芯片(CycloneⅡ系列)EP2C35F672C6NK为平台，结合音频编/解码芯片WM8731实现语音录制与回放。该FPGA芯片具有丰富的片内资源，大量的逻辑宏单元和多个硬件乘法器，大量的自定义I/O...
评级：0 浏览量：208 收藏量：0 资源大小：445KB 上传时间：2020-10-23

: 基于NiosⅡ软核处理器的电机调速控制系统 0引言以往的直流电机调速...本文利用Altera公司的FPGA芯片EP2C35F672C6作为系统控制器，采用数字PID算法对直流电机进行PWM闭环调速控制。并且利用硬件描述语言(VHDL)自行设计、生成PWM模块和测速模块，最后通过实验验
评级：0 浏览量：99 收藏量：1 资源大小：376KB 上传时间：2020-10-25

: 数字QAM调制系统_题目1 设计要求在EDA开发环境中完成，使用的器件为CycloneII系列EP2C35F672C6 FPGA。 **设计要求：** 1. **时钟生成电路**：生成满足系统需求的时钟信号，例如50MHz的主时钟。必须为其他模块提供合适的时钟信号，并预留...
评级：0 浏览量：117 收藏量：0 资源大小：32KB 上传时间：2022-08-08

: 基于FPGA的数字调制解调器设计说明.doc 在本设计中，使用ALTERA公司生产的DE2开发板，Cyclone II EP2C35F672C6型号的FPGA和EPCS16系列的配置驱动，使用VHDL硬件描述语言实现。FPGA的应用可以提供高性能和灵活性，满足数字调制解调器的需求。三、ASK、FSK...
评级：0 浏览量：68 收藏量：0 资源大小：3.27MB 上传时间：2021-09-18

: 基于现代DSP技术的QPSK调制器的设计采用DSP Builder中的模块代替VHDL编程，在同一平台上实现了系统建模和硬件实现的有机结合，然后利用ALTERA公司提供的Signal Compile进行编译，产生VHDL源程序，同时，采用ALTERA公司的Cyclone系列芯片EP2C35F672C6N...
评级：0 浏览量：61 收藏量：1 资源大小：917KB 上传时间：2021-04-16

: 基于FPGA和USB2.0的高精度数据采集系统设计 * FPGA 的选择：Cyclone II 系列的EP2C35F672C6，中等密度的FPGA，具有较低的成本 * FPGA 主控模块的设计：使用FPGA 的Bank3 和Bank4 接收来自ADS5463 输出的高速LVDS 数据，包括DRY（数据输出准备好）以及OVR（数据...
评级：0 浏览量：117 收藏量：1 资源大小：287KB 上传时间：2020-08-07

: 基于MIPS处理器的外围接口应用实验设计 (2013年) 介绍了实验设计的基本思路，介绍了使用Veril09硬件描述语言设计该实验的详细过程，同时给出了该实验在QuartusⅡ7．2软件环境下的仿真波形，并在Altera公司的FPGA芯片 EP2C35F672C6和DE2教学开发板上进行了下载验证。...
评级：0 浏览量：57 收藏量：0 资源大小：2.03MB 上传时间：2021-04-24

: Quartus-II使用教程-完整实例2.pdf 输入工程名称和保存路径后，选择芯片型号，我们这里选择的是 Cyclone II 系列下的 EP2C70F896C6 芯片。添加文件在添加文件步骤中，我们可以选择添加已有的文件，如果没有，则直接跳过。然后，选择仿真和综合工具...
评级：0 浏览量：25 收藏量：0 资源大小：907KB 上传时间：2023-06-19

: 基于FPGA的无线传感网络信道波形整形滤波器针对模拟滤波器设计灵活性差且不能很好地支持数据通信的并行和速度等问题，利用Altera公司CycloneII系列中的EP2C35F672C6N芯片完成了基于FPGA的WSN信道波形整形滤波器的设计。通过功能创建、计算查表法系数、建立...
评级：0 浏览量：83 收藏量：0 资源大小：270KB 上传时间：2020-10-17

: 基于NiosII的电子收费专用芯片验证与测试平台设计 (2013年) 该平台采用Altera CycloneII EP2C35F672C6N现场可编程门阵列(FPGA)芯片,根据ETC专用芯片的功能,对FPGA 芯片内的NiosII处理器核配置相关外设,并编写NiosII应用软件,完成ETC专用芯片的FPGA验证和测试.实践表明,该平台...
评级：0 浏览量：53 收藏量：0 资源大小：806KB 上传时间：2021-05-20

: 基于NiosII软核的网络摄像头采集与以太网内传输基于NiosII软核的网络摄像头采集与以太网内传输、电子技术,开发板制作交流
评级：0 浏览量：66 收藏量：1 资源大小：322KB 上传时间：2021-02-03

: protel99se封装库器件PCB2D库芯片封装库400个（protel库）.lib C6X8 C8X8MM C8X10 C8X12 C10x16 C13x20 C23x20 C0402 C0402S C0603 C0805 C1206 C1206A C1210 C2225 C3216 C3528 C6032 C7343 C7361 CAP4MM CAP5X5 CAP6.6X6.6 CAP7.5MM CLCC-48 COM_MODE_CHOKE CR1220 CR2032 ...
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: 基于FPGA的CORDIC算法的改进及实现介绍了CORDIC算法的基本原理,分析了其具体计算方法。...选用 ALTERA 公司CycloneII系列的EP2C35F672C6 来实现整个FFT 处理器，并对设计进行了时序仿真和硬件仿真。通过比较，计算结果与设计基本一致。
评级：0 浏览量：191 收藏量：0 资源大小：381KB 上传时间：2020-10-20

: 基于FPGA的全局异步局部同步四相单轨握手协议实现在常规FPGA中设计了基于LUT的异步状态保持单元，实现了全局异步局部同步系统的接口电路、时钟暂停电路，进一步完成...在Altera CycloneⅡ EP2C35F672C6器件上，完成了GALS系统的时序仿真，证明了四相单轨握手的正确性。
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: 一种高效二维小波分解算法的FPGA实现针对现有二维提升小波变换实现过程中存在的大量过程数据存储及关键路径延时较长的问题...采用Altera公司Cyclone II系列FPGA EP2C35F672C6对架构进行实现和验证，在纯计算逻辑下二维小波变换时钟频率可达到157.78 MHz。
评级：0 浏览量：236 收藏量：0 资源大小：306KB 上传时间：2020-10-18

: SOPC 流水灯实验在实验中，我们需要设计硬件部分，包括建立 hello_led 文件夹，打开 QuartusII，创建新的工程，选择芯片 EP2C35F672C6，并使用 SOPC Builder 工具设计系统。系统名称为 NiosII32，选择语言为 VHDL， Device Family ...
评级：0 浏览量：323 收藏量：2 资源大小：536KB 上传时间：2014-07-01

: 基于NiosⅡ的直流电机PID调速控制系统设计与应用方案本文利用Altera公司的FPGA芯片EP2C35F672C6作为系统控制器，采用数字PID算法对直流电机进行PWM闭环调速控制。并且利用硬件描述语言（VHDL）自行设计、生成PWM模块和测速模块，最后通过实验验证了该系统的可行性。
评级：0 浏览量：98 收藏量：0 资源大小：442KB 上传时间：2020-10-24

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: 单片机STM32F103+FPGA 设计多轴运动控制板ALTIUM硬件原理图PCB+AD集成封装库.zip EP2C8Q208C6 Cyclone II Family, 1.2V FPGA, 138 I/O Pins, 2 PLLs, 208-Pin PQFP, Speed Grade 6, Commercial Grade EPCS1SI8 EPCS1 Series, In-system programmable 3.3V serial configuration device, 8-Pin SOIC...
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: FPGA+DSP在空中背景下运动目标实时跟踪系统中的应用 (2010年) 针对电视跟踪系统对飞行目标的检测与跟踪受到速度瓶颈的限制,设计出在TMS320C6416 DSP的配合下,以Altera公司的EP2C70F672C6 FPGA为核心处理器的实时电视跟踪系统。该系统利用FPGA强大的并行流水处理能力,实现视频...
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: 实验一含异步清0 该实验使用DE2实验平台，选择Cyclone II系列的EP2C35F672C6作为FPGA目标器件。二、实验设计与实现 1. 设计一个含异步清0和同步使能的4位加法计数器，使用VHDL语言编写设计代码。 2. 创建一个名为CNT4B的工程，...
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: 基于 IEEE 802.16d OFDM系统的 FPGA设计 (2008年) 研究基于IEEE802.16d OFDM系统的FPGA实现。首先探讨了基于802.16d的OFDM系统FP-GA设计的构架。...最后选用了 Al-tera公司CycloneⅡ系列的 EP2C35F484C6芯片,在 QuartusⅡ软件环境下对 VHDL代码进行了综合。
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: 采用DSP+FPGA的三轴运动控制器设计 (2014年) 为了满足开放式数控系统的需求,设计了一种基于TMS320F28335浮点型数字信号处理器(DSP)和EP2C8F256C6现场可编程门阵列(FPGA)的通用三轴运动控制器。详细介绍该运动控制器的整体结构、硬件电路设计、插补算法、FPGA各...
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: 可配置高速二维卷积处理器设计与Gabor滤波应用 (2010年) 针对具有多种大尺寸卷积内核的Gabor滤波器组,设计了可配置几维卷积...从而实现 Gabor滤波实验表明：使用EP2C70F896C6型FPGA 工作在75 MHz,对于120×90像素的灰度图像计算五尺度八方向Gabor滤波(最大尺寸为41 × 41像
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: signaltap skill.doc 使用環境：Quartus II 7.2 SP1 + DE2(Cyclone II EP2C35F627C6) 本文是我較早期的方法，並不是很理想，建議參考(原創) 如何使用SignalTap II觀察reg與wire值? (SOC) (Verilog) (Quartus II) (SignalTap II) 在...
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: 基于FPGA的数字电子时钟设计与实现.doc 系统主芯片采用EP2C70F896C6，有时钟模块、控制模块、计时模块、数据译码模块、显示以与报时模块组成。该设计实现了一个基于FPGA的数字电子时钟，具有时、分、秒计数显示功能，以24小时的循环计数，具有校对功能。...
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: 基于FPGA 的CORDIC 算法的改进及实现介绍了CORDIC 算法的基本原理,分析了其具体计算方法。...选用ALTERA 公司CycloneII 系列的EP2C35F672C6 来实现整个FFT 处理器，并对设计进行了时序仿真和硬件仿真。通过比较，计算结果与设计基本一致。
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