基于VHDL的全数字锁相环的设计.docx
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2022-11-01
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第一章 绪论 .......................................................................................................................1
1.1 锁相环（PLL）－全数字锁相环（ADPLL）的发展过程 ............................................ 1
1.2 锁相环（PLL）......................................................................................................... 1
1.2.1 锁相环的发展及应用 ....................................................................................... 1
1.2.2 锁相环的分类与特点 ....................................................................................... 2
1.2.3 锁相环的优点.................................................................................................. 3
1.3 全数字锁相环的现状及发展 ...................................................................................... 3
1.4 本论文的研究内容 .................................................................................................... 4
第二章 全数字锁相环的开发系统 ...................................................................................5
2.1 EDA 技术简介 .......................................................................................................... 5
2.1.1 EDA 的发展 .................................................................................................... 5
2.1.2 EDA 技术的主要内容 ...................................................................................... 5
2.1.3 EDA 技术的基本特征及特点............................................................................ 5
2.1.4 EDA 设计工具................................................................................................. 6
2.2 现场可编程门阵列（FPGA）..................................................................................... 6
2.3 硬件设计语言－VHDL .............................................................................................. 6
2.3.1 VHDL语言简介 .............................................................................................. 6
2.3.2 VHDL语言的特点 ........................................................................................... 7
2.4 软件开发工具－MAX＋plus II ................................................................................... 8
2.4.1 MAX+PLUSⅡ概述.......................................................................................... 8
2.4.2 Max+plusⅡ功能简介 ....................................................................................... 9
2.4.3 Max+plusⅡ设计流程 ......................................................................................
2.5 实验开发系统 ..........................................................................................................12
11
第三章 设计总体规划 .....................................................................................................13
3.1 整体方案 .................................................................................................................13
3.2 关于全数字锁相环设计的几种方案...........................................................................13
3.3 设计分工 .................................................................................................................16
3.3.1 模块划分........................................................................................................16
第四章 基于 VHDL 的全数字锁相环的设计 ................................................................17
4.1 全数字锁相环的介绍................................................................................................17
4.2 ADPLL结构及工作原理 ...........................................................................................17
4.3 全数字锁相环模块介绍 ............................................................................................18
4.4 全数字锁相环的 VHDL设计.....................................................................................18
4.4.1 全数字锁相环的基本结构框图 ........................................................................18
4.4.2 全数字锁相环各模块原理及子程序设计 ..........................................................19
4.4.3 总体模块、仿真及体统性能分析.....................................................................23
第五章 总结 .......................................................................................................................28
致 谢 ...............................................................................................................................29
参考文献 .............................................................................................................................30
Ⅲ
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