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用vhdl语言设计的数字时钟 评分:

用vhdl语言设计的数字时钟 基于maxplus2软件的描述

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2011-06-10 上传 大小:4KB
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完整版 VHDL设计数字电子时钟

有完整的代码,也有设计好的完整的程序工程, 拿到手后可以直接在Quartus2上运行,还附有设计报告,包含连接图和仿真图!

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基于VHDL语言的数字时钟设计

基于VHDL的数字时钟课程设计,适用大学的电子设计自动化等方面的课程设计。

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数字时钟设计,用的是vhdl语言

根据以上对于多功能数字钟的功能的描述,可以将整个的电路设计分为以下几个模块: 分频模块:由于实验电路板上所能提供的只有1Khz和6Mhz的信号,而本设计过 程的即时以及跑表模块需要1hz、100hz和4hz的时钟信号。 控制模块:为达到多动能数字钟在计时、校时、显示日历、跑表等不同的模块之间 切换,需要控制模块产生时序要不相冲突的控制信号,保证各个模块的功能有序的执行。 计时模块:在输入的1hz时钟信号,产生显示的AM、PM、时、分、秒信号,由 于要涉及到后面的校时模块,这里采用带有置数的计时模块,在load信号控制下将校时模块设定的时间转载至初始值,在初始值的基础上正常计时。 校时模块:当功

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VHDL语言实现四人表决器

数字电路与逻辑设计实验,用Quartus 2软件VHDL语言实现的四人表决器

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VHDL语言实现简易多功能信号发生器

基于VHDL语言设计一个简易多功能信号发生器,通过选入输入信号,可以输出正弦波、三角波、方波和锯齿波四种波形信号。信号发生器的控制模块可以用数据选择器实现,四种信号的信号选择可以用4选1数据选择器实现。同时本设计使用原理图的方法,对正弦波、三角波、方波和锯齿波和4选1数据选择器元件进行调用。

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VHDL程序设计附源代码

完整讲述了一个VHDL开发抢答器实例,帮助大家完成数字逻辑VHDL语言课程设计

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VHDL全加器设计以及ALU设计报告+(全代码)

VHDL全加器设计以及ALU设计报告+(全代码)100%可以运行

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用VHDL设计多功能信号发生器

用VHDL设计多功能信号发生器,可以产生方波,锯齿波,正弦波,阶梯波等六种波形。

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基于VHDL的单片机设计

本文首先对MCS8051单片机的原理进行介绍和分析;接着介绍使用EDA技术,用VHDL语言完成了8051单片机的设计工作;MCS8051单片机的CPU和数模转换器的设计运用了算术逻辑单元ALU算术运算的算法实现和控制单元的状态机;以及数模转换器的∑-△调制方法的实现。通过如上的算法实现,可以看出VHDL语言在算法级的设计上具有很多的优势和特点。使用EDA技术设计的结果既可以用FPGA/CPLD来实施验证,也可以直接做成专用集成电路(ASIC).

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贪吃蛇游戏VHDL代码

基于可编程器件的,使用硬件描述语言的、简单的VHDL的游戏设计,贪吃蛇游戏中有一个墙,一个存在5秒的老鼠,蛇吃到老鼠后可以加分,计分到三分时,点阵会出现全亮

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VHDL实现3-8译码器.zip

使用,VHDL实现3-8译码器,Quartus II 操作.可编程逻辑器件.

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VHDL Verilog 实现三态门的源程序以及testbench代码

1)VHDL 语言下同步、异步三态门的实现和仿真; 2)VerilogHDL 语言下同步、异步三态门的实现和仿真;

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《数字通信同步技术的MATLAB与FPGA实现——Xilinx/VHDL版》杜勇编著 程序源代码

本书以Xilinx公司的FPGA为开发平台,采用MATLAB及VHDL语言为开发工具,详细阐述数字通信同步技术的FPGA实现原理、结构、方法,以及仿真测试过程,并通过大量工程实例分析FPGA实现过程中的具体技术细节。主要包括FPGA实现数字信号处理基础、锁相环技术原理、载波同步、自动频率控制、位同步、帧同步技术的设计与实现等内容。本书思路清晰、语言流畅、分析透彻,在简明阐述设计原理的基础上,追求对工程实践的指导性,力求使读者在较短的时间内掌握数字通信同步技术的FPGA设计知识和技能。

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EDA实验 序列检测器的设计

用VHDL语言设计一个序列检测器,其设计电路框图如图9-1所示,状态转换图如图9-2所示,状态转换功能表如表9-3所示,顶层电路原理图如图9-4。要求当检测器连续收到一组串行码(1110010)后,输出为1,其他情况输出为0。其仿真时序波形如图9-5所示。

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论文研究-基于FPGA的信道误码测试设计 .pdf

基于FPGA的信道误码测试设计,方琪,胡绍海,本文介绍了一种基于FPGA信道误码测试设计方案。该设计方案利用VHDL语言实现多种接口类型、多种传输速率和多种伪随机码码型的选择,�

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论文研究-基于USB总线的MVB网卡设计与实现 .pdf

基于USB总线的MVB网卡设计与实现,宋健军,刘全利,本文介绍了USB接口芯片FT245BM的工作原理以及它在MVB网卡中的实际应用。该MVB网卡采用Xilinx公司的SpartanⅡ系列的FPGA,运用VHDL语言实现FPGA�

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24进制/60进制计时器设计

24进制/60进制计时器设计,EDA 基于VHDL硬件描述语言设计

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一种基于FPGA的数字秒表设计方法

VHDL语言。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。

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基于VGA和FPGA实现的打砖块(反弹球)游戏设计

数字逻辑设计课程大作业。3人合作完成 用VHDL语言实现,内含实验报告和源代码。 游戏特点有: 不同难度级别、 计分功能、 生命值、 绚丽结束画面、 砖块形转方便修改、 随机发射速度、 挡板不同位置反射角不同、 小球速度、挡板宽度可变 通过FPGA实验板和VGA测试。

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EDA二选一数据选择器

EDA二选一数据选择器,vhdl语言编写,用于eda课程设计,可以下载到可编程逻辑器件上进行操作

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