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matlab说话代码-CCDL_FPGA_ADQ214:CCDL_FPGA_ADQ214
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2021-05-22
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matlab说话代码 CCDL_FPGA_ADQ214 Implement FFT algorithm in ADQ214 FPGA #1. And also the power spectrum accumulation, Peak detection algorithm. ##目录结构如下: ├─implementation │ └─xilinx │ ├─constraints │ ├─ipcore_dir │ ├─iseconfig │ ├─isim │ ├─logfiles │ ├─netgen │ ├─scripts │ ├─xlnx_auto_0_xdb │ ├─xst │ ├─_ngo │ └─_xmsgs ├─ngc └─source ├─Matlab_verify └─ipcore_dir Git仓库位于source文件夹、 使用方法 将ADQ214开发包复制到适当位置,按照User Guide文件“11-0724_UsersGuide_ADQ_V5_DevKit.pdf”中的说明,利用ADQ214_devkit.tcl创建ISE工程。 从Github网站clone项
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CCDL_FPGA_ADQ214-master.zip (48个子文件)
CCDL_FPGA_ADQ214-master
FIFO_Buffer.v 5KB
spi_registers.v 18KB
gain_control_template.v 2KB
ipcore_dir
fifo_Buffer_in.xco 7KB
Fifo_Buffer_Tc.xco 7KB
FIFO_Depth_512.xco 7KB
xfft_v7_1.xco 2KB
Multiplier_25.xco 2KB
FIFO_In_Rd_StateMachine.v 3KB
Trigger_Generator.v 3KB
Add_NewSource_Files.tcl 1KB
Pulse_Counter.v 2KB
SPI_CMD.v 2KB
FIFO_In_Overlap_Wr_StateMachine.v 3KB
Trigger_Decoder.v 965B
Group_Ctrl.v 2KB
Power_Spec_Cal.v 4KB
FIFO_In.v 3KB
user_logic_data_packaging.v 1KB
userlogical_processing_tb.v 6KB
adq2xx_framework_template.v 5KB
adq2xx_sandbox.v 25KB
FIFO_In_Overlap_Rd_StateMachine.v 3KB
Upload_Switcher.v 4KB
sample_skip_template.v 2KB
counter_test_pattern_v5_template.v 2KB
Posedge_detector.v 1011B
FIFO_In_Overlap.v 4KB
Post_Process.bmm 0B
config.v 473B
waveform_average_v5_template.v 2KB
FIFO_TC.v 2KB
README.md 2KB
FIFO_In_Wr_StateMachine.v 3KB
Matlab_verify
DATA_Out_Verify.m 2KB
complement.m 737B
Fifo_Out_Verify.m 414B
Gen_stimulus_sinewave.m 930B
SPEC_Verify.m 347B
Negedge_detector.v 1011B
constants.v 2KB
swrev.v 654B
decimation_extended_top_template.v 2KB
packet_streamer_template.v 2KB
user_logic_signal_processing.v 10KB
adq_alg_fpga.v 9KB
.gitignore 928B
userlogicpartnumber.v 317B
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