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简单数字时钟 EDA设计
简单数字时钟 EDA设计
数字时钟
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2009-06-21
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实现简单的数字时钟 有时序图之类~~并带有总结，是一个很好的资源
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简易数字钟EDA设计
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本实验要求在QuartusII开发系统中用可编程逻辑器件完成简易数字钟的EDA设计。掌握较为复杂逻辑电路的设计方法，包括十进制、六进制、二十四进制计数器的设计方法。并学习在QuartusII环境下采用层次化的设计方法输入逻辑电路。
基于EDA的数字时钟设计
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本系统由秒计数器、分钟计数器、小时计数器、整点报时、分的调整以及小时的调整并能显示小时、分钟、秒。采用自顶向下的设计方法，子模块利用VHDL语言设计，顶层文件用原理图的设计方法。显示：小时采用24进制，而分钟和秒均60进制。
eda 实现数字钟设计
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eda数字钟讲述了使用verilog编程实现数字时钟的办法，文件夹内包含代码。
EDA数字时钟
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EDA数字时钟设计（内含实验要求、代码及原理图）
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EDA课程的期末考察任务，以前写的，但是只剩下这个文档了，要求如下： 结合实验室EDA实验箱，完成设计数字时钟。 1) 要求其显示时间范围是00:00 :00~23:59:59。 2) 时钟具有清零功能。 3) 时钟具有暂停计时。 4) 时钟具有调节时间功能。 5) 闹钟功能等。
EDAVerilogHDL简易数字钟设计报告.pdf
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基于EDAVerilogHDL的简易数字钟设计报告，用quartus ii 实现数字电子钟，可以实现 时、分、秒走时，并且可以调整时间，闹钟，整点报时等功能。
EDA实验设计简易数字钟源程序
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在quartus II 9.0上用原理图设计了一个简易数字钟，这是源程序
简易数字钟的设计（数字逻辑与数字系统课设）
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eda程序数字时钟设计
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这是一个数字时钟设计，我真的不知道描述什么了，垃圾网站，传东西这么麻烦
数字时钟——EDA设计
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有分、秒、时显示，可以整点报时 用VHDL语言设计分模块，再进行打包综合
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鉴于Qutarts的简单时钟，可以实现计时功能，
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简易数字时钟设计报告
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eda数字时钟
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数字时钟不是数字的始祖 的的的的的的ddddddd、
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数字电子钟verilog课程设计
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数字时钟eda仿真设计报告 内容很详细的
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wzq901123
2013-01-08
还挺好，糊弄过了
tianxiang123
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