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数字时钟（电工课设）
数字时钟（电工课设）
数字时钟
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2019-01-13
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这是一个关于电子技术课设的程序，使用软件做出来的，课题是“数字时钟”，具有时分秒的计时功能，使用555定时器产生脉冲
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电工课程设计（数字时钟）
浏览：159
一、设计基本要求、设计目的 随着现代电子技术的发展，人们正处于一个信息时代，现代信息的存储、处理和传输越来越趋于数字化，数字逻辑几乎应用于每一电子设备或电子系统中。掌握基数字电路技术基础，已成为当代工科大学生的基本要求。
数电课设数字时钟
浏览：59
简单数字时钟，级数，秒脉冲，
数字电路时钟设计
浏览：69
这是一篇数字时钟设计的文档，希望能帮到大家
电工电子综合实验-数字钟设计报告
浏览：179
数字计时器（也即数字钟）在日常生活中非常的常见，同时它的应用范围也非常的广泛。本次课程设计要求设计一个简单的数字计时器，完成从 0:00到59:59的计时功能，同时还要求此电路具有任意时刻校分、清零的功能，并且还能具有特定时刻的报时功能（本次设计要求在59分53秒，59分55秒，59分57秒时各发一声低音，在59分59秒时发一声高音）。
数字逻辑课程设计数字时钟
浏览：26
3星 · 编辑精心推荐
1.设计一个能显示日期、小时、分钟、秒的数字电子钟，并具有整点报时的功能。 2.由晶振电路产生1HZ标准的信号。分、秒为六十进制计数器，时为二十四进制计数器。 3.可手动校正时、分时间和日期值。
数字逻辑课设：数字时钟（logisim文件）.circ
浏览：106
注意：先按快捷键Ctrl+K让时钟自动跳动！！！ 利用logisim软件实现数字时钟。 要求： 1. 利用logisim自带的元器件：各种逻辑门（Gate）、触发器（Flip-Flop）、7段数码管（7-Segment Display）等实现显示时、分、秒的数字钟。 2. 两位数码管显示小时并满24进位，两位显示分钟和两位显示秒钟的数码管满60进位。 3. 制作子电路芯片实现7490/74390
简易数字钟的设计（数字逻辑与数字系统课设）
浏览：107
基本要求 1、能进行正常的时、分、秒、 0.99秒的计时功能，分别由8个数码管显示24小时、60分钟、60秒钟、0.99秒的计数器显示。 2、能利用实验系统上的按键实现“校时”“校分”功能： ⑴按下“SA”键时，计时器迅速递增，并按24小时循环，计满23小时后回“00”； ⑵按下“SB”键时，计分器迅速递增，并按60分钟循环，计满59分钟后回“00”，但不向“时”进位； ⑷要求按下“SA”、“SB
数字逻辑课程设计-数字时钟（月日时分秒）
浏览：68
4星 · 用户满意度95%
数字逻辑课程设计-数字时钟 课程设计的三个简单要求 1、设计一个能显示日期、小时、分钟、秒的数字电子钟，并具有整点报时的功能。 2、由晶振电路产生1HZ标准的信号。分、秒为六十进制计数器，时为二十四进制计数器。 3、可手动校正时、分时间和日期值。 这次课程设计使用到的软件为Proteus 8 Professional，version:8.3。
中山大学数电实验时钟设计大作业
浏览：11
5星 · 资源好评率100%
另一个学长的dsn文件是有问题的......这个没问题，不过用的是同步设计，其实异步设计不用这么麻烦。
数电实验数字钟设计详细资料
浏览：184
4星 · 用户满意度95%
这是武汉理工大学的数电试验的报告！！用74ls90设计，加上74ls48 门电路设计实验！！这个ppt里面包含数电实验的所有电路图，以及原理图！还有报告的详细资料！！喜欢和需要的人下载！！可以作为参考！
数字时钟课设专用
浏览：84
数字时钟设计
数字电子电路课设报告-数字电子时钟
浏览：41
数字电子时钟的完美报告，已完成各部分的介绍截图，及相应功能的描述，各部分报告齐全，是有识之士的最好选择！
微机原理课设 数字时钟
浏览：105
CODE SEGMENT ASSUME CS:CODE,DS:CODE,ES:CODE ORG 3000H H8: JMP ABC PORT82530 EQU 0FFE8H;8253的端口地址 PORT82531 EQU 0FFE9H PORT82532 EQU 0FFEAH PORT82533 EQU 0FFEBH Port0 EQU 0FFE0H；8259的端口地址 Po
数电课设.docx 数字时钟的设计
浏览：114
5星 · 资源好评率100%
福州大学数字电路课设 数字电子钟逻辑电路设计 此文档为word文档 另有一份源文档！！！！！！！！！！！！！！！！！！！！！
数电课设（数字时钟）.ms14
浏览：150
数电课设（数字时钟）.ms14
数字电路-时钟课程设计（含源代码）
浏览：107
数字电路课程设计，包好各个模块的源码，时钟的基本功能：时钟设计有时、分、秒计数显示的功能,小时为24进制,分钟和秒为60进制以24小时循环计时；有校时功能,可以分别对时和分进行单独校时；还有整点报时功能。
数字时钟（数字逻辑）
浏览：14
数字逻辑课程设计-数字时钟 课程设计的三个简单要求 1、设计一个能显示日期、小时、分钟、秒的数字电子钟，并具有整点报时的功能。 2、由电路产生1HZ标准的信号。分、秒为六十进制计数器，时为二十四进制计数器。 3、可手动校正时、分时间和日期值。 这次课程设计使用到的软件为Proteus 8 Professional
数字逻辑课程设计 时钟（修订）
浏览：84
纯VHDL文件 拥有闹铃 整点报时 日历 使用方法（打开文件shizhong.gdf文件编译即可（本人使用maxplus））
基于数字逻辑电路的数字钟的设计
浏览：101
本次设计中数字钟基于纯数字逻辑电路，包括振荡器、分频器、计数器、译码器、显示器等基本部分，每个部分都能实现功能。
电工电子综合实验Ⅱ--数字计时器设计
浏览：196
本实验使用中小规模集成电路设计一个0分00秒——9分59秒的数字计时器。包括收获体会及建议。
数字逻辑课设：简易秒表设计（logisim文件）.circ
浏览：194
注意：先按快捷键Ctrl+K让时钟自动跳动！！！ 利用logisim软件完成简易秒表设计。 要求： 1、具有时钟源产生1S的信号 2、能够通过数码管显示，显示最大值为59，具有时间暂停功能 3、能够通过按键清除上次计数时间值
电子线路课程设计 60进制秒计时器电路设计
浏览：178
4星 · 用户满意度95%
设计一个秒计时电路，由74160同步二进制计数器和一个单位脉冲信号构成，单位脉冲信号由555定时器构成的多谐振荡器产生。
数字逻辑实验-时钟代码（maxplus2）
浏览：101
数字逻辑课实验代码，时间为二十四小时制，包含调控时间，闹钟等功能。内附maxplus2安装包。
Verilog_实现简易数字钟设计
浏览：131
5星 · 资源好评率100%
Verilog_实现简易数字钟设计......
FPGA课设数字时钟
浏览：11
本文档包含了FPGA课设数字时钟仿真的完整代码和报告。采用ISE软件，用verilog语言写成，可成功仿真出波形。(附有每个模块的测试代码)
单片机C2051数字时钟课设
浏览：139
单片机的课程设计，压缩文档内有DSN原图，可以直接加载hex文件运行，用c语言编写的代码，6位一体的数码管，可以显示时分秒，超值的课设作业
数字逻辑课设VHDL实现多功能时钟
浏览：87
5星 · 资源好评率100%
包含功能：倒计时，校时，正常时间显示，整点报时，闹钟。除可直接运行的工程文件外，还有波形图模块解释。
数字钟计时器的设计与制作
浏览：181
5星 · 资源好评率100%
用74LS系列芯片设计的具有时，钟，秒计时功能的电子钟，具有校时和整点报时功能，附有元器件和PCB原理图 二、设计要求： 1、 用中、小规模TTL组件设计一个能显示时、分、秒的数字钟。要求具有校时功能。扩展功能可考虑整点报时（此项不作基本要求）。 2、 在数字逻辑机（或外加面包板）上安装、调试成功，即算完成。 3、 编写设计报告。设计报告要求有：方案选择、各部分的工作原理及设计过程、器件
数字逻辑数字时钟设计报告
浏览：183
5星 · 资源好评率100%
1.设计任务 设计制作一台数码显示管显示的数字钟。 2设计要求 ⑴时钟显示功能，能够以十进制显示“星期”、“时”、“分”、“秒”。 ⑵具有快速校准星期、时、分、秒的功能。 ⑶计时准确度，每天计时误差不超过1s。 ⑷整点自动报时，在离整点10s时，便自动发出鸣叫声，步长1s，每隔1s鸣叫一次，前四响是低音，最后一响为高音，最后一响结束为整点。
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