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DDR控制器(xilinx)
DDR控制器(xilinx)
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DDR控制器(xilinx)
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DDR控制器(xilinx) 安福利详细设计教程
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基于Xilinx FPGA的DDR3读写控制模块(包含整个工程)
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3星 · 编辑精心推荐
基于Xilinx FPGA的DDR3控制器读写程序,此程序已经用于实际的项目中,读写控制很稳定。上传的是一个实际的DDR3工程,开发环境为Vivado 2017.4
Xilinx公司原版的DDR时序控制源码
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xilinx ddr ip
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ddr 读写说明
DDR控制器详细设计方案
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本文档讲述了DDR控制器的详细设计过程,并使用镁光的DDR model进行 仿真验证
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网络下载的XILIN DDR3 IP核教程,包括仿真、综合、设计、应用、最终篇5个部分,讲解的深入浅出,简明扼要,非常实用!在其指导下,完成了DDR3的设计调试!可惜没有找到出处!
xilinx fpga ddr3数据读写工程
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该资源为ddr3数据读写代码工程,由vivado2018.2编写。低版本的软件请参考附带的教程,自行配置ip核。开发板为ax7035,芯片为xc7a35tfgg484,ddr3芯片为16bit位宽,直接上板使用,其他芯片需更改相关输入输出管脚。module文件代码量少,适合初学者了解ddr3的读写操作。
Xilinx ISE_12.1_License 已测试
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Xilinx ISE_12.1_License 已经通过测试 请放心使用
实用DDR控制器
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在分析DDR SDRAM 基本操作原理的基础上,提出了一个基于FPGA 的DDR SDRAM 控制器的设计,实现了DDR SDRAM 读写时序控制,并给出实现结果
xapp491(xilinx DDR)
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DDR SDRAM控制器
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xapp708_DDR xilinx官方参考设计
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DDR控制器 xilinx mig用户自定义代码verilog
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一种DDR SDRAM控制器的设计
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在介绍DDR SDRAM控制器设计关键技术的基础上,讨论了一种DDR SDRAM控制器的设计方法。通过一种优化的地址映射策略提高了突发访问效率,采用0.18 ?滋m CMOS工艺流片实现。所设计的DDR SDRAM控制器芯片在PCB板级测试中达到预期设计要求。
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用VHDL编写的DDR SDRAM控制器,非常使用,内附文档说明。
基于FPGA的DDR控制器设计
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介绍了 DDR SDRAM 控制器的系统命令和结构 ,设计了一种基于状态机的 DDR SDRAM 控制器 。利 用状态机对读写操作进行控制可提高系统性能 ,给出了基于 FPGA 的控制器的仿真结果 。
基于FPGA的DDR控制器的设计
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本文档主要是介绍基于FPGA的DDR控制器的设计,包括整个设计原理以及最后的实现仿真验证。
DDR SDRAM控制器的FPGA实现
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DDR_SDRAM控制器的VHDL
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FPGA实现 DDR SDRAM FPGA控制器
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第9章 DDR存贮器控制器
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仿真电路以及操作方法
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用一片通用四运放芯片LM324组成电路,实现以下功能:用低频信号源产生ui1=0.1sin2πft(V),f=500Hz的正弦波信号,加至加法器的输入端,加法器的另输入端加入有自制振荡器产生的信号uo1。要求加法器的输出电压ui2=10 ui1+ uo1。ui2经选频滤波器滤除uo1频率分量,选出f信号为uo2,uo2为峰峰值等于9V的正弦信号。uo2信号经比较器后在1KΩ负载上得到峰峰值2V的输
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ssskkkyyy
2014-07-11
可以,深入详细,英文不好的不要看。
maozhu_yimi
2013-03-15
哥。。英文的,有点自卑
宁静致远future
2015-06-11
资料很好,很有用。
Grice_ling
2012-10-18
比较简易,对于新手来说...不够详细哦。
a330238251
2011-10-19
全英文,不容易看。
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