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8B/10B编码器的设计实现
8B/10B编码器的设计实现
8B/10B
serdes
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一篇讲解8B/10B编码的硕士论文，写的比较全面
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8B/10B编码器的设计与实现
浏览：160
用于JESD204B中的编码技术，详细描述了8B/10B编码的技术原理和方法，以及相应的verilog代码，对于理解编码技术非常有用，对于设计基于JESD204B接口的serdes十分有用
8B_10B编码器的设计及实现.pdf
浏览：123
8B_10B编码器的设计及实现.pdf
PCIE接口8B10B编、解码的实现
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PCIE接口8B10B编、解码的实现 PCIE接口8B10B编、解码的实现 PCIE接口8B10B编、解码的实现
基于FPGA的8b10b编解码verilog实现
浏览：41
5星 · 资源好评率100%
本设计是采用EDA技术设计的一种8B /10B 编解码电路,实现了在高速的串行数据传输中的直流平衡。利用verilog HDL 逻辑设计语言，经过modelsim、quartus II的仿真和下载验证，实现其编码和解码的功能。 该编解码电路设计大体上可以由五个模块构成，分别是默认编码模块、差异度计算模块、编码校正模块、并串转换模块、显示模块。 采用Verilog HDL 描述、modelsim 1
Verilog8b10b编码
浏览：157
采用Verilog语言编写8b10b编码代码，其基于查找表方法而不是逻辑关系，易于理解
Xilinx Aurora 8B_10B IP核详解和仿真.pdf
浏览：117
5星 · 资源好评率100%
Xilinx Aurora 8b/10b IP核的详解，对IP核的配置和如何仿真有非常详细的说明，除了对IP核官方文档的内容进行了解析以外，对GTX引脚的选择等比较容易混淆和不好理解的地方进行了说明。对IP核的仿真以及如何修改源码和约束文件以用于实际工程进行了简要说明
Xilinx 提供的高速多状态编码8b_10b编码器.7z
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Xilinx aurora 8b10b 协议
浏览：80
Xilinx aurora 8b10b 协议，半导体行业硬件驱动接口开发编码协议。
8B/10B编码器设计
浏览：44
8B/10B编码器设计，主要介绍如何设计，8B/10B编解码器，并告诉如何编码。
新型8B_10B编码方案的设计与实现.pdf
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一种基于FPGA的8B_10B编解码电路的设计与实现.pdf
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8B_10B解码器的设计
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3星 · 编辑精心推荐
8B_10B解码器的设计，描述了8B_10B编码的原理
基于FPGA的8B/10B编解码设计
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为提高8B/10B编解码的工作速度和简化逻辑方法，提出一种基于FPGA的8B/10B编解码系统设计方案。与现有的8B/10B编解码方案相比，该方案是一种利用FPGA实现8B/10B编解码的模块方法，接收模块在收到外部发送的并行数据时，通过直接查找映射的方法转换成利于传输的串行信号。串行信号经串并行转换模块，将数据经10B/8B解码模块解码还原成原始数据。为了更好实现数据的传输，系统加入了极性偏差R
基于FPGA技术的8B_10B信道编码设计.pdf
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一种基于低成本FPGA的高速8B_10B编解码器设计.pdf
浏览：64
5星 · 资源好评率100%
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基于FPGA的8B_10B编解码设计.pdf
浏览：144
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8B/10B编解码的IP核设计
浏览：156
研究了8B/10B编码的编码特点和内在相关性，并在此基础上介绍了一种用Verilog HDL设计8B/10B编解码逻辑描述的方法，将其嵌入到FPGA中或设计成ASIC，可构成一个资源使用少、速度快、可靠性高的IP核。文中着重介绍8B/10B编解码总体设计方案，详细描述其内部工作原理和实现。最后给出在Altera公司软件平台Quartus II上进行EDA的综合和仿真结果。
千兆以太网中的8B_10B编解码的CPLD实现技术[收集].pdf
浏览：34
千兆以太网中的8B_10B编解码的CPLD实现技术[收集].pdf
DAB发射系统编码器的设计及实现
浏览：29
数字音频广播(DAB)是继调幅(AM)、调频(FM)广播之后的第三代广播。与现行广播相比，DAB具有音质好(CD质量)、可实现多媒体及高速移动接收、可加密、发射功率小、覆盖面积大、频谱利用率高、抗干扰能力强等优点。DAB传送的业务可以是多种多样的，除了普通的音频节目，它也可以传送任何形式的其它数据，比如文字、静止图像或活动影音。因此，人们也称DAB为数字多媒体广播(DMB)。 本文主要介绍了
Manchester编码器的FPGA设计与实现
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JPEG2000 MQ编码器的设计与实现
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提出了一种JPEG2000 MQ编码器的硬件设计方案。通过状态更新超前预测、前导零检测、重归一化超前预测等方法以及字节输出的改进处理，使MQ编码器的工作速率可达1CxD/cycle。同时对各流水段中的路径进行优化改进，提高了系统的最高时钟频率。采用Verilog语言进行RTL级描述，并在Altera的FPGA上进行了仿真验证。结果表明，在Altera的EP2S60F67214上，该MQ编码器的最高
4PPM码编码器设计与实现2.rar
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5星 · 资源好评率100%
所设计的4PPM码是将两位二进制信息，编译成四位二级制信息码。共四组二进制码有00、01、10、11，分别对应编译成1000、0100、0010、0001。同时编译时要求串行输入输出，所以要求对信息设计编码分组，经过计数器的控制将被串行转换后的编码，依次循环输出，四组输入对应四组不同的输出，这就是4PPM编码器的基本设计原理。
CMI码编码器设计与实现.rar
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CMI又称传号反转码，是一种二电平非归零码。其中“0”码用固定的负、正电平表示，“1”码用交替的正、负电平表示。 CMI码是一种1B2B码（一位信息码，二位码元），即将过来的一位码子用两位码子来表示。当过来“0”码时，编码输出固定的“00”或者“11”码，并且交替出现。
Turbo码编码器的FPGA设计与实现
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Turbo码编码器的FPGA设计与实现，原理解释，通俗易懂
串口助手工具合集.zip
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收集整理常用的一些串口工具，比如串口波形显示，modbus协议调试，串口多条发送等各种功能软件。
OLED显示温度和时间-STM32F103C8T6（完整程序工程+原理图+相关资料）.zip
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OLED 屏幕显示时间，温度。时间可以校准，屏幕通过取模，可以显示汉字。
pn532模拟资料包.zip
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使用pn532实现。手环模拟加密门禁卡的一些必需软件，包括M1T-v1.6.6、M1T-v1.6.6、驱动等。
Vivado license 永久
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2018.3测试可用，各种IP超级齐全，测试了srio可用，Jesd等IP均显示正常，理论上所有版本应该都支持，大家下来看看。
STM32全系列 Keil MDK pack包（当前最新离线包）
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STM32全系列 Keil MDK pack离线包 注：由于上传大小限制，除了F0和F1的包，其他的提供链接通过百度云下载。 包括以下包，当前最新版本（20200115） Keil.STM32F0xx_DFP.2.0.0.pack Keil.STM32F1xx_DFP.2.3.0.pack Keil.STM32F2xx_DFP.2.9.0.pack Keil.STM32F3xx_DFP
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lp1234567
2018-01-18
东西很有用
dzlyl
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