本项目实现的是32位加法器，实现思路为连接4个8位加法器，已通过vivado Simulation。
使用语言：Verilog
使用软件：vivado
本项目包含：
1、adder_32.xpr
2、readme.txt
3、vivado自动生成的文档
adder_32.rar （63个子文件） 
adder_32 adder_32.srcs sim_1 new 
adder_32_tb.v 434B sources_1 new adder_8.v 362B adder_4.v 236B adder_32.v 571B adder_32_tb.wcfg 3KB adder_32.hw adder_32.lpr 290B adder_32.ip_user_files 
README.txt 130B adder_32.cache compile_simlib riviera vcs modelsim xcelium ies activehdl questa wt xsim.wdf 256B java_command_handlers.wdf 1KB webtalk_pa.xml 5KB project.wpc 61B gui_handlers.wdf 4KB synthesis.wdf 5KB adder_32.xpr 9KB adder_32.sim sim_1 behav xsim webtalk_2440.backup.jou 801B compile.bat 840B xsim.ini 40B elaborate.bat 1KB glbl.v 1KB xvlog.log 0B simulate.log 50B elaborate.log 595B compile.log 0B webtalk.jou 802B adder_32_tb.tcl 460B .Xil Webtalk-5236-LAPTOP-T5PKU205 webtalk Webtalk-2440-LAPTOP-T5PKU205 webtalk Webtalk-27376-LAPTOP-T5PKU205 webtalk xvlog.pb 16B adder_32_tb_behav.wdb 15KB webtalk_5236.backup.log 1KB webtalk.log 1KB xelab.pb 1KB simulate.bat 1KB webtalk_2440.backup.log 1KB webtalk_5236.backup.jou 801B xsim.dir adder_32_tb_behav 
xsimk.exe 67KB xsim.rlx 784B obj xsim_1.win64.obj 3KB xsim_1.c 5KB xsim_0.win64.obj 7KB xsim.mem 4KB xsim.type 24B xsimkernel.log 330B xsim.xdbg 7KB xsim.dbg 11KB Compile_Options.txt 256B xsim.rtti 254B webtalk xsim_webtalk.tcl 4KB usage_statistics_ext_xsim.wdm 1KB .xsim_webtallk.info 65B
usage_statistics_ext_xsim.html 3KB usage_statistics_ext_xsim.xml 3KB TempBreakPointFile.txt 29B xsim.svtype 66B xsim.reloc 2KB xsimSettings.ini 1KB xsimcrash.log 0B xil_defaultlib adder_8.sdb 2KB adder_32.sdb 2KB xil_defaultlib.rlx 670B adder_4.sdb 878B adder_32_tb.sdb 2KB glbl.sdb 4KB adder_32_tb_vlog.prj 399B readme.txt 248B资源评论
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