%8B电路实验数据采集系统的研究和设计

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: %8B电路实验数据采集系统的研究和设计 %8B电路实验数据采集系统的研究和设计 数据采集 电路设计
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评级：0 浏览量：163 收藏量：1 资源大小：299KB 上传时间：2021-01-19

: 基于nRF24E01的无线温度采集系统设计 温度采集系统所采集的温度信息通常通过RS485、CAN总线通信方式传输至上位机，但这种方式维护较困难，不利于工业现场生产；而无线通信GPRS技术传输距离长，通信可靠稳定，但设计复杂、成本昂贵、后期运转成本高。本...
评级：0 浏览量：64 收藏量：0 资源大小：64KB 上传时间：2020-07-29

: CMOS分频电路的设计　目前，在高速串行数据传输系统中，传送的数据大多采用8B/10B 编码方案编码成自同步的数据流，因此在接收端为了进行8B/10B 解码，需要对数据进行1:8/1:10 的串并转换；在高速收发系统中，为在特定工艺下实现更高...
评级：0 浏览量：771 收藏量：2 资源大小：299KB 上传时间：2021-01-19

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: fuhction.rar_shoote8b_系统/网络安全 Matrix_Template_Library rar c++矩阵模块库函数
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评级：0 浏览量：1128 收藏量：1 资源大小：589KB 上传时间：2021-04-18

: 8B10B编解电路设计 具体实现8B10B编解电路，是很好参考论文，论文里面很多内容不错
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: 基于FPGA_CPLD的7B8B编解码电路设计.pdf 基于FPGA_CPLD的7B8B编解码电路设计.pdf
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: 基于光纤通道数据收发系统的设计与实现本论文基于对航空航天电子...提出一种数据收发系统的硬件设计方案，通过chipscope对该数据收发系统进行上板调试和验证，最终实现数据高速传输，串行数据传输速率达到1.062 5 Gb/s，得出该数据收发系统设计的可行性。
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: 8B/10B编解码的IP核设计研究了8B/10B编码的编码特点和内在相关性，并在此基础上介绍了一种用Verilog HDL设计8B/10B编解码逻辑描述的方法，将其嵌入到FPGA中或设计成ASIC，可构成一个资源使用少、速度快、可靠性高的IP核。文中着重介绍8B/...
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: TDK技术人员谈HDMI接口设计和测试 HDMI v1.3标准的数据传输速率达到3.4Gbps，这加增大选择EMI/ESD保护元件的难度。在EMI对策中，尽管大多数情况下可以有效使用共模滤波器(CMF)，但是如果选择了错误的CMF，则可能导致最坏的后果。因此，必须减小相对于...
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: 基于FPGA的8B10B编解码设计摘要：为提高8B／10B编解码的工作速度和简化逻辑方法，提出一种基于FPGA的8B／10B编解码系统设计方案。与现有的8B／10...
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: 8B_10B编码器的设计及实现.pdf 8B_10B编码器的设计及实现.pdf
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: 光纤通道8B/lOB编码的ASIC研究与设计 (2011年) 在目前的高速串行数据传输中广泛采用的是8B/10B编解码，为了达到简化实现结构，用于大规模集成电路的目的，研究了现有各种不同的8B/10B编解码的特点和内在相关性，并在此基础上介绍了用一种VHDL设计8B/1B编码逻辑...
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: XC7K325T aurora_8b10b光通信设计（含教程和FPGA工程） XC7K325T aurora_8b10b光通信设计（含教程和FPGA工程），有操作教程，FPGA源码（VIVADO2017.4打开），参考原理图
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: AdminLTE-master.rar_AdminLTE_adminLET 主题_singw8b_可视化系统_可视化系统一个用于系统可视化管理的网站系统，可更换主题，自定义模块
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: 电源技术中的DAP-8B构成的碟机开关电源电路原理分析 DAP-8B是一片高电压开关电源脉宽控制集成电路。内置启动、振荡、过流、过压保护等电路。各引脚功能如下：①脚过零电压检测；②脚反馈电流输人；③脚过压保护输入；④脚热地；⑤脚驱动信号输出；⑥脚电源电压；⑦脚空...
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: 设计基于数字温度传感器DSl8B20芯片的多点测温系统本文在介绍数字温度传感器DSl8B20的基础上，采用AT89C5l单片机设计多点采集温度系统的方案，并给出了重要电路图和初始化DSl8B20程序。该方案采用从机采集多点温度，主机显示温度，主、从机之间通过RS 485通信，且...
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: 基于京微雅格低功耗FPGA的8b/10b SERDES的接口设计摘要　串行接口常用于芯片至芯片和电路板至电路板之间的数据传输。随着系统带宽不断增加至多吉比特范围，并行接口已经被高速串行链接，或SERDES （串化器/ 解串器）所取代。起初， SERDES 是独立的ASSP 或ASIC 器件...
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: 基于PRBS检测的8B/10B编码器设计基于减少8B/10B编码器占用的逻辑资源和保证该编码器误码率为0的目的，采用查表法和组合逻辑实现相结合的方法设计实现了符合嵌入式互连规范RapidIO协议的8B/10B编码器，通过伪随机二进制序列（Pseudo Random Binary ...
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