七段译码

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七段译码

: VHDL七段译码器 VHDL七段译码器，输入二进制代码，通过译码器，能够直接在数码管上显示
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: 七段译码器的设计实验用verilog语言写的七段译码器的实验，尽管代码挺简洁的，但用处很大，对学习数字逻辑电路的同学很有帮助。
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: 七段显示译码器74LS48实验multisim源文件七段显示译码器74LS48实验multisim源文件，multisim10及以上版本可以正常打开仿真，是教材上的电路，可以直接仿真，方便大家学习。
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: 七段显示译码器74LS48 七段显示译码器74LS48
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