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Matlab代码verilog-4x4-to-8x8-upsample-code:用于上采样的补充文件A收缩式nxn至2nx2n...
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2021-05-27
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Matlab代码verilog 4x4至8x8上采样代码 用于上采样的补充文件A收缩式nxn至2nx2n反卷积架构 texstuidio 2.12.14将用于向上采样的Systolic反卷积架构用于M.tex和reference.bib生成的pdf文件 环境MATLAB 2019a 2.1公式摘要.m,用于获取本文中的方程式。 2.2 verifycode3by3.m用于检查FPGA与Matlab之间的3x3内核2.3 verifycode5by5.m用于检查FPGA与Matlab之间的3x3内核2.4 verifycode7by7.m用于检查FPGA与Matlab之间的3x3内核 project_4_to_8.zip是Verilog HDL代码,用于显示我们在VIVADO 2017.4上使用[1 2 3 4; 5 6 7 8; 9 10 11 12; 13 14 15 16]; Verilog代码:我们已单独上传了Verilog代码以供审核。 审核完成后,可以在以下doi 10.6084 / m9.figshare.13668644中使用完整的项目,以供使用。
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verifycode3by3.m 5KB
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randomImage32.bmp 3KB
verifycode7by7.m 17KB
randomImage64.bmp 12KB
README.md 1KB
A Systolic Deconvolution Architecture for up samplingM.tex 67KB
equationSummary.m 495B
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