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hough变换matlab代码-lht_framework:具有PYNQ和Mathworks的HDL编码器的Hough评估平台
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2021-05-27
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hough变换Matlab代码 具有PYNQ和Mathworks的HDL编码器的Hough评估平台 请参阅相应的出版物。 该存储库包含一个用于线型霍夫变换(LHT)的现场可编程门阵列(FPGA)架构的(Zynq的Python生产效率)评估平台。 该系统被称为霍夫评估平台(HEP)。 HEP可以使用自定义FPGA架构计算将LHT应用于图像所需的时间,并且能够使用PYNQ的信号跟踪和可视化功能检查Hough参数空间(HPS)。 HEP还可以计算新的定量度量,以分析由不同LHT架构产生的HPS。 此测量称为峰均投票比(PMVR),对于量化从其他相邻位置可靠地提取和分离HPS中的峰的能力很有用。 HEP使用MathWorks的HDL Coder参考设计进行LHT架构的快速原型设计和评估。 该参考设计目前针对Xilinx ZCU104开发板。 以后将支持其他平台。 请参阅快速入门,以使用您自己的ZCU104开发板快速评估HEP。 或者,您可以学习如何使用。 该存储库与开发板兼容。 尽管可以找到示例笔记本,但是由于必须在Zynq MPSoC器件上使用它,因此没有交互性。 快速开始 以下步骤将打开一
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lht_framework-master.zip (84个子文件)
lht_framework-master
Models
hpa_module
hpa_module.slx 32KB
lht_1280_720
setup_parallel_hough_transform.m 445B
stop_parallel_hough_accumulator.m 183B
lht_1280_720.slx 52KB
Template
ZCU104_HEP_Template.slx 29KB
img
window.jpg 2.35MB
wall.jpg 4.1MB
github_hps_gif.gif 38.94MB
stairs.jpg 1.01MB
dirtyroof.bmp 37.13MB
boards
ZCU104
lht_framework
bitstream
zcu104_hep.bit 18.42MB
zcu104_hep.hwh 519KB
zcu104_hep_bd.tcl 47KB
notebooks
Hough Evaluation Platform.ipynb 9.66MB
assets
system_overview.pdf 360KB
system_diagram.png 31KB
circle_steps.jpg 1.01MB
brick_wall.jpg 4.1MB
dirtyroof.bmp 37.13MB
system_overview.png 54KB
hough_evaluation.py 4KB
hough_performance.py 1KB
iprepo
hpa_module_v1_0
hdl
vhdl
hpa_module_src_Rising_Edge_Detector_Valid.vhd 2KB
hpa_module_axi_lite.vhd 10KB
hpa_module_src_hpa.vhd 11KB
hpa_module_src_Rising_Edge_Detector_Last.vhd 2KB
hpa_module_dut.vhd 6KB
hpa_module_addr_decoder.vhd 10KB
hpa_module_axi_lite_module.vhd 11KB
hpa_module_reset_sync.vhd 2KB
hpa_module_src_Rising_Edge_Detector_Seconds.vhd 2KB
hpa_module.vhd 12KB
xgui
hpa_module_v1_0.tcl 195B
include
hpa_module_addr.h 983B
hpa_module_v1_0.zip 94KB
xilinx.com_ip_hpa_module_1.0.zip 95KB
doc
doc_arch_axi4_lite.jpg 61KB
free_running.jpg 23KB
hpa_module_ip_core_report.html 13KB
hdlwfbuildstatus.mat 3KB
prj_ip
vivado_ip_package.tcl 18KB
prj_ip.cache
wt
project.wpc 62B
prj_ip.hw
prj_ip.lpr 284B
prj_ip.xpr 12KB
component.xml 44KB
ZynqCustom
+ZCU104
+vivado_dma_system_2019_1
plugin_rd.m 2KB
zcu104_hep.tcl 48KB
callback_CustomProgrammingMethod.m 1KB
hdlcoder_ref_design_customization.m 213B
plugin_board.m 529B
+strath
+hdlcoder
vivado_dma_system_2019_1_iplist.m 91B
hpa_module_v1_0
hdl
vhdl
hpa_module_src_Rising_Edge_Detector_Valid.vhd 2KB
hpa_module_axi_lite.vhd 10KB
hpa_module_src_hpa.vhd 11KB
hpa_module_src_Rising_Edge_Detector_Last.vhd 2KB
hpa_module_dut.vhd 6KB
hpa_module_addr_decoder.vhd 10KB
hpa_module_axi_lite_module.vhd 11KB
hpa_module_reset_sync.vhd 2KB
hpa_module_src_Rising_Edge_Detector_Seconds.vhd 2KB
hpa_module.vhd 12KB
xgui
hpa_module_v1_0.tcl 195B
include
hpa_module_addr.h 983B
hpa_module_v1_0.zip 94KB
xilinx.com_ip_hpa_module_1.0.zip 95KB
doc
doc_arch_axi4_lite.jpg 61KB
free_running.jpg 23KB
hpa_module_ip_core_report.html 13KB
hdlwfbuildstatus.mat 3KB
prj_ip
vivado_ip_package.tcl 18KB
prj_ip.cache
wt
project.wpc 62B
prj_ip.hw
prj_ip.lpr 284B
prj_ip.xpr 12KB
component.xml 44KB
hdlcoder_board_customization.m 163B
src
slht_pmvr_plot.m 956B
Sobel.m 1KB
StandardLHT.m 2KB
slht_pmvr_compare.m 1KB
plot3DHPS.m 169B
setup.py 1KB
.gitignore 44B
README.md 5KB
.gitattributes 66B
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