放大器电气过应力放大器电气过应力EOS问题分析问题分析
当我们考虑出现EOS问题的放大器时,可能会想到静电放电 (ESD) 。ESD使放大器引脚面临短时、高压、放电
问题。第二种(通常会被人们忽略)过应力条件是 EOS 。EOS使放大器面临相对于 ESD 较低的过压和电流,但
持续时间更长。看完本文后,您就会对潜在放大器 EOS 状态有所了解,并知道解决这一问题的方法。利用这种
方法,您就能够设计防止电气过应力损坏、稳健的集成电路外部系统。破坏性的静电放电事件 电气过应力
的一个明显起因是 ESD。当两个物体 (body) 极为接近,且处于不同静电位下(几百伏或数千伏)时,便存在发生
ESD 的可能性。若两个物体之间出现传导路径,则会发生静电荷转移。
当我们考虑出现EOS问题的放大器时,可能会想到静电放电 (ESD) 。ESD使放大器引脚面临短时、高压、放电问题。第二
种(通常会被人们忽略)过应力条件是 EOS 。EOS使放大器面临相对于 ESD 较低的过压和电流,但持续时间更长。看完本文
后,您就会对潜在放大器 EOS 状态有所了解,并知道解决这一问题的方法。利用这种方法,您就能够设计防止电气过应力损
坏、稳健的集成电路外部系统。破坏性的静电放电事件
电气过应力的一个明显起因是 ESD。当两个物体 (body) 极为接近,且处于不同静电位下(几百伏或数千伏)时,便存在发
生 ESD 的可能性。若两个物体之间出现传导路径,则会发生静电荷转移。电荷中和以后,便不再放电。芯片处于电路断开
(out-of-circuit) 环境下可能会发生 ESD 。一般而言,我们发现错误地操作 IC 芯片会导致 ESD发生,从而带来一定的破坏性。
ESD 发生在若干分之一秒时间内(通常不到 250ns)。若电流路径中几乎没有电阻的话,则大约数安培的电流将会流入芯片电
路。数十年前,半导体电路常常遭受 ESD 带来的破坏,终会导致整个电路故障,甚至带来危害更大的参数降级。然而,一旦
ESD 的特性为人们了解之后,半导体厂商就开始在新的 IC 设计中实施保护电路。这些片上保护电路极大地降低了 ESD 对 IC
芯片产生破坏的可能性。片上 ESD 保护电路的主要功能是防止PCB 装配之前和 PCB 装配操作带来的 ESD 相关破坏。此类操
作期间,低阻抗接地路径可起到放电路径的作用,以对 IC 或周围表面所带的电荷进行放电。IC 安装到 PC 电路板上后,情况
便不一样了。一旦安装完成,在 IC 芯片和另一个板上组件之间便形成了连接。这就大大降低了低阻抗 ESD 路径存在的可能
性。完成此安装以后,您极有可能不会碰到干预内部 ESD IC 电路的 ESD 情况。这的确不错!但是,还有另一种可能性。工作
电路的一些状况可能会使 IC 芯片受 EOS的影响。在 EOS状态下,可能会无意中激活 ESD 电路。EOS 的时滞可能会比 ESD
的时间要长得多。EOS期间电流传导的强度和持续时间可能足以在芯片中产生具有危险水平的热量。在这种极端条件下,芯
片会被迅速破坏而且不可避免,终损坏电路。幻像电气过应力不知不觉地,我们可能正依赖器件的内部 ESD 电路在 EOS期间
提供保护,尽管并非有意让电路支持这一用途。您可能会发现,在施加电力以前您便拥有了一个可以完美运行的 IC(请参见图
1),然而在施加电力和输入信号以后该 IC 突然就被破坏了。EOS 可能会非常剧烈,以至于 IC 过热,从而熔化裸片和封装材
料。图 2 为此类破坏的一个例子。
图 1 安装之前的全功能 IC
图2
图 2 出现EOS后被破坏的 IC集成电路通常不包括 EOS 条件保护。充其量,内部 ESD 保护电路可能会在 EOS 期间启
用,并提供充分保护。但是,设计 ESD 保护电路并不能保证在所有 EOS 状态下都提供这种保护。EOS 期间建立的电流路径
较为复杂,并且有一定的不可预知性,杂散阻抗变大的高频情况下更是如此。图 3 显示了放大器内几种可能的电流路径例
子。ESD 输入保护二极管(常为“关闭”)提供了到各个电源和 T1 的直流路径。如果放大器电源不能吸入 EOS相关电流,则 IC
电源引脚电压可能会上升至危险水平。T1 为一个 ESD 吸收器件。ESD 期间,T1 的功能是在安全水平开启并钳制电源引脚的
电压。切记大多数 ESD 事件都发生在 IC 处于电路断开时。但是,在电路内 EOS 期间,T1 可能在不经意间开启。此时,T1
会在运算放大器电源引脚之间建立起一个低电阻连接。这样,强破坏性电流开始流动,直到 T1 熔化,从而在放大器电源之间
形成短路。前面提到的自加热和破坏均可能发生。上述热量温度可以升高到足以使封装熔化、裂开,如图 2 所示。