摘要：研究采用编码扩频的DS/FH混合扩频接收机的模块――同步及解扩部分的FPGA实现结构。将多种专用芯片的功能集成在一片大规模FPGA芯片上，实现了接收机的高度集成化、小型化。伪码的串并混合捕获算法及跳频同步算法等均采用硬件完成，提出了捕获速度。实现结果证明该方案是正确可行的。
关键词：DS/FH接收机 解扩 同步 FPGA实现
DS/FH混合扩频通信系统中，需要数字下变频器、相关累加器及码发生器等完成下变频、相关解扩等运算。通常采用专用芯片来完成这些功能，导致系统体积增大不便于小型化。现代的EDA(电子设计自动化)工具已突破了早期仅能进行PCB版图设计或电路功能模拟、纯软件范围的局限
