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实验三_1181002038_张璐矾1
实验三_1181002038_张璐矾1
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EDA实验三实验目的：使用VHDL设计一个带使能的24译码器,0代表灯亮，不译码，1代表灯灭，译码。
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EDA
实验三
实验目的
：使用
VHDL
设计一个带使
能的
24
译码器
,0
代表灯亮，不
译码，
1
代表灯
灭，译
码。
实验设计：
Input
output
En
G1
G0
M3
M2
M1
M0
1
0
0
0
0
0
1
1
0
1
0
0
1
0
1
1
0
0
1
0
0
1
1
1
1
0
0
0
0
0
0
0
0
0
0
0
0
1
0
0
0
0
0
1
0
0
0
0
0
0
1
1
0
0
0
0
电路图：
仿真：
RTL
：
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