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秒表设计 外部中断 12进制 24进制切换
秒表设计 外部中断 12进制 24进制切换
秒表设计
外部中断
12进制
24进制切换
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运行正确！单片机汇编语言 数字钟设计 带外部中断 12 24进制切换
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基于Quartus的数字秒表设计
浏览：76
课程实验 秒表的显示范围是00:00:00-59:59:99，显示精度为10ms，其拥有可控的自动报警功能（可通过蜂鸣器控制模块的clk端选择计数一小时后报时或者不报时，如想要报时则接通clk端，反之clk端断开，选择报时则计数达到一小时后蜂鸣器会响一声，否则蜂鸣器不响，）、可控的启动功能
用定时计数器和中断程序设计秒表
浏览：139
只用定时计数器和中断程序相关知识，实现秒表从0—59循环显示。不需要延时程序，亦不需动态扫描。
二十四进制电子钟设计
浏览：61
1、设计一个有“时”，“分”，“秒”（23小时59分59秒）显示且有校时功能的电子钟； 2、 用中小规模集成电路组成电子钟； 3、画出框图和逻辑电路图，写出设计报告； 4、选做：①闹钟系统。②整点报时。③日历系统
24进制的电子钟
浏览：72
能正常仿真24进制的转换，确实可行，可以用555芯片驱动或者方波发生器驱动
VHDL数字电子钟的设计
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4星 · 用户满意度95%
能够实现小时（24进制）、分钟和秒钟（60进制）的计数功能 具有复位功能 功能扩展：具有复位、整点报时提示、定时闹钟等功能 在软件工具平台上，进行VHDL语言的各模块编程输入、编译实现和仿真验证。
秒表（定时器+中断，带proteus仿真）
浏览：53
5星 · 资源好评率100%
利用定时器和中断编写的秒表程序，自己一点一点手打，简单明了，适合学习！带proteus仿真，C语言编写！
简易数字钟实验报告（含12~24进制转换扩展）
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基于FGPA的数字模拟设计，设计要求制作一个简易数字钟，正点会鸣响报时。扩展功能要求可以12~24进制间转换。
数字钟实验报告
浏览：77
这是一个比较完善的制作数字钟的报告，具有比较好的指导意义。
verilog数字钟
浏览：43
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verilog 数字钟设计，功能齐全 （1）设计一个数码管实时显示时、分、秒的数字时钟（24小时显示模式）； （2）可以调节小时，分钟。 （3）能够进行24小时和12小时的显示切换。 （4）可以设置任意时刻闹钟，并且有开关闹钟功能。 （5）有整点报时功能，几点钟LED灯闪亮几下。 （6）有复位按键，复位后时间从零开始计时，但闹钟设置时间不变。
二十四进制计数器
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使用Quartus ii 软件编写的二十四进制计数器，所使用的语言为Verilog.
最新单片机仿真 数码秒表设计
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数字钟设计，包括万年历，闹钟，倒计时，秒表，进制转换
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数字钟设计，包括万年历，闹钟，倒计时，秒表 进制转换.内含报告文档，代码注释，模块解析
电子线路课程设计 60进制秒计时器电路设计
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设计一个秒计时电路，由74160同步二进制计数器和一个单位脉冲信号构成，单位脉冲信号由555定时器构成的多谐振荡器产生。
任意进制计数器及简易秒表设计.pdf
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ADC十二位二进制数LED灯显示，proteus仿真
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基于stm32单片机的ADC电压采集，将其采集的十二位二进制数用十二个LED灯的亮灭来显示0和1，更好的理解ADC采样电压。
数字电子技术课程设计报告-数字时钟与闹钟
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数字电子技术课程设计报告-数字闹钟 ①由晶振电路产生1HZ标准秒信号； ②分、秒为00~59六十进制计数器； ③时为00~23二十四进制计数器； ④周显示从1~日为七进制计数器； ⑤具有校时功能，可以分别对时及分进行单独校时，使其校正到标准时间； ⑥整点具有报时功能
24小时制数字时钟设计.rar
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压缩包内包含三个文件，皆是经过quartus软件仿真验证无误的。其中clock_60为可启动/暂停、复位、进位的60进制计数器，clock_24为为可启动/暂停、复位、进位的24进制计数器，clock_day将前两个源码封装后的模块进行连接，即可得到24小时制的时、分、秒时钟，该时钟具有进位、复位、启动/暂停的功能。
24小时制数字时钟显示
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基于89c51的设计仿真，文件里面有报告，有仿真图，有hex文件。
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通过对数字秒表的设计，进行理论与实际的结合，提高与计算机有关设计能力，提高分析、解决计算机技术实际问题的能力。通过课程设计深入理解计算机结构与控制实现的技术，达到课程设计的目标。 有设计报告 quartus ...
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