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华中科技大学计算机15级计算机组成原理课程设计,分别用logisim和Verilog实现简单CPU.zip
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华中科技大学计算机15级计算机组成原理课程设计,分别用logisim和Verilog实现简单CPU.zip
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华中科技大学计算机15级计算机组成原理课程设计,分别用logisim和Verilog实现简单CPU.zip (156个子文件)
benchmark_ccmb.asm 13KB
多级中断.asm 9KB
中断演示主程序.asm 8KB
移位测试.asm 4KB
单级中断.asm 3KB
分支预测测试.asm 2KB
JMP测试.asm 2KB
排序测试.asm 2KB
走马灯测试.asm 2KB
SH.asm 1KB
SLTIU.asm 1KB
LHU.asm 1KB
SB.asm 1KB
LB.asm 1KB
LBU.asm 1KB
中断演示V2.0.asm 1KB
LH.asm 1KB
数据相关测试.asm 1KB
乘除法.asm 1KB
MULTU.asm 987B
SUBU.asm 924B
LUI.asm 924B
DIVU.asm 890B
B指令测试.asm 886B
XORI.asm 831B
XOR.asm 829B
SRAV.asm 754B
SRLV.asm 753B
SLLV.asm 696B
BGEZ.asm 535B
BLEZ.asm 530B
BGTZ.asm 520B
BLTZ.asm 514B
理想流水线测试.asm 458B
CS1508_U201514699_张鑫_data.circ 1.82MB
CS1508_U201514699_张鑫_storage.circ 965KB
CS1508_U201514699_张鑫_storage2.circ 959KB
CS1508_U201514699_张鑫_alu.circ 321KB
CS1508_U201514699_张鑫_alu.circ 320KB
分支预测.circ 303KB
重定向流水线.circ 260KB
气泡流水线.circ 251KB
理想流水线.circ 249KB
U201514714_张钧瑜_理想流水.circ 239KB
多级中断.circ 212KB
单级中断(bug).circ 184KB
单周期CPU_ccmb.circ 164KB
CS1508_U201514699_张鑫_CPU.circ 163KB
BHT林力韬.circ 110KB
BHT.circ 93KB
alu-test.circ 11KB
CS1508_U201514699_张鑫_组成原理课程设计报告.docx 4.82MB
CS1508_U201514699_张鑫.docx 2.57MB
计算机组成原理课程设计报告模板 2018-2-26 修订版.docx 2.09MB
CPU设计实验1.3.docx 359KB
CCMB输出汇总.docx 13KB
.gitattributes 66B
多级中断.hex 4KB
单级中断.hex 3KB
benchmark_ccmb.hex 2KB
排序测试.hex 630B
移位测试.hex 531B
JMP测试.hex 504B
走马灯测试.hex 396B
数据相关测试.hex 351B
乘除法.hex 225B
B指令测试.hex 207B
理想流水线测试.hex 162B
CS 3410 Components Guide.html 12KB
Mars4_5.jar 3.98MB
cs3410.jar 100KB
README.md 52B
MIPS32指令集完整.pdf 1.96MB
课程设计指南V1.9.pdf 1.94MB
存储系统实验V3.1.pdf 1.34MB
数据表示实验1.1.pdf 1.11MB
MIPS-C指令集.pdf 1.01MB
运算器实验V1.1.pdf 978KB
MARS使用手册.pdf 637KB
组原实验学生任务分配.pdf 274KB
MIPS_Green_Sheet.pdf 233KB
5段流水线CPU设计V4.1(2018-03-12).pptx 1.02MB
rom.txt 558B
Readme.txt 304B
data.txt 183B
decodShowInDisplay.v 8KB
TopLayer.v 7KB
decodShowInDisplay.v 7KB
TopLayer.v 4KB
controller - 副本.v 3KB
controller.v 3KB
alu.v 3KB
ALU.v 3KB
controll.v 3KB
decod_ShowInDisplay.v 2KB
DM - 副本.v 2KB
ID-EX.v 2KB
DM.v 1KB
counter - 副本.v 1KB
counter.v 1KB
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