## descirption
数电的课程设计,要求采用FPGA设计一个电子日历,于是突发奇想设计了有一个网络同步时间的功能,大体上就是在树莓派端用python编写程序(serial库调用串口ttyAMA1),然后在FPGA端设计一个UART的RX模块即可。
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数电的课程设计,要求采用FPGA设计一个电子日历,于是突发奇想设计了有一个网络同步时间的功能,大体上就是在树莓派端用python编写程序(serial库调用串口ttyAMA1),然后在FPGA端设计一个UART的RX模块即可。
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Python数电的课程设计网络同步时钟.zip (153个子文件)
__synthesis_is_complete__ 0B
runme.bat 219B
runme.bat 219B
top_file.bin 2.09MB
top_file.bit 2.09MB
top_file_routed.dcp 632KB
top_file_physopt.dcp 546KB
top_file_placed.dcp 544KB
top_file_opt.dcp 360KB
top_file.dcp 241KB
usage_statistics_webtalk.html 32KB
vivado.jou 762B
vivado.jou 757B
ISEWrap.js 8KB
ISEWrap.js 8KB
rundef.js 1KB
rundef.js 1KB
runme.log 47KB
runme.log 28KB
FPGA_calendar_final.lpr 335B
README.md 286B
vivado.pb 45KB
write_bitstream.pb 34KB
place_design.pb 13KB
route_design.pb 12KB
opt_design.pb 11KB
init_design.pb 6KB
phys_opt_design.pb 2KB
top_file_power_summary_routed.pb 722B
top_file_utilization_placed.pb 242B
top_file_utilization_synth.pb 242B
vivado.pb 149B
top_file_methodology_drc_routed.pb 54B
top_file_timing_summary_routed.pb 52B
top_file_route_status.pb 44B
top_file_drc_opted.pb 37B
top_file_drc_routed.pb 37B
top_file_bus_skew_routed.pb 30B
ds.png 162KB
UART_senter.py 2KB
calendar.rar 7KB
top_file_io_placed.rpt 98KB
top_file_methodology_drc_routed.rpt 92KB
top_file_control_sets_placed.rpt 36KB
top_file_timing_summary_routed.rpt 20KB
top_file_drc_routed.rpt 19KB
top_file_clock_utilization_routed.rpt 16KB
top_file_utilization_placed.rpt 9KB
top_file_power_routed.rpt 8KB
top_file_utilization_synth.rpt 7KB
top_file_drc_opted.rpt 3KB
top_file_bus_skew_routed.rpt 864B
top_file_route_status.rpt 588B
top_file_power_routed.rpx 374KB
top_file_methodology_drc_routed.rpx 162KB
top_file_timing_summary_routed.rpx 115KB
top_file_drc_routed.rpx 36KB
top_file_drc_opted.rpx 2KB
top_file_bus_skew_routed.rpx 1KB
.vivado.begin.rst 222B
.vivado.begin.rst 221B
.route_design.begin.rst 183B
.opt_design.begin.rst 183B
.write_bitstream.begin.rst 183B
.phys_opt_design.begin.rst 183B
.place_design.begin.rst 183B
.init_design.begin.rst 183B
.vivado.end.rst 0B
.init_design.end.rst 0B
.Vivado_Implementation.queue.rst 0B
.write_bitstream.end.rst 0B
.route_design.end.rst 0B
.phys_opt_design.end.rst 0B
.opt_design.end.rst 0B
.place_design.end.rst 0B
.vivado.end.rst 0B
.Vivado_Synthesis.queue.rst 0B
ISEWrap.sh 2KB
ISEWrap.sh 2KB
runme.sh 1KB
runme.sh 1KB
top_file.tcl 12KB
top_file.tcl 6KB
htr.txt 392B
htr.txt 384B
README.txt 129B
uart_recv.v 6KB
main_UART.v 5KB
smg.v 4KB
main_counter.v 4KB
Dcounter.v 4KB
hms_counter.v 3KB
top_file.v 3KB
Mcounter.v 3KB
Ycounter.v 3KB
disp_counter.v 2KB
key_debounce.v 2KB
ExceptFor.v 2KB
time_div.v 1KB
test_led2bcd.v 621B
共 153 条
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