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图:1-6
11、对参加到波形文件中的输入端口进展初始值设置,并点击 Processing/Start
Simuliation 进展仿真。查看仿真结果是否符合要求。
12、仿真无误后,选择Assignments/Assing Pins对实验中用到的管脚进展绑定分配,如
图 1-7 所示。
图 1-7
13、对于复用的引脚,需做进一步处理,使其成为通用 I/O。
14、最后再编译一次,编译无误后,用下载电缆通过 JTAG 接口将对应的 dff2.sof 文件
下载到 FPGA 中。
15、在实验系统中正确连线,观察实验结果是否与仿真结果相吻合。
四、实验报告
根据以上实验内容写出实验报告,包括设计流程,仿真结果及分析等内容。
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