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EDA-Verilog HDL期末复习题总结必过.docx
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EDA-Verilog HDL期末复习题总结必过
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EDA-Verilog HDL 期末复习题总结必过
选择题
1. 大规模可编程器件主要有 、 两类, 下列对 结构与工作原理的描述
中,正确的是( )。
. 全称为复杂可编程逻辑器件;
. 是基于乘积项结构的可编程逻辑器件;
.基于 的 器件,在每次上电后必须进行一次配置;
.在 公司生产的器件中, 系列属 结构。
2. 不完整的 语句,其综合结果可实现( )
A. 时序逻辑电路 B.组合逻辑电 C. 双向电路 D. 三态控制电路
3. 综合是 设计流程的关键步骤,在下面对综合的描述中,( )是错误的。
综合就是把抽象设计层次中的一种表示转化成另一种表示的过程;
综合就是将电路的高级语言转化成低级的,可与 的基本结构相映射的网表文
件;
为实现系统的速度、面积、性能的要求,需要对综合加以约束,称为综合约束;
综合可理解为一种映射过程,并且这种映射关系是唯一的,即综合结果是唯一的。
4. 大规模可编程器件主要有 、 两类,下列对 结构与工作原理的描述中,
正确的是( )。
全称为复杂可编程逻辑器件;
是基于乘积项结构的可编程逻辑器件;
基于 的 器件,在每次上电后必须进行一次配置;
在 公司生产的器件中, 系列属 结构。
5. 以下关于状态机的描述中正确的是( )
. 型状态机其输出是当前状态和所有输入的函数
.与 型状态机相比, 型的输出变化要领先一个时钟周期
. 型状态机其输出是当前状态的函数
.以上都不对
6. 目前应用最广泛的硬件描述语言是( )。
汇编语言
语言
7. 一模块的 端口说明: “ !"#$%&',则关于该端口说法正确的是( )。
输入端口,位宽为 (
输出端口,位宽为 (
输入端口,位宽为
输出端口,位宽为
8. 基于 软件的 设计流程为:原理图 文本输入 → 综合
)*****))适 配 → 编 程 下 载 → 硬 件 测 试 。 正 确 的 是+,。
- 功能仿真 ②时序仿真 ③逻辑综合 ④配置 ⑤分配管脚
.③① .①⑤ .④⑤ .④②
9. 下列标识符中, +,是不合法的标识符。
. ./ . . 0*12*. 3
10. 下列语句中,不属于并行语句的是:+,
.过程语句 . 33 语句 .元件例化语句 . 13 语句
11. 已知 “a =1’b1; b=3'b001;”那么 {a,b} =( C )
(A) 4'b0011 (B) 3'b001 (C) 4'b1001 (D) 3'b101
12. 在 verilog 中,下列语句哪个不是分支语句?( D )
(A) if-else (B) case (C) casez (D) repeat
13. 在 verilog 语言中整型数据在默认情况与( C )位寄存器数据在实际意义上是相同的。
(A) 8 (B) 16 (C) 32 (D) 64
14. 大规模可编程器件主要有 FPGA、 CPLD 两类,下列对 FPGA 结构与工作原理的描述
中,正确的是( C )
A. FPGA 全称为复杂可编程逻辑器件;
B. FPGA 是基于乘积项结构的可编程逻辑器件;
C.基于 SRAM 的 FPGA 器件,在每次上电后必须进行一次配置;
D.在 Altera 公司生产的器件中, MAX7000 系列属 FPGA 结构。
15. 请根据以下两条语句的执行,最后变量 A 中的值是 ( A )
reg [7:0] A;
A=2'hFF;
A. 8'b0000_0011 B. 8'h03 C.8'b1111_1111 D.8'b11111111
16. 下列描述中采用时钟正沿触发且 3 异步下降沿复位的代码描述是 ( )
、 435+!36127 63,
8+3,
、 435+!361273,
8+93,
、 435+!36127 63,
8+93,
、 435+ 6127!363,
8+3,
17. 关于过程块以及过程赋值描述中,下列正确的是( )
、在过程赋值语句中表达式左边的信号一定是寄存器类型;
、过程块中的语句一定是可综合的;
、在过程块中,使用过程赋值语句给 4赋值不会产生错误;
、过程块中时序控制的种类有简单延迟、边沿敏感和电平敏感。
18. 语言与 语言的区别,不正确的描述是( )
、 语言可实现并行计算, 语言只是串行计算;
、 语言可以描述电路结构, 语言仅仅描述算法;
、 语言源于 语言,包括它的逻辑和延迟;
、 语言可以编写测试向量进行仿真和测试。
19. ::下列模块的例化正确的是( )。
63 63 +3 +3 ,73"+3",,&
63 63 +3 +3 ,73"+3",,&
63 63 +3 +3 ,73"+3",&,&
63 63 +3 +3 ,&3"+3",,&
20. 下列关于 语言中模块的例化说法错误的是( )。
在引用模块时, 有些信号要被输入到引用模块中, 有些信号要从引用模块中输出
在引用模块时,必须严格按照模块定义的端口顺序来连接
在引用模块时可以用“ '符号,表明原模块是定义时规定的端口名,用端口名和被引用模
块的端口相对应,提高程序的可读性和可移植性
在语句“ 63 63 +!:+!:,7!;+!;,,&'中,被引用的模块为 63 模
块
21. 下列 语言中寄存器类型数据定义与注释矛盾的是( )。
#<$%33为 =位寄存器
1 1 为 :位寄存器
#$<%///#$><%///为 >=个 =位寄存器的数组
#:$?%66为 =位寄存器
22. 下列关于非阻塞赋值运算方式(如 @AB&)说法错误的是( )。
块结束后才完成赋值操作
@的值立刻改变
在编写可综合模块时是一种比较常用的赋值方式
非阻塞赋值符“ AB'与小于等于符“ AB'意义完全不同,前者用于赋值操作,
后者是关系运算符,用于比较大小。
23. 下列关于阻塞赋值运算方式(如 @B&)说法错误的是( )。
赋值语句执行完后,块才结束
@的值在赋值语句执行完后立刻就改变的
在沿触发的 43块中使用时,综合后可能会产生意想不到的结果
在“43'模块中的 型信号都采用此赋值方式
24. 在下列 运算符中,属于三目运算符的是( )。
CC
! BB
?:
BBB
25. 当 A时, 3的值是( )。
33 3B+DB;,E:$+A,E;$&
:
;
其他
26. 在 语言中的位拼接运算符是( )。
FG AD +, HH
27. 下面语句中,信号 会被综合成( )。
#?$%&
435+!3612,
8+33D:,
AB;&
38+33D:?,AB<&
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