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HDL 开发的流程和工具 IC设计流程典型芯片开发步骤.pdf

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HDL 开发的流程和工具 IC 设计流程典型芯片开发步骤

HDL 开发的流程和工具+IC 设计流程+典型芯片开发步

骤

2006-11-23 19:17:04| 分类：

|字号订阅 HDL 相关工具简介

HDL 即 Hardware Description Language，硬件描述语言，主

要用来描术电子电路的结构、行为、功能和接口。采用 HDL

语言描述电路与传统的利用原理图设计电路有很大的不同，

主要特点如下：

采用自顶向下的设计方式

采用语言描述硬件

多种输入方式

存档、交流方便

便于集体协作

便于早期规划

电脑辅助完成部分工作

电路验证更完善

HDL

语言有多种，现最流行的是 VHDL 和 Verilog

HDL，并且各有其特点。一般认为 VHDL 语法类似于 Ada

语言，语法繁锁，关键字较长，学习较困难，对电路的行为

描述能力较强，但对开关级电路描述能力

不强；Verilog 则类似于 C 语言，语法简洁，入门较易，对底

层电路描述能力较强，但行为描述能力较 VHDL 弱。但 VHDL

和 Verilog 的市场占有

率相当，且各 EDA 工具一般都支持两种语言，所以很难断

言哪种语言将更有前途。目前两种语言都在发展当中。最近

用 C 语言描述硬件电路也已加大了研究力度。

用 HDL 语言开发电路一般分为几个阶段：HDL 语言输入、

逻辑综合、仿真、布线,适配

。这是 FPGA/CPLD 开发中所用到的步骤，如果是集成电路

开发，则不需适配，在布局、仿真完成后即可到制程厂生产。

输入

较常用的输入方式是文本输入方式。一般的 HDL 仿真、综

合软件或 FPGA/CPLD 厂家提供的集成开发环境都包含语

法敏感的输入工具，不需要另外寻找。但也有例外，例如

Synopsys 的 FPGA

Express 就不带编辑器，给使用带来些许不变。Modelsim 所

带的编辑器不是很好用，且字体对齐有些问题。其余如

Xilinx、Altera、

Synplicity 提供的开发工具中的编辑器都不错。如果你感到不

满意，可寻找其它的编辑器，例如专业的 Turbo

Writer，使用相当方便。被众多程序员喜爱的 UltraEdit 在加

上语法模板之后非常好用，打开文件快速，占用资源少，各

项功能使用都相当方便。

另

一个较流行的方式是状态图输入方式。它可以让设计者采用

类似于画流程图的方式，设定好各种状态转换条件后，依靠

专用软件自动生成 HDL 源程序，简化了输入

过程。这类软件有 Visual Software Solutions, Inc 的 StateCAD、

Mentor Graphics 的 HDL

Designer Series 等。

电路图式输入方式也经常用到，这多是在利用现成的元件构

成电路时使用。例如一个设计中主要是采用 HDL 语言作

设计，而某个模块有现成的电路，一种方法是采用 HDL 语

言将电路按连线关系重新描述一遍，另一种是使用软件将该

电路自动转换成 HDL 源文件，例如

Xilinx 的 ISE 3.3 中就是采用此方式。

综合

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