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基于FPGA的数字时钟(可调时)BASYS2(绝对有用)
基于FPGA的数字时钟(可调时)BASYS2(绝对有用)
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FPGA
数字时钟
BASYS2
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基于FPGA的数字时钟(可调时),切换显示模式,BASYS2
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基于FPGA数字时钟的设计(VHDL代码)
浏览:8
5星 · 资源好评率100%
采用VHDL语言编写的数字时钟主要可以实现以下功能 (1)通电后从“00:00:00:00”开始显示,采用24小时制进行时间显示; (2)设计复位开关和启停开关,复位开关可以在任何情况下使用,使用以后计时器清零,并做好下一次计时的准备; (3)具有倒计时功能。
基于FPGA的数字时钟设计
浏览:133
基于FPGA的数字时钟设计,verilog HDL语言
基于fpga的按键可调数字钟
浏览:73
含闹钟功能的按键可调数字钟,是数码管显示的,也可对其进行改为液晶显示。
FPGA多功能数字时钟
浏览:49
4星 · 用户满意度95%
有时钟及修改功能,同时可设置三个独立的闹钟,各个闹钟有一半模式和懒人模式。
FPGA_Verilog basys2
浏览:94
FPGA_Verilog basys2
基于verilog的数字钟
浏览:186
3星 · 编辑精心推荐
一个基于verilog的数字钟程序,用xilinx的basys2开发板
Basys3原理图+使用手册-电路方案
浏览:125
Basys3介绍: Digilent 的 Basys3 是一款采用 Xilinx Artix 7 FPGA 架构的入门级 FPGA 板,专门用于 Vivado 设计套件。 Basys3 是广受欢迎的 Basys 入门级 FPGA 板系列的最新成员。 Basys3 具有所有 Basys 板的标准特性:全套现成的硬件、大量板载 I/O 设备、所有必要的 FPGA 支持电路和免费版开发工具,且全部以学生
basys2手册中文版
浏览:184
5星 · 资源好评率100%
basys2的手册文档,这个是中文版的,内容和英文原版一样,很好用的手册。了解basys2的基础知识
贪吃蛇游戏的FPGA实现课程设计报告——verilog
浏览:167
贪吃蛇游戏的FPGA实现课程设计报告,里面含有多篇课程设计报告,对程序的原理实现进行了详细的说明,还附有部分源码,有需要的朋友可以参考下
基于FPGA的打地鼠游戏课设报告
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5星 · 资源好评率100%
电子课设报告,全文一万多字,详细介绍了各模块的原理及实现方法。
数字钟与万年历 基于basys
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5星 · 资源好评率100%
自己做的数字钟与万年历,用basys2板子开发
基于FPGA的可调时钟(利用8051内核)
浏览:117
将8051内核下到FPGA中,实现对LCD的控制,实现可调时钟。
数字时钟的实现(verilog版)
浏览:194
本代码是基于FPGA编写的,采用的开发语言是verilog语言,实现的是一个数字时钟:包括小时、分钟、秒,包括对数字时钟的时间调节等动能!
多功能数字钟FPGA完整工程
浏览:128
5星 · 资源好评率100%
多功能数字钟代码 基于Basys2实验板 ISE开发环境 verilog 编程语言 实验已经下载验证通过
基于FPGA的串口收发(Basys2)
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5星 · 资源好评率100%
基于FPGA的串口收发(Basys2实现,一个负责发送数据,另一个接受数据)
Basys3实验指导手册
浏览:35
5星 · 资源好评率100%
Basys3实验指导手册,描述了开发板使用以及实践过程
FPGA入门学习资料(含14个完整工程实例,basys3,nexys2开发板资料,verilog 语法相关资料)
浏览:124
5星 · 资源好评率100%
FPGA 完整工程,非常适合新手入门,14个例子带你轻松入门FPGA,各编译环境适用,还附带basys3,nexys2开发板资料,verilog 语法相关资料
basys3_摩尔斯发报机
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3星 · 编辑精心推荐
数字电路中课程设计利用Basys3开发板设计的摩尔斯发报机,实现从外接键盘输入A~Z26个英文字母,对应的从开放版上显示出摩尔斯电码和信号灯指示
Basys3板上数码管的使用1
浏览:174
1、当前指令地址PC、下条指令地址PC 2、RS寄存器地址:RS寄存器数据 3、RT寄存器地址:RT寄存器数据 4、ALU结果输出 :DB总线 数据 2、七段数
Basys3入门指导手册_FPGAverilog_
浏览:39
Basys3入门指导手册,很好的资料,亲测有用
Basys 板子Verilog FPGA 秒表 计数器 分频 数码管显示
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4星 · 用户满意度95%
Basys 板子Verilog FPGA 秒表 计数器 分频 数码管显示
基于BASYS开发板的Verilog语言数码管时钟程序
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5星 · 资源好评率100%
基于Xilinx BASYS开发板,利用ISE软件Verilog语言编写的简单时钟,可以暂停以及设置时间。因为该开发板只有4个数码管,所以只有分秒的显示。如果为其他开发板,修改ucf文件即可。
FPGA入门捷径(Xilinx)基于BASYS2开发板
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5星 · 资源好评率100%
压缩包内包括Basys2的使用手册、原理图和一些开发板的Demo和程序下载软件。
Basys2数码管的显示与计数
浏览:181
5星 · 资源好评率100%
利用Verilog语言进行数码管的动态显示,SW0为复位键,SW0置1开始程序,初始四个数码管显示为0,每个数码管下有一个按键,BTN0~3。按下数码管对应位置的按键一下,对应数码管显示数字加一,加到九归零
FPGA basys2 信号发生器设计
浏览:40
5星 · 资源好评率100%
基于ise开发环境,构建顶层文件,实现信号发生器的设计。在basys2板子上完成正弦、方波、三角波的产生、调频、调幅等工作。
FPGA数字时钟计数器 Verilog实现
浏览:55
FPGA基于Verilog语言的普通数字时钟计数器代码
basys2资料2
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basys2开发板资料2
adept2(basys2工具)
浏览:78
3星 · 编辑精心推荐
用于basys2烧写的软件工具,资源占用小,适合xilinx编译的verilog程序
Xilinx Basy2板子动态显示译码加计数器Verilog HDL程序
浏览:66
5星 · 资源好评率100%
Verilog HDL 计数器加数码管动态显示程序。数电作业,自己编写的。
基于FPGA的数字时钟的设计
浏览:97
电子钟是人们日常生活中常用的计时工具,而数字式电子钟又有其体积小、重量轻、走时准确、结构简单、耗电量少等优点而在生活中被广泛应用。
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小时钟(可调时).zip
(15个子文件)
小时钟(可调时)
附录
Readme.txt
40B
sim
src
x7segbc.v
2KB
In50Mhz_Out100hz.v
775B
In50Mhz_Out3hz.v
792B
shift_array.v
2KB
counter6.v
791B
binbcd.v
997B
timer.v
2KB
mod10k.v
745B
tb_7seg.v
1KB
mod10cnt.v
1KB
In50Mhz_1hz.v
796B
clkdiv.v
796B
counter10.v
793B
counter3.v
966B
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观芯
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观芯
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