CPLD的VHDL代码

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CPLD的VHDL代码

: 基于CPLD的数字时钟设计VHDL代码 课程设计中的基于CPLD的数字时钟VHDL代码：由于此课程设计主要以CPLD--EPM570T100C5N芯片为主，通过Quartus II编程软件进行编程，能实现以了时间24小时为一个周期的计时和显示（时，分，秒共6个数码管显示）；...
评级：0 浏览量：349 收藏量：2 资源大小：27KB 上传时间：2023-04-23

: abc.rar_ABC_VHDL 串行通信_vhdl代码文中给出了cPLD与单片机的串行通信的C语言代码与VHDL代码有一定的使用价值
评级：0 浏览量：28 收藏量：0 资源大小：6KB 上传时间：2022-09-22

: tms320C6416T CPLD的VHDL代码 tms320C6416T CPLD的VHDL代码
评级：0 浏览量：96 收藏量：0 资源大小：40KB 上传时间：2012-04-01

: 异步FIFO的VHDL实现 --rtl 这是源代码 --sim 这是modelsim仿真目录已经验证，可以实现异步FIFO 两级寄存器实现读写指针的同步，地址采用格雷码形式防止亚稳态。异步FIFO的源码，个人觉得不易理解，故上传本人最近写的源码，与大家一起...
评级：0 浏览量：238 收藏量：2 资源大小：56KB 上传时间：2021-03-05

: VHDL实验二基于 VHDL 格雷码编码器的设计基于 VHDL 格雷码编码器的设计
评级：0 浏览量：1996 收藏量：6 资源大小：409KB 上传时间：2020-12-24

: cpld-clock.rar_CPLD_clock_clock vhdl_vhdl clock VHDL语言编写的时钟显示代码，简短而又易懂，个人觉得很不错
评级：0 浏览量：33 收藏量：0 资源大小：1KB 上传时间：2022-09-24

: cpld&8051总线接口vhdl源代码 cpld与8051的总线接口vhdl设计源代码，可参考
评级：0 浏览量：41 收藏量：1 资源大小：51KB 上传时间：2008-06-03

: VHDL 实验四八位七段数码管动态显示电路的设计当设计文件加载到目标器件后，将数字信号源模块的时钟选择为 1KHZ，拨动四位拨动开关，使其为一个数值，则八个数码管均显示拨动开关所表示的十六进制的值。
评级：5 浏览量：9780 收藏量：23 资源大小：408KB 上传时间：2020-12-24

: LED的VHDL代码 该程序是VHDL在CPLD上的运行程序,且该程序已经在CPLD开发板上已经运行通过,如果要改动的话需要改动相应的引脚说明
评级：0 浏览量：87 收藏量：0 资源大小：275KB 上传时间：2009-10-14

: CPLD原理图和测试代码资源包含了CPLD（EPM7128）原理，电路包含小系统和LED、按钮、蜂鸣器等，以及简单的测试程序，对于初学者可以按部就班快速入门学习。
评级：0 浏览量：302 收藏量：2 资源大小：550KB 上传时间：2013-09-01

: 采用CPLD/FPGA的VHDL语言电路优化原理设计使用VHDL进行CPLD/FPGA电路设计时，要根据实际项目的具体情况，合理地划分项目功能，并用VHDL实现相应的功能模块。用模块来构建系统，可有效地优化模块间的结构和减少系统的冗余度，并在模块设计过程中始终贯彻以上...
评级：0 浏览量：85 收藏量：0 资源大小：92KB 上传时间：2020-08-31

: 课设光立方代码_光立方vhdl_vhdl_ 基于CPLD，用VHDL语言编程，实现了一个8*8*8的光立方控制
评级：5 浏览量：186 收藏量：0 资源大小：7KB 上传时间：2021-10-04

: cpld-urat-vhdl.rar_UART CPLD_cpld uart_cpld串行通信_vhdl串行通信基于CPLD的VHDL UART代码，串行异步通信，含代码及仿真图
评级：0 浏览量：52 收藏量：0 资源大小：321KB 上传时间：2022-09-21

: EDA/PLD中的用VHDL语言在CPLD上实现串行通信(图) 本文利用VHDL语言在CPLD上实现了串行通信，完全可以脱离单片机使用，克服了单片机的许多缺点。串口结构及内容本设计所采用的是异步通信方式，可以规定传输的一个数据是10位，其中最低位为启动位(逻辑0低电平)，...
评级：0 浏览量：105 收藏量：0 资源大小：57KB 上传时间：2020-12-13

: 用VHDL语言对FPGA 和CPLD器件进行开发时应注意的事项在使用VHDL语言对FPGA和CPLD器件进行开发时，理解这两种器件的结构特点至关重要。FPGA（Field Programmable Gate Array）是通过可编程逻辑块（CLB）、输入/输出模块（IOB）和内部连线资源（PIA）来实现逻辑功能的，...
评级：0 浏览量：81 收藏量：0 资源大小：82KB 上传时间：2020-08-04

: jiaotongdeng.zip_CPLD JIAOTONGDE_VHDL 交通灯_jiaotongdeng_vhdl_交通灯一个用VHDL编写的在CPLD上实现模拟交通灯的程序源代码
评级：0 浏览量：53 收藏量：0 资源大小：385KB 上传时间：2022-09-24

: 按键消抖Verilog/VHDL程序按键消抖程序：文件中包括Verilog和VHDL的两种语言的Quartus II程序，请您参考。
评级：0 浏览量：963 收藏量：1 资源大小：97KB 上传时间：2018-08-01

: 数字频率计设计论文(CPLD+VHDL编程).doc 在本设计中，VHDL代码被用来定义CPLD内部的逻辑门电路，包括计数器、分频器、比较器等单元。通过仿真和综合，最终将VHDL程序下载到CPLD中，完成硬件配置。 2.3 软件设计软件部分主要集中在单片机的程序设计，包括...
评级：0 浏览量：23 收藏量：0 资源大小：5.6MB 上传时间：2023-07-10

: cpld用VHDL编写的音乐程序使用QUARTUSII为CPLD编写的音乐程序。使用VHDL语言编写。
评级：5 浏览量：90 收藏量：0 资源大小：221KB 上传时间：2009-08-09

: 基于IIC通信的EEPROM读/写Verilog/VHDL程序基于IIC通信的EEPROM读/写实验程序：当按键1按下时，通过IIC总线执行AT24C02的数据写入操作；当按键2按下时，通过IIC总线执行AT24C02的数据读出操作...文件中包括Verilog和VHDL的两种语言的Quartus II程序，请您参考。
评级：0 浏览量：1050 收藏量：1 资源大小：201KB 上传时间：2018-08-01

: 自动化-CPLD课程设计在CPLD课程设计中，学生将通过实际项目学习如何运用这些概念，包括编写VHDL代码、仿真电路行为、配置CPLD并验证最终设计的功能正确性。这不仅锻炼了学生的编程能力，还强化了他们对数字逻辑和硬件系统理解的能力。...
评级：0 浏览量：58 收藏量：0 资源大小：2.87MB 上传时间：2023-03-06

: iic.rar_CPLD IIC_CPLD单片机_IIC_iic vhdl_vhdl iic 单片机和cpld通信中的用vhdl编写的cpld源程序代码
评级：0 浏览量：37 收藏量：0 资源大小：1KB 上传时间：2022-09-24

: DDS 9851 VHDL驱动代码 fpga/cpld DDS 9851 VHDL并行驱动代码 fpga/cpld
评级：4 浏览量：48 收藏量：1 资源大小：1.47MB 上传时间：2009-08-22

: PS/2键盘解码Verilog/VHDL程序 CPLD通过PS/2接收键盘的数据，然后把接收到的大写字母A-Z的键值转换成相应的ASCII码，再通过串口传送给PC机。只要字母按键被按下，就能够在串口调试助手里显示相应的字母。文件中包括Verilog和VHDL的两种语言的...
评级：0 浏览量：424 收藏量：2 资源大小：382KB 上传时间：2018-08-01

: 北邮数电综合实验-基于 CPLD 的模拟单元门禁系统的设计与实现（包含vhdl代码、仿真）设计实现一个简易单元门禁系统，模拟呼叫住户和开关单元门的基本功能。基本要求： 1.本单元门禁系统的住户为 8 户，门牌号分别为 101、102、103、104、105、106、 107 和 108），按键 BTN0-BTN7 为各家户内开单元...
评级：0 浏览量：79 收藏量：0 资源大小：3.75MB 上传时间：2023-06-03

: 以CPLD为核心的定时器 CTRL模块的VHDL源代码中，定义了计数器的变量cnt，通过process语句处理时钟和控制信号，实现计数和减计数功能。当CN为高时，计数器加一，达到一定值后，通过COUT输出高电平。当CN为低时，计数器开始减计数，每60个...
评级：0 浏览量：127 收藏量：0 资源大小：59KB 上传时间：2020-08-05

: 基于CPLD的DRAM控制器设计方法通过VHDL语言编写完整的控制器源代码，可以实现更灵活和定制化的DRAM控制逻辑。总的来说，这篇文章深入介绍了如何利用CPLD和VHDL设计实现80C186XL微处理器的DRAM控制器，克服DRAM的时序挑战，优化嵌入式系统的存储...
评级：0 浏览量：51 收藏量：1 资源大小：261KB 上传时间：2020-08-31

: VHDL例程源代码《CPLDFPGA嵌入式应用开发技术白金手册》源代码《CPLDFPGA嵌入式应用开发技术白金手册》源代码
评级：0 浏览量：289 收藏量：0 资源大小：281KB 上传时间：2009-02-12

: VHDL 译码器基于CPLD的译语言码器代码，VHDL语言编写，适用于quartes II 软件
评级：0 浏览量：247 收藏量：0 资源大小：988B 上传时间：2018-06-17

: VHDL 实现秒表的控制利用VHDL实现一小时的秒表计时，适合于初学者对VHDL语言的学习
评级：0 浏览量：222 收藏量：1 资源大小：4KB 上传时间：2013-06-05

: 基于VHDL的串口通信程序本模块的功能是验证实现和PC机进行基本的串口通信的功能。需要在PC机上安装一个串口调试工具来验证程序的功能。程序实现了一个收发一帧10个bit（即无奇偶校验位）的串口控制器，10个bit是1位起始位，8个数据位，1个...
评级：0 浏览量：378 收藏量：0 资源大小：58KB 上传时间：2020-08-08

: VHDL设计的串口通信程序本模块的功能是验证实现和PC机进行基本的串口通信的功能。需要在PC机上安装一个串口调试工具来...　程序的工作过程是：串口处于全双工工作状态，按动key2，CPLD向PC发送皐elcome"字符串（串口调试工具设成按ASCII码接
评级：0 浏览量：199 收藏量：1 资源大小：57KB 上传时间：2021-01-19

: 基于VHDL的异步串行通信电路设计发送电路的VHDL代码展示了如何按照指定的帧格式发送数据。该电路包含一个进程，通过计数器变量记录已发送的数据位数，当达到10位（1位起始位、8位数据位、1位停止位）时，停止发送并保持发送端为逻辑1状态，等待下一...
评级：0 浏览量：78 收藏量：0 资源大小：121KB 上传时间：2020-10-22

: 一套CPLD开发板的VHDL源码及Verilog源码一套CPLD开发板的VHDL源码及Verilog源码
评级：3 浏览量：136 收藏量：0 资源大小：3.11MB 上传时间：2010-04-09

: 数字系统与VHDL程序设计语言001.pdf 设计者首先在该平台上编写VHDL代码，保存为以实体名命名的.VHD文件。接着，通过编译器对代码进行编译，以检查语法错误和逻辑问题。软件仿真则允许设计者在实际硬件实现前验证设计的功能。完成仿真后，设计会被安排到...
评级：0 浏览量：29 收藏量：0 资源大小：1.21MB 上传时间：2022-11-10

: 基于VHDL的数字系统层次化设计方法使用MAX+PLUS II开发软件完成设计输入、编译、逻辑综合和功能仿真，最后在CPLD上实现数字系统的设计。结果表明，使用这种设计方法可以大大地简化硬件电路的结构，具有可靠性高、灵活性强等特点。
评级：0 浏览量：121 收藏量：0 资源大小：210KB 上传时间：2020-10-17

: vhdl （ＣＰＬＤ）交通灯有一条主干道和一条支干道的汇合点形成十字交叉路口，主干道为东西向，支干道为南北向。为确保车辆安全，迅速地通行，在交叉道口的每个入口处设置了红、...本设计中由VHDL语言编程实现，分模块相连组成交通灯控制系统。
评级：4 浏览量：147 收藏量：0 资源大小：161KB 上传时间：2010-01-08

: VHDL中信号与变量的区别及赋值的讨论之变量的使用 VHDL中的信号与变量的区别及赋值的讨论之变量的使用在VHDL中，信号和变量是两个不同的概念，它们在赋值和使用方面存在着显著的差异。在本文中，我们将讨论变量的使用和赋值，包括普通赋值和时钟边沿赋值。变量的...
评级：0 浏览量：602 收藏量：0 资源大小：43KB 上传时间：2020-08-03

: usb.rar_CPLD_FIFO USB_bulk read SLAVE FIFO_fifo vhdl_vhdl usb 使用68013的测试程序，包含68013固件程序（采用slave FIFO bulk同步读写，EP2 OUT，EP6 IN），驱动，PC端测试用程序。CPLD的VHDL代码
评级：0 浏览量：39 收藏量：0 资源大小：989KB 上传时间：2022-09-23

: VHDL串口通信程序设计下面是VHDL代码的解析： * ENTITY UART :该语句定义了一个名为UART的实体。 * PORT (Clk : IN Std_logic; ...):该语句定义了UART实体的端口。 * ARCHITECTURE Arch OF UART IS :该语句定义了UART实体的架构。 * ...
评级：0 浏览量：277 收藏量：0 资源大小：48KB 上传时间：2020-07-31

: CPLD/FPGA开发VHDL经典实例源程序 CPLD/FPGA开发VHDL经典实例源程序，很有参考价值！！！
评级：5 浏览量：115 收藏量：0 资源大小：43KB 上传时间：2011-04-15

: mux21_2选1多路选择器的VHDL_ FPGA(现场可编程门阵列)与 CPLD(复杂可编程逻辑器件)都是可编程逻辑器件，它们是在PALGAL等逻辑器件的基础之上发展起来的。同以往的PALGAL等相比较，FPGA／CPLD的规模比较大，它可以替代几十甚至几千块通用IC芯片。...
评级：5 浏览量：2723 收藏量：1 资源大小：1KB 上传时间：2021-10-02

: 基于CPLD内部的反向器实现振荡器应用编写好代码后，通过编译综合工具生成可下载的配置文件，然后通过JTAG接口将程序下载到CPLD中，振荡器就开始工作了。在实际应用中，振荡器的频率可以通过调整外部RC网络的参数（R电阻和C电容）来改变。电阻越小、...
评级：0 浏览量：48 收藏量：0 资源大小：116KB 上传时间：2020-10-24

: 基于CPLD的郁金香培养游戏的设计与实现-北邮数电综合实验2018-VHDL状态机编程北邮电子院大三上学期的数电综合实验，利用Quartus/VHDL状态机编程实现郁金香培养（浇水、施肥、灭虫等），使用了btn、4x4键盘、点阵显示屏、数码管、蜂鸣器等，实现了郁金香的播种、萌芽、现蕾、含苞、初放、盛开、...
评级：5 浏览量：748 收藏量：3 资源大小：838KB 上传时间：2021-08-09

: 基于CPLD和ISA总线的数据采集系统设计介绍一种基于复杂可编程逻辑器件（CPLD）的数据采集系统，并给出详细的设计方案。计算机通过ISA总线实现与数据...通过VHDL编程实现CPLD对12位串行模数转换器ADS7816的控制。最后，给出该系统设计的仿真波形和测试结果。
评级：0 浏览量：75 收藏量：0 资源大小：769KB 上传时间：2021-01-30

: CPLD的串口通信设计 VHDL程序模块设计及描述部分使用VHDL对CPLD进行编程，设计了三个模块，波特率发生模块、接收器、发送器。波特率发生模块实际是一个分频器，本文设计的波特率为19.2kb/秒，设计使用的时钟频率为10MHz，所以计数器...
评级：1 浏览量：109 收藏量：0 资源大小：205KB 上传时间：2020-08-07

: 研究论文-基于CPLD和VHDL的一种线阵CCD 驱动时序电路的设计与实现研究论文-基于CPLD和VHDL的一种线阵CCD 驱动时序电路的设计与实现
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: CPLD实现的SPI控制的PWM代码 CPLD实现的SPI控制的PWM PWM精度6bit 4路PWM输出为了减少对电源的冲击，4路PWM的相位是不同的语言VHDL
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: 基于cpld自动售货机的代码【基于CPLD的自动售货机代码解析】自动售货机是一种常见的自动化零售设备，其核心在于能够根据用户的选择和投币情况进行精确的货币计算和货物分配。在这个项目中，设计者使用了CPLD（复杂可编程逻辑器件）来实现...
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: cpld_TFT43_lcd_src.rar_VHDL/FPGA/Verilog_PDF_ cpld上的lcd模块源代码，很有用的东东
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