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频率合成

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26.5 GHz, Integer N/Fractional-N,

记录表

ADF41513

5 位

r 计数器

高 Z 值



地线

输出复用器

模拟电源

参考时钟分频器

–

数据输出

32 位数据寄存器

整数值

1.8V 调节器

发现

锁

参考

25 位固定 /49 位可变小数插值器

充电泵

+ 相位频率

– 检测器

÷2

圆规

×2

加倍装置

模数 225 值分数值

计数器

PLL 频率合成器

特征

1 GHz 至 26.5 GHz 带宽超低噪

声 PLL

整数 N = 235 dBc/Hz，小数 N = 231 dBc/Hz 高最大 PFD

频率

整数 N = 250 MHz，小数 N = 125 MHz

25 位固定/49 位可变小数模数模式单端参考输入

3.3 V 电源、集成 1.8 V 逻辑功能的 3.3

V 电荷泵

相位再同步

可编程电荷泵电流:16 倍范围数字锁定检测

三线式串行接口，带寄存器回读选项硬件和软件掉电模

式，工作温度范围为 40°C 至+105°C

应用程序

测试设备和仪器仪表无线基础设施

微波点对点和多点无线电甚小孔径终端(VSAT)无线电航

空和国防

总体描述

ADF41513 是一款超低噪声频率合成器，可以用来实现高达

26.5 GHz，用于无线接收机和发射机的上变频和下变频部分。

ADF41513 采用高性能硅天竺葵(SiGe)、双极性互补金属氧化

物半导体(BiCMOS)工艺设计，归一化相位噪底为 235

dBc/Hz。鉴频鉴相器(PFD)的工作频率最高可达 250 MHz(整数

N 分频模式)/ 125 MHz(小数 N 分频模式)，可改善相位噪声和

刺激性能。当使用 49 位分频值时，可变模数,∑-δ 调制器可以

实现极高的分辨率。ADF41513 可以用作整数 N 分频锁相环

(PLL ),也可以用作小数 N 分频锁相环(PLL ),其固定模数用于亚

赫兹频率分辨率，可变模数用于亚赫兹精确频率分辨率。

当频率合成器与外部环路滤波器和压控振荡器(VCO)一起使用时，

就实现了一个完整的 PLL。26.5 GHz 带宽无需倍频器或分频器级，

简化了系统架构，降低了成本。ADF41513 采用紧凑型 24 引脚 4 mm

× 4 mm LFCSP 封装。

功能框图

AVDD1 AVDD1 AVDD2 AVDD3 AVDD4 AVDD5

疏散时间

REFIN

大脑性麻痹

MUXOUT

数字生活设计论坛

TXDATA

DC1

DC2

RFINA

RFINB

CLK

数据

报

CREG1

CREG2

地线

图一。

版本 0

文档反馈

ADI 公司提供的信息被认为是准确可靠的。然而，ADI 公司对其使用不承担任何责任，也不对因其

使用可能导致的任何专利或第三方权利的侵犯承担任何责任。规格如有变更，恕不另行通知。ADI

公司未以暗示或其他方式授予任何专利或专利权。商标和注册商标是各自所有者的财产。

美国马萨诸塞州诺伍德 9106 号邮政信箱 One Technology Way，邮编 02062-

技术支持

www.analog.com

16805

ADF4151

Data

Rev. 0 | Page

参数福建话典型最大值单位

测试条件/注释

逻辑输入

输入电压高(VIH)

低(VIL)

输入电流(IINH，IINL)输入

电容(CIN)

1.4

0.6

安

一

个

串行端口接口(SPI)模块可以接受 1.8 V 或 3.3 V

逻辑输入

逻辑输出

输出电压高

(VOH)

低(体积)

输出高电流，输出低电流

(IOH，IOL)

1.4

2.6

0.4

500

MUXOUT 电压= 1.8 V，DLD 电压= 1.8 V MUXOUT 电压=

3.3 V，DLD 电压= 3.3 V

电力供应

AVDD1、AVDD2、AVDD3、AVDD4、AVDD5

、VP IDD11

IDD 21

IDD 31

IDD 41

IDD 51

total

省电模式

3.135 3.3 3.465

2 3.2

63.5 88

2.1 3.6

1.45 2

20 25

6 7

95.1 128.8

100

妈

AVDD1 消耗的电流 AVDD2

消耗的电流 AVDD3 消耗

的电流 AVDD4 消耗的电

流 AVDD5 消耗的电流 VP

消耗的电流

AVDDx 和 VP 消耗的总电流

TA = 25°C，CE 为低电平，所有供电轨合计

噪声特性

归一化相位噪底(PNSYNTH)

在整数 N 模式 2 下

在小数 n 分频模式 3 下，归

一化 1∕f 噪声(PN1_f)3

235−

231−

128−

dBc/Hz

PLL 环路带宽(BW) = 1 MHz(整数 N 模式)

PLL 环路带宽= 1 MHz(小数 N 分频模式)10

kHz 偏移，归一化为 1 GHz

虚假信号

参考杂散 PFD 杂散

带内整数边界杂散

90−

87−

45−

dBc

参考= 100 MHz 时，PLL 环路带宽= 40 kHz，PFD

= 50 MHz 时，PLL 环路带宽= 40 kHz

10 kHz 偏移，PLL 环路带宽= 250 kHz

1 TA = 25°C，AVDDx = 3.3 V(其中 x = 1、2、3 或 4)，预分频器(P) = 8/9，fRFIN = 26.5 GHz，REFIN = 124 MHz，PFD 频率输入(fPFD) = 124 MHz。

2 频率合成器的本底相位噪声通过测量 VCO 输出端的带内相位噪声并减去 20 log N(其中 N 为 N 分频器值)和 10 log fPFD 来估算。PNSYNTH 是在 VCO 输出(pn tot)10 log

fPFD 20 log n 处测得的总相位噪声。

3 PLL 相位噪声由 1/f(闪烁)噪声加上归一化 PLL 噪底组成。计算 RF 频率 fRF 和频率偏移 f 下 1/f 噪声贡献的公式为:相位噪声(PN)= P1 f+10 log(10 kHz/f)+20 log(fRF/1 GHz)。归一化相位噪底和闪烁噪声都在中建模

ADIsimPLL。

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