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数字集成电路原理与设计：L5 时序逻辑电路 verilog.pdf
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时序逻辑电路
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时序逻辑电路
Verilog
Verilog
主讲人：姜小波
本章目录
2013
‐
04
‐
09
2
姜小波
本章目录
2013
‐
04
‐
09
3
姜小波
时序逻辑电路概述
数字电路按其完成逻辑功能的不同特点，划分为
组合逻辑电路
和
时序逻辑电路
两大类。
时序逻辑电路定义
：时序逻辑电路是一种输出不
仅与当前的输入有关
而且与其输出状态的原始状态
仅与当前的输入有关
，
而且与其输出状态的原始状态
有关的电路。相当于在组合逻辑的输入端加上了一个
反馈输入
在其电路中有
一
个存储电路
可以将输出
反馈输入
，
在其电路中有
个存储电路
，
可以将输出
的状态保持住。
2013
‐
04
‐
09
4
姜小波
时序逻辑电路概述
时序逻辑电路——有记忆功能
从逻辑上讲，
时序电路在任一时刻的输出不仅取决
于该时刻的输入
而且还和电路原来的状态
有关
于该时刻的输入
，
而且还和电路原来的状态
有关
。
从结构上讲
，
时序电路不仅仅由逻辑门组成
，
还包含
从结构上讲
，
时序电路不仅仅由逻辑门组成
，
还包含
有存储信息的有记忆能力的电路：触发器、寄存器等。
5
姜小波
2013
‐
04
‐
09
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