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实验五—变量译码器实验应用.pdf
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实验五—变量译码器应用实验报告
姓名:王凯
3090102720
学号: 专业:工科
课程名称:逻辑与计算机设计基础实验
2
实验时间:
010-10-26
同组学生姓名:无名
指导老师: 蒋方炎实验地点:紫金港东 4-509
一、实验目的和要求
1.进一步熟练掌握三态门的应用和总线共用分时传输的方法;
2.掌握变量译码器的逻辑构成和逻辑功能;
3.用变量译码器实现组合函数;
4.掌握变量译码器的典型应用(地址译码的具体方法);
5.了解存储器编址的概念;
6.进一步熟悉 ISE 平台和利用 Verilog 语言对 Spartan 3 实验板的应用。
二、实验内容和原理
2.1 在 Spartan 3 实验板上实现 3-8 译码器
实验原理:
(1)译码器是将一种输入编码转换成另一种编码的电路,即将给定的代码进行“翻译”并
转换成指定的状态或输出信号(脉冲或电平)。
(2)变量译码器是一个将n个输入变为2n个最小项输出的多输出端的组合逻辑电路。n通常
在2~64之间。
(3)3—8译码器
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