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verilog-usb--protel-design.rar_FPGA USB_USB ip verilog_USB2.0 ve
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vhdl/fpga/verilog
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基于FPGA的usb2.0 ip核设计,所用的语言是verilog
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USB2.0 IP核,ASIC,FPGA可用,Verilog HDL源代码
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这个是Verilog的USB控制程序,用于USB与FPGA之间的通信
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usb接口全源代码,直接fpga使用 usb2.0接口verilog源代码
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verilog-usb--protel-design.rar
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verilog usb protel design
usbf_rf.v
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usbf_top.v
17KB
usbf_pl.v
13KB
usbf_wb.v
7KB
usbf_mem_arb.v
5KB
usbf_ep_rf.v
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usbf_crc16.v
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usbf_utmi_if.v
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usbf_pd.v
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usbf_crc5.v
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