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整个工程代码.rar_FPGA 刷新_SDRAM控制器_fifo_rubbedbv3_串口 fifo
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sdram控制器
fifo
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掌握SDRAM数据读写、刷新、初始化以及FPGA串口收发时序,熟练FIFO IP核的生成和调用。
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整个工程代码.rar
(12个子文件)
整个工程代码
FIFO_PLL.v
6KB
sdram_write.v
7KB
top.v~
4KB
sdram_init.v
2KB
sdram_top.v
5KB
uart_rx.v
2KB
sdram_ref.v
2KB
sdram_decode.v
1KB
sdram_read.v
7KB
uart_tx.v
2KB
FIFO_PLL_inst.v
164B
top.v
4KB
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