+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Legal Partition Candidates ;
+-------------------------------------------------------+-------+----------------+--------------+----------------+--------+-----------------+---------------+-----------------+-------+----------------+--------------+------------------+-------------------+
; Hierarchy ; Input ; Constant Input ; Unused Input ; Floating Input ; Output ; Constant Output ; Unused Output ; Floating Output ; Bidir ; Constant Bidir ; Unused Bidir ; Input only Bidir ; Output only Bidir ;
+-------------------------------------------------------+-------+----------------+--------------+----------------+--------+-----------------+---------------+-----------------+-------+----------------+--------------+------------------+-------------------+
; Inst_LED ; 2 ; 0 ; 0 ; 0 ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
; Inst_FXSM ; 2 ; 4 ; 0 ; 4 ; 7 ; 4 ; 4 ; 4 ; 32 ; 0 ; 0 ; 0 ; 0 ;
; Inst_SYSCTL|Inst_pll0|altpll_component|auto_generated ; 3 ; 0 ; 0 ; 0 ; 6 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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; Inst_SYSCTL ; 2 ; 0 ; 0 ; 0 ; 5 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ;
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FXS_RW.rar_FPGA verilog_cyusb3014_fx3 slave fifo_fx3 verilog_usb
共1545个文件
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2022-09-24
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FX3作为FPGA核心的Slave完成与PC的通信验证例程。其中引脚需要按照自己的FX3开发板进行配置。默认配置是HSC的ALTERA开发板,EP4CE22F17C8+CYUSB3014。 同步FIFO传输,使用CyConsole验证通过。内附SignalTapII观察波形。
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FXS_RW.rar_FPGA verilog_cyusb3014_fx3 slave fifo_fx3 verilog_usb (1545个子文件)
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