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oram:递归统一ORAM
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2021-05-07
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该REAMDE描述了Tiny ORAM的代码结构。 介绍 微小的ORAM分为前端和后端,因为这导致了模块化的设计。 在系统级别,主要组件的连接方式如下: User design <= Memory interface => Frontend <= Position-based ORAM interface => Backend <= Memory interface => DRAM controller “内存接口”为:(op,地址,数据),其中op =读/写。 “基于位置的ORAM接口”是:(op,地址,数据,currentPos,NewPos),其中op =读/写/一些其他底层命令。 前端管理块到位置的映射,并将前端访问转换为一个或多个后端访问。 当前有一个统一的前端,它可以递归管理位置图(PosMap)。 当访问模式具有良好的局部性时,Unified前端使用PosMap-Loo
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oram:递归统一ORAM (146个子文件)
DRAM.constants 3KB
comp.dc 5KB
read.dc 2KB
lib_spec.dc 1KB
design_spec.dc 775B
waves.do 5KB
simulation.do 801B
Makefile 2KB
README.md 4KB
aes.pdf 72KB
testUORAM.prj 4KB
put ORAM ecc here 0B
sram2S_32soi_wrapper_gen.py 4KB
sram_32soi_wrapper_gen.py 4KB
sram1D_32soi_wrapper_gen.py 4KB
sram2D_32soi_wrapper_gen.py 4KB
rf2D_32soi_wrapper_gen.py 4KB
rf1D_32soi_wrapper_gen.py 3KB
RAM_dimensions.txt 7KB
AESREWORAM.v 50KB
StashCore.v 37KB
test_bench_top.v 36KB
Stash.v 32KB
RF1DFCMN00128X192D02C064_PWRAP.v 29KB
CoherenceController.v 28KB
StashTestbench.v 28KB
PathORAMBackendCore.v 23KB
IntegrityVerifier.v 22KB
RF1DFCMN00512X128D04C064_PWRAP.v 21KB
AESPathORAM.v 20KB
PathORAMBackendTestbench.v 17KB
DRAM2RAM.v 17KB
REWAESCore.v 17KB
testUORAM.v 16KB
FIFOControl.v 16KB
BackendCoreController.v 15KB
TrafficGenASIC.v 15KB
UORAMController.v 15KB
StashScanTable.v 15KB
table.v 14KB
StashTop.v 14KB
RF1DFCMN00128X078D02C064_PWRAP.v 14KB
PathORAMBackend.v 14KB
RAM.v 13KB
IntegrityVerifier.v 13KB
AESDWTestBench.v 13KB
SRAM1DFCMN01024X064D04C128_PWRAP.v 13KB
TinyORAMASICWrap.v 12KB
SynthesizedDRAM.v 12KB
FIFOShiftRound.v 12KB
aes_inv_cipher_top.v 11KB
testUORAM_synthBackend.v 11KB
aes_cipher_top.v 10KB
SynthesizedRandDRAM.v 10KB
LFSR.v 9KB
UORAMDataPath.v 9KB
TinyORAMCore.v 9KB
Frontend.v 9KB
PosMapPLB.v 9KB
testFrontEnd.v 9KB
FIFORAM.v 9KB
DRAMToStash.v 9KB
round2in1.v 9KB
aes_inv_sbox.v 8KB
aes_sbox.v 8KB
FIFORegister.v 7KB
DummyGenASIC.v 7KB
test_keccak.v 7KB
FIFOLinear.v 7KB
FIFORegControl.v 7KB
PrioritySelect.v 7KB
StashToDRAM.v 7KB
CountCompare.v 6KB
Pipeline.v 6KB
REWStatCtr.v 6KB
StashCoreTestbench.v 6KB
ShiftRegister.v 6KB
aes_192.v 6KB
DM_Cache.v 6KB
Counter.v 6KB
DRAMInitializer.v 5KB
Mux.v 5KB
SRAM_WRAP.v 5KB
Register.v 5KB
UDCounter.v 5KB
AESREWORAMTestbench.v 5KB
REWAESCoreTestbench.v 5KB
ClockSource.v 5KB
Reverse.v 5KB
CountAlarm.v 5KB
test_f_permutation.v 5KB
test_padder.v 5KB
AES_DW.v 5KB
Keccak_WF.v 5KB
aes_256.v 4KB
OneHot2Bin.v 4KB
AddrGen.v 4KB
Bin2Gray.v 4KB
Gray2Bin.v 4KB
keccak.v 4KB
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SouravGoswami
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