边缘提取的FPGA实现
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2018-05-23
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module Peri_Camera_Sobel
(
/* 时钟和复位 */
CLK_24M,RST_N,
/* 用户输入端口 */
original_href,original_wrreq,original_wrdata,
/* 用户输出端口 */
#fo_wrdata,#fo_wrreq,
/* 按键端口 */
KEY
);
//---------------------------------------------------------------------------
//-- 外部端口声明
//---------------------------------------------------------------------------
input CLK_24M; //时钟端口
input RST_N; //复位端口
input [ 7:0] KEY; //按键端口
input original_href; //没有处理过的行同步信
号
input original_wrreq; //没有处理过的写请求信
号
input [15:0] original_wrdata; //没有处理过的 16 位数据
output [15:0] #fo_wrdata; //FIFO 的写数据
output #fo_wrreq; //FIFO 的写使能
//---------------------------------------------------------------------------
//-- 内部端口声明
//---------------------------------------------------------------------------
wire process_href; //经过矩阵模块处理过的行同
步信号
wire process_wrreq; //经过矩阵模块处理过的
行同步信号
wire [ 7:0] matrix_p11; //矩阵第一行第一个数据
wire [ 7:0] matrix_p12; //矩阵第一行第二个数据
wire [ 7:0] matrix_p13; //矩阵第一行第三个数据
wire [ 7:0] matrix_p21; //矩阵第二行第一个数据
wire [ 7:0] matrix_p22; //矩阵第二行第二个数据
wire [ 7:0] matrix_p23; //矩阵第二行第三个数据
wire [ 7:0] matrix_p31; //矩阵第三行第一个数据
wire [ 7:0] matrix_p32; //矩阵第三行第二个数据
wire [ 7:0] matrix_p33; //矩阵第三行第三个数据
reg [ 9:0] Gx_temp1; //计算 Gx 矩阵的临时寄存器
wire [ 9:0] Gx_temp1_n; //Gx_temp1 的下一个状态
reg [ 9:0] Gx_temp2; //计算 Gx 矩阵的临时寄存器
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