基于TMS320F206的多协议数据传输
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2020-08-31
06:22:05
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基于基于TMS320F206的多协议数据传输的多协议数据传输
全数字电力线载波机等数字通信设备中通常要求在有限带宽的数据通道中传输多路话音和数据，此类设备传输
的数据格式不定，有同步数据格式、异步数据格式及不确定的非等时数据格式。
全数字电力线载波机等数字通信设备中通常要求在有限带宽的数据通道中传输多路话音和数据，此类设备传输的数据格式不
定，有同步数据格式、异步数据格式及不确定的非等时数据格式。另外，数据接口的速率也是变化的，必须能适应异步数据
300 b／s～19.2 kb／s，同步数据300 b／s～33.6 kb／s的不同数据速率的传输要求，因此多功能数据接口必不可少。当数据
速率较高时，普通的微处理器一般难以胜任。DSP芯片由于其特殊的流水线结构，能较好地解决诸如多路多协议高速数据复
分接等方面的难题。
1 设计思想
TMS320C2xx是美国TI公司出品的TMS320系列数字信号微处理器(Digital Signal Process，DSP)中的一种定点DSP，本设计
的核心器件是数字信号处理器TMS320F206，他是C2xx系列中惟一具有片内FLASH存储器的DSP芯片。
TMS320F206速度可达40 MIPS，单周期指令执行时间最快可达50 ns，具有丰富的片内外资源。可寻址的存储器空间为224
kB(程序空间64 kB，数据空间64 kB，I／O空间64 kB，还有32 kB的全局存储空间)；片内双向访问RAM为544 B，(288 B用于
数据，256 B可用于程序／数据)；片内有闪速存储器32 kB；片内有单访问RAM为4.5 kB。还有丰富的片内外设，软件可编程
的定时器；适用于程序、数据和I／O存储空间的软件可编程等待状态产生器；振荡器与锁相环，可实现时钟的选择：
×1，×2，×4和÷2；同步串行口；异步串行口。
CPLD由于其体积小、可靠性高、开发方便，已成为目前业界数字逻辑电路设计的首选。本设计选用Altera公司的MAX7000系
列CPLD芯片EPM7128。EPM7128可用门数目为2 500，宏单元数目为128，逻辑门阵列块数目为8，最大用户I／O数目为
100，正好满足系统对数字逻辑电路设计的要求。
MXL1543是多协议软件可编程数据传输接口芯片，与MXL1344A多协议软件可编程终端电阻网络配合使用，可使数据处理单
元方便快捷地满足用户不同数据格式的传输要求，灵活地选用V.10，V.11，V.28，V.35多种协议。因此，本设计选用
MXL1543和MXL1344A实现多协议接口。
2 硬件实现
该系统由以下几部分组成：
(1)以TMS320F206为核心的主控部分。
(2)以EPM7128SLC为核心的逻辑电路控制部分。
(3)总线驱动电路。
(4)多协议数据接口电路。
(5)看门狗电路。
以下具体分析各部分电路功能。
2.1 以DSP芯片为核心的主控电路
该部分电路由TMS320F206、晶体振荡电路和JTAG口组成。
TMS320F206端口提供了7根与仿真电路设计有关的仿真引脚，引脚76～82，连接到双列14脚的仿真插头。通过此JTAG口，
使用TI公司的XDS510仿真器即可进行在线仿真调试。必须注意：仿真插头为双列14引脚，其中第6脚应为空，作为定位引
脚。图中EMU0／1为仿真引脚，加入22 kΩ上拉电阻，以保证信号上升时间，PD与电源相连。用于电源检测，指示电缆是否
连接和目标系统是否加电，其他端与DSP对应端相连。注意在布线时仿真头与TMS320F206问距不大于6 in，否则要加入信号
缓冲器。
另外需要重视的是，TMS320F206虽然具有片内32 kB FLASH，但在调试状态下并不能实际使用，为了使仿真系统能正常工
作，必须在设计的目标系统中加入仿真时下载程序用的RAM。本电路采用2片CYC199完成。
引脚85～90是同步串行口的引脚，在本设计中此同步串口主要用于处理同步数据。同步串行口的工作需要3种信号：
时钟信号(CLKX／CLKR)，由CPLD产生送入；帧同步信号(FSX／FSR)由CPLD产生送入；数据信号，发送引脚(DX)连接到多
协议接口芯片的TTL发送端，接收引脚(DR)连接到多协议接口芯片的TTL接收端。
片内的异步串行口(ASP)可提供便的串口数据通信。片内共有4个寄存器异步数据发送和接收寄存器(ADTR)，异步串行口控制
寄存器(ASPCR)，I／O状态寄存器(IOSR)，波特率除法寄存器。还有2个程序员不可访问的寄存器：异步串行口发送移位寄存
器(AXSR)和异步串行口接收移位寄存器(ARSR)。共有6个引脚TX，RX，IO0，IO1，IO2，IO3。本设计中利用TX及RX进行
与上位机异步数据的传输，IO0～IO3作为通用的I／O口使用。
本设计利用通用输入引脚BIO、通用输出引脚XF及外部中断来处理用户的异步数据传输。
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