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Matlab代码verilog-spatial-filter-hdl:FPGA上的高吞吐量图像滤波器
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2021-05-27
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Matlab代码verilog FPGA上的图像处理空间滤波器 这是什么 ? 该存储库托管具有以下配置的通用空间(窗口,社区)图像过滤器的实现: 1. window size: 7x7, 5x5, 3x3 2. configurable filter coefficients (fixed point representation normalized to sum to 1) 3. configurable filter circuit (multiply add circuts : FPGA fabric, DSP, transposed form, direct form) 连同testbench文件和数据文件的组织方式如下: a. src: the filter verilog source files. b. test_io : data files (images and filter coefficints in their text files representation) c. testbench: verilog testbench files. Some are
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spatial-filter-hdl-master.zip (62个子文件)
spatial-filter-hdl-master
README.MD 3KB
src
counter.v 908B
dsp_adder24.v 7KB
row_buffers_no_border.v 8KB
sgnd_mult.v 1KB
row_buffers_no_temp.v 8KB
mult_add_cascade.v 5KB
filter_mask_no_temp.v 7KB
im_filter.v 11KB
dsp_adder48.v 4KB
no_border_scheme_mask.v 3KB
filter_mask_no_border.v 6KB
second_stage_adder.v 4KB
mult25x18_parallel_pipe.v 4KB
bailey_scheme_mask.v 3KB
filter_function_6_adder.v 10KB
adder_tree_LOG.v 7KB
control_unit.v 10KB
row_buffers.v 7KB
window_operator.v 3KB
no_brdr_dir_scheme.v 3KB
open_border_scheme_mask.v 3KB
filter_function_fabric.v 10KB
no_brdr_trnsps_scheme.v 7KB
filter_function.v 8KB
first_stage_adder.v 4KB
filter_buffer_mask_no_temp.v 55B
adder_tree_DSP.v 5KB
im_filter_no_temp.v 11KB
im_filter_no_border.v 8KB
adder_tree_DSPCOMP.v 7KB
filter_function_cas.v 6KB
control_unit_trnsps_scheme.v 10KB
control_unit_no_border.v 10KB
six_2_three_compressor.v 2KB
coefficient_file.v 1KB
control_unit_no_temp.v 10KB
array_pack_unpack.v 917B
six_input_adder.v 2KB
filter_function_tb.v 2KB
accum48.v 4KB
filter_mask.v 7KB
utils
some_useful_function.m 192B
TextToImage.m 844B
ImageToText.m 511B
test_io
FilCof.txt 123B
frog.png 303KB
frog_smoothing_cas_15.png 36KB
im_filter_no_border_pad.txt 221KB
im_filter_no_temp_pad.txt 221KB
frog100.png 40KB
frog_cas_tree.PNG 172KB
TextImage.txt 49KB
1.jpg 346KB
ImageText.txt 31KB
testbench
filter_tb2.v 6KB
filter_tb.v 3KB
mult25x18_parallel_pipe_test.v 728B
accum48_test.v 925B
dsp_adder48_test.v 790B
dsp_adder24_test.v 1KB
high-throughput-2d-filters-fpga.pdf 716KB
共 62 条
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