ep4cgx30 f484引脚表1
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2022-08-03
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Bank Number VREFB Group
Pin Name /
Function (2)
Optional
Function(s) (2)
Configuration
Function
F484 DQS for X8/X9 in F484 DQS for X16/X18 in F484 DQS for X32/X36 in F484
QL0 GXB_TX3p F2
QL0 GXB_TX3n F1
QL0 GXB_RX3p H2
QL0 GXB_RX3n H1
QL0 GXB_TX2p K2
QL0 GXB_TX2n K1
QL0 GXB_RX2p M2
QL0 GXB_RX2n M1
QL0 GXB_TX1p P2
QL0 GXB_TX1n P1
QL0 GXB_RX1p T2
QL0 GXB_RX1n T1
QL0 GXB_TX0p V2
QL0 GXB_TX0n V1
QL0 GXB_RX0p Y2
QL0 GXB_RX0n Y1
B3 MSEL3 MSEL3 P4
B3 MSEL2 MSEL2 R5
B3 MSEL1 MSEL1 P5
B3 MSEL0 MSEL0 T6
B3 CONF_DONE CONF_DONE U5
B3 nSTATUS nSTATUS R8
B3B VREFB3N2 REFCLK0p DIFFCLK_0p,CLKIO20 M7
B3B VREFB3N2 REFCLK0n DIFFCLK_0n N7
B3B VREFB3N2 REFCLK1p DIFFCLK_1p,CLKIO22 M8
B3B VREFB3N2 REFCLK1n DIFFCLK_1n N8
B3 VREFB3N2 IO PLL1_CLKOUTp T7
B3 VREFB3N2 IO PLL1_CLKOUTn T8
B3 VREFB3N2 IO PLL5_CLKOUTp U6
B3 VREFB3N2 IO PLL5_CLKOUTn V6
B3 VREFB3N2 IO PLL6_CLKOUTp U7
B3 VREFB3N2 IO PLL6_CLKOUTn V7
B3 VREFB3N2 IO INIT_DONE W8
B3 VREFB3N2 IO DIFFIO_B1p DATA5 W4
B3 VREFB3N2 IO DIFFIO_B1n DATA6 Y4
B3 VREFB3N2 IO DIFFIO_B2p DATA7 R9
B3 VREFB3N2 IO DIFFIO_B2n T9
B3 VREFB3N2 IO DIFFIO_B3p CRC_ERROR AA4
B3 VREFB3N2 IO DIFFIO_B3n NCEO AB3
B3 VREFB3N2 IO DIFFIO_B4p P10
B3 VREFB3N2 IO DIFFIO_B4n R10
B3 VREFB3N2 IO DIFFIO_B5p W5 DM3B/BWS#3B DM3B/BWS#3B DM5B/BWS#5B
B3 VREFB3N2 IO DIFFIO_B5n Y5 DQ3B DQ3B DQ5B
B3 VREFB3N2 IO VREFB3N2 V9
B3 VREFB3N2 IO DIFFIO_B6p R11 DQS1B/CQ1B#, DPCLK0 DQS1B/CQ1B#, DPCLK0 DQS1B/CQ1B#, DPCLK0
B3 VREFB3N2 IO DIFFIO_B6n T11 DQ3B DQ3B DQ5B
B3 VREFB3N2 IO DIFFIO_B7p W6 DQ3B DQ3B DQ5B
B3 VREFB3N2 IO DIFFIO_B7n Y6 DQ3B DQ3B DQ5B
B3 VREFB3N2 IO DIFFIO_B8p W7 DQ3B DQ3B DQ5B
B3 VREFB3N2 IO DIFFIO_B8n Y7 DQ3B DQ3B DQ5B
B3 VREFB3N1 IO DIFFIO_B9p AB4 DQ3B DQ3B DQ5B
Pin Information for the Cyclone
®
IV GX EP4CGX30F484 Device
Version 1.1
Note (1)
PT-EP4CGX30F484-1.1
Copyright © 2010 Altera Corp.
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